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關(guān)于硅光電應(yīng)用下的on-chip ESD的性能分析和介紹

弘模半導(dǎo)體 ? 來源:djl ? 2019-09-09 09:27 ? 次閱讀
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2006年前英特爾高級副總裁帕特·基爾辛格說:“今天,光學(xué)是一個非常小的細(xì)分技術(shù),明天,它將成為我們制造每一個芯片的主流?!?事實上,光互連對于內(nèi)部和數(shù)據(jù)中心之間的高速通信是非常重要的。

關(guān)于硅光電應(yīng)用下的on-chip ESD的性能分析和介紹

最近公司接觸的項目中,因為所有其他功都能高度集成在一個CMOS芯片上,外部只需要激光二極管。為了讓CMOS高速通信芯片和激光二極管之間實現(xiàn)高速通信,片上ESD(靜電保護)保護的寄生電容必須盡可能的小。在過去5年當(dāng)中,公司在不同的光互聯(lián)項目中,一直使用公司自創(chuàng)的TAKE CHARGE 工具,得到了很好的結(jié)果。當(dāng)通用的或者半導(dǎo)體廠的在片ESD不符合您的需求時,采用公司的TAKE CHARGE是非常理智的選擇。因為,TAKE CHARGE在數(shù)千個IC商業(yè)應(yīng)用芯片上已經(jīng)證明,它能提供一個快速,可靠的方式來平衡ESD保護與成本之間的關(guān)系,同時發(fā)揮最大的IC性能。

設(shè)計無約束

保護接口與最敏感的節(jié)點,如GATE,核心器件等

高速電路的低寄生電容

200fF,100fF甚至低于15fF

縮短幾個月量產(chǎn)和上市的時間

現(xiàn)有低寄生電容可用的on-chip ESD 解決方案ESD

TSMC: 180nm down to 28nm

UMC: 130nm, 65nm, 28nm

GF: 65nm

SMIC: 40nm

Several other foundries, …

針對其他技術(shù)節(jié)點或者半導(dǎo)體廠的私人定制EOS / ESD解決方案,可在幾天內(nèi)交貨

大幅降低IC成本

已經(jīng)在硅產(chǎn)品上被證明的ESD解決方案有助于降低IC開發(fā)成本和時

兼容所有的標(biāo)準(zhǔn)工藝流程

已經(jīng)和歐洲,美國的大客戶在光互連項目方面取得很多合作和經(jīng)驗

公司所有合作的客戶:

如果你在硅光電這塊或者高速電路這塊有涉足,那么公司的on-chip ESD 解決方案,會給貴公司產(chǎn)品帶來更多的附加價值。

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