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CAN總線為什么要有兩個120Ω的終端電阻

FPGA設(shè)計論壇 ? 來源:FPGA設(shè)計論壇 ? 作者:FPGA設(shè)計論壇 ? 2022-08-13 10:39 ? 次閱讀
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CAN總線為什么要有兩個120Ω的終端電阻

CAN總線兩端必須連接終端電阻才可以正常工作,終端電阻應該與通訊電纜的阻抗相同,典型值為120歐姆。其作用是匹配總線阻抗,提高數(shù)據(jù)通信的抗干擾性及可靠行。

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終端電阻的作用就是吸收信號反射及回波,而如果阻抗不連續(xù)以及不匹配便會產(chǎn)生信號反射,從而對傳輸?shù)男盘柈a(chǎn)生干擾。

如果把終端電阻加在單獨的兩根線上,相當于一個開環(huán)的狀態(tài)。這種連接方式會導致單線上阻抗更加不連續(xù),在末端突然變?yōu)?,會導致反射成倍增加。

高速CAN所加的兩個120歐的電阻實際上模擬的是線束連接無窮遠的時候在傳輸線上產(chǎn)生的特性阻抗(而不是實際阻抗),這是個典型經(jīng)驗值,具體值取決于所采用的線束類型。高速CAN之所以要加終端電阻,是因為高頻信號傳輸時,信號波長相對傳輸線較短,信號在傳輸線終端會形成反射波,干擾原信號,所以需要在傳輸線末端加終端電阻,使信號到達傳輸線末端后不反射。

低速CAN之所以不加終端電阻,是由于波長相對較長,反射和回波較弱。但低速CAN系統(tǒng)的控制單元會有自己獨立的終端電阻,它不是連接在CAN-high導線與CAN-low導線之間,而是連接在每根導線對地或?qū)?5V電源之間。如果蓄電池斷電,電阻就沒有了,這時用萬用表無法測出電阻。

CAN總線上的電平邏輯

顯性:表現(xiàn)為一個超出某個最小閾值差動電壓。顯性狀態(tài)會覆蓋隱形狀態(tài),它在顯性位期間發(fā)送。

隱性:隱形狀態(tài)下差分電壓近乎為0,在總線空閑或隱性位期間發(fā)送隱性狀態(tài)。

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CAN總線采用雙絞線差動信號的優(yōu)點

增強抗干擾能力

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審核編輯 :李倩

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原文標題:CAN總線為什么要有兩個120Ω的終端電阻

文章出處:【微信號:gh_9d70b445f494,微信公眾號:FPGA設(shè)計論壇】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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