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芯片代工新動向背后,PCB如何應(yīng)對高密度信號挑戰(zhàn)?

任喬林 ? 來源:jf_40483506 ? 2026-02-26 17:09 ? 次閱讀
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近日,有關(guān)英特爾可能于2027年為蘋果代工低端M系列芯片的消息引發(fā)關(guān)注,其核心技術(shù)基礎(chǔ)是18A先進(jìn)制程。這一進(jìn)展不僅關(guān)乎晶圓制造,也對下游封裝與互連技術(shù)提出更高要求,尤其是作為芯片與系統(tǒng)連接橋梁的PCB。

隨著晶體管尺寸縮小,芯片I/O密度持續(xù)上升,傳統(tǒng)FR-4單板已難以承載如此密集的信號走線。尤其在高頻高速應(yīng)用場景中,若PCB無法實(shí)現(xiàn)精細(xì)線路與穩(wěn)定阻抗控制,即便前端芯片性能優(yōu)越,整體系統(tǒng)也可能受限于“最后一厘米”的傳輸瓶頸。

這正是HDI技術(shù)價值顯現(xiàn)之處。通過盲埋孔設(shè)計(jì)與更薄介質(zhì)層壓合,HDI可在有限空間內(nèi)實(shí)現(xiàn)更多布線層級,提升互聯(lián)效率。同時,在應(yīng)對高頻信號時,合理選擇低損耗材料、優(yōu)化過孔結(jié)構(gòu),有助于減少串?dāng)_與反射,保障信號完整性。

值得注意的是,這類需求并不僅限于消費(fèi)電子旗艦產(chǎn)品。隨著高性能計(jì)算向邊緣設(shè)備滲透,越來越多終端開始采用類MCM(多芯片模塊)架構(gòu),這對載板級互連提出了類似要求。而PCB作為底層支撐平臺,其設(shè)計(jì)裕量和技術(shù)儲備往往決定了整機(jī)能否充分發(fā)揮芯片潛力。

我是捷多邦的老張,深耕PCB行業(yè)十二年,見過太多項(xiàng)目因忽視板級匹配而導(dǎo)致調(diào)試周期延長。真正成熟的硬件開發(fā),從來不是單一環(huán)節(jié)的突破,而是系統(tǒng)級的協(xié)同演進(jìn)。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
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