AD8283：高性能雷達(dá)接收路徑AFE的全面解析

在電子設(shè)計(jì)領(lǐng)域，尤其是雷達(dá)系統(tǒng)設(shè)計(jì)中，一款性能卓越的前端模擬前端（AFE）芯片至關(guān)重要。今天，我們就來深入探討Analog Devices推出的AD8283，一款專為高速斜坡、調(diào)頻連續(xù)波雷達(dá)（HSR - FMCW雷達(dá)）設(shè)計(jì)的6通道LNA/PGA/AAF與ADC集成芯片。

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產(chǎn)品概述

AD8283以低成本、低功耗、緊湊尺寸、靈活性和易用性為設(shè)計(jì)理念。它集成了六個(gè)通道的低噪聲前置放大器（LNA）、可編程增益放大器（PGA）和抗混疊濾波器（AAF），以及一個(gè)直接連接到ADC的通道，所有這些都與一個(gè)12位模數(shù)轉(zhuǎn)換器（ADC）集成在一個(gè)10 mm × 10 mm、72引腳的LFCSP封裝中。該芯片在 - 40°C至 + 105°C的汽車溫度范圍內(nèi)工作，非常適合汽車?yán)走_(dá)等應(yīng)用。

關(guān)鍵特性

通道特性

• 增益范圍：每個(gè)通道的增益范圍為16 dB至34 dB，以6 dB為步長(zhǎng)進(jìn)行可編程調(diào)節(jié)，能夠滿足不同信號(hào)強(qiáng)度的處理需求。
• 低噪聲性能：整個(gè)通道的輸入?yún)⒖荚肼曤妷涸谧畲笤鲆鏁r(shí)為3.5 nV/√Hz，這得益于其前端的超低噪聲LNA，有效降低了后續(xù)PGA和AAF的噪聲影響。
• 抗混疊濾波器：采用可編程的三階低通橢圓濾波器，截止頻率可在1 MHz至12 MHz之間進(jìn)行調(diào)節(jié)，通過片上調(diào)諧技術(shù)，減少了由于電阻和電容的標(biāo)準(zhǔn)IC工藝公差導(dǎo)致的截止頻率變化。

ADC性能

• 高分辨率與高采樣率：ADC具有12位的分辨率，采樣率最高可達(dá)72 MSPS，能夠滿足大多數(shù)HSR - FMCW雷達(dá)的需求。
• 出色的動(dòng)態(tài)性能：在1 MHz輸入頻率下，信噪比（SNR）可達(dá)68.5 dB，無雜散動(dòng)態(tài)范圍（SFDR）可達(dá)68 dB，能夠有效處理復(fù)雜的雷達(dá)信號(hào)。

功耗與封裝

• 低功耗設(shè)計(jì)：在12位/72 MSPS的工作模式下，每個(gè)通道的功耗僅為170 mW，同時(shí)還具備掉電模式，功耗可低至5 mW，適合對(duì)功耗敏感的應(yīng)用。
• 緊湊封裝：采用72引腳、10 mm × 10 mm的LFCSP封裝，節(jié)省了電路板空間，便于集成到小型化的雷達(dá)系統(tǒng)中。

工作原理

雷達(dá)接收路徑AFE架構(gòu)

AD8283在雷達(dá)接收路徑中扮演著關(guān)鍵角色。其信號(hào)鏈包含多個(gè)通道，每個(gè)通道由LNA、PGA、AAF和ADC組成。芯片內(nèi)部的多路復(fù)用器（mux）在ADC前自動(dòng)切換每個(gè)有效通道，DSYNC輸出指示通道A數(shù)據(jù)何時(shí)到達(dá)ADC輸出，每個(gè)有效通道的數(shù)據(jù)隨每個(gè)時(shí)鐘周期順序輸出。

各組件功能

• 低噪聲放大器（LNA）：輸入阻抗可通過SPI端口或ZSEL引腳選擇為200 Ω或200 kΩ，支持高達(dá)4.0 V p - p的差分輸出電壓。采用全差分拓?fù)浜拓?fù)反饋技術(shù)，有效降低了二階和三階失真。
• 抗混疊濾波器（AAF）：通過片上調(diào)諧技術(shù)調(diào)整電容，實(shí)現(xiàn)所需的截止頻率。默認(rèn) - 3 dB低通濾波器截止頻率為ADC采樣時(shí)鐘速率的1/3或1/4，可通過SPI進(jìn)行縮放調(diào)整。
• ADC：采用流水線式ADC架構(gòu)，量化輸出在數(shù)字校正邏輯中組合成12位結(jié)果。采樣在時(shí)鐘上升沿進(jìn)行，輸出級(jí)對(duì)齊數(shù)據(jù)、校正誤差并將數(shù)據(jù)傳遞到輸出緩沖區(qū)。

應(yīng)用場(chǎng)景

AD8283廣泛應(yīng)用于汽車?yán)走_(dá)系統(tǒng)，如自適應(yīng)巡航控制、碰撞避免、盲點(diǎn)檢測(cè)和自動(dòng)泊車等。其高性能的通道特性和低功耗設(shè)計(jì)，能夠滿足汽車?yán)走_(dá)對(duì)信號(hào)處理和可靠性的嚴(yán)格要求。

設(shè)計(jì)注意事項(xiàng)

時(shí)鐘輸入

為獲得最佳性能，AD8283的采樣時(shí)鐘輸入（CLK +和CLK -）應(yīng)使用差分信號(hào)進(jìn)行時(shí)鐘驅(qū)動(dòng)。可通過變壓器或電容進(jìn)行交流耦合，同時(shí)要注意時(shí)鐘抖動(dòng)對(duì)動(dòng)態(tài)范圍的影響。

電源與接地

建議使用兩個(gè)獨(dú)立的1.8 V電源和兩個(gè)獨(dú)立的3.3 V電源，分別為模擬和數(shù)字電路供電。同時(shí)，要使用多個(gè)去耦電容覆蓋高低頻，確保電源的穩(wěn)定性。

SPI接口

通過SPI接口，用戶可以配置信號(hào)鏈的特定功能或操作。在使用SPI時(shí)，要注意時(shí)鐘信號(hào)、數(shù)據(jù)信號(hào)和片選信號(hào)的時(shí)序關(guān)系，確保通信的準(zhǔn)確性。

總結(jié)

AD8283作為一款高性能的雷達(dá)接收路徑AFE芯片，憑借其出色的通道特性、低噪聲性能、高分辨率ADC和低功耗設(shè)計(jì)，為汽車?yán)走_(dá)等應(yīng)用提供了優(yōu)秀的解決方案。在實(shí)際設(shè)計(jì)中，工程師需要充分考慮時(shí)鐘輸入、電源接地和SPI接口等方面的因素，以確保芯片發(fā)揮最佳性能。你在使用AD8283或類似芯片時(shí)，遇到過哪些挑戰(zhàn)呢？歡迎在評(píng)論區(qū)分享你的經(jīng)驗(yàn)。