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發(fā)表于 02-04 15:22
RDMA設(shè)計(jì)35:基于 SV 的驗(yàn)證平臺(tái)
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發(fā)表于 02-01 13:14
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發(fā)表于 10-30 07:35
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發(fā)表于 08-29 14:33
NVMe高速傳輸之?dāng)[脫XDMA設(shè)計(jì)23:UVM驗(yàn)證平臺(tái)
驗(yàn)證的硬核 IP,因此在驗(yàn)證過程中可以只使用其接口進(jìn)行模擬,這將極大減小驗(yàn)證平臺(tái)復(fù)雜度和構(gòu)建難度,同時(shí)對驗(yàn)證的完備性影響較小.
發(fā)表于 08-26 09:49
NVMe高速傳輸之?dāng)[脫XDMA設(shè)計(jì)23:UVM驗(yàn)證平臺(tái)
抽象為 PCIeTLP 事務(wù),因此為了方便的在事務(wù)層構(gòu)建復(fù)雜的測試用例,項(xiàng)目基于 UVM 搭建驗(yàn)證平臺(tái)進(jìn)行功能驗(yàn)證。
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抽象為 PCIeTLP 事務(wù),因此為了方便的在事務(wù)層構(gòu)建復(fù)雜的測試用例,項(xiàng)目基于 UVM 搭建驗(yàn)證平臺(tái)進(jìn)行功能驗(yàn)證
NVMe高速傳輸之?dāng)[脫XDMA設(shè)計(jì)18:UVM驗(yàn)證平臺(tái)
驗(yàn)證的硬核 IP,因此在驗(yàn)證過程中可以只使用其接口進(jìn)行模擬,這將極大減小驗(yàn)證平臺(tái)復(fù)雜度和構(gòu)建難度,同時(shí)對驗(yàn)證的完備性影響較小.
發(fā)表于 07-31 16:39
NVMe簡介之AXI總線
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