資料介紹
This quadruple bus buffer gate features independent line drivers with 3-state outputs. Each output is disabled when the associated output-enable (OE) input is high.
To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
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- SN74AHC32Q-Q1,pdf(Quadruple 2-
- SN74LVC2G125-Q1,pdf(Dual Bus B
- SN74LVC125A-Q1,pdf(Quadruple B
- SN74LV125AT,pdf(QUADRUPLE BUS
- SN74F125,pdf(Quadruple Bus Buf
- SN74AUC126,pdf(QUADRUPLE BUS B
- SN74AUC125,PDF(QUADRUPLE BUS B
- SN74ALVC126,pdf(QUADRUPLE BUS
- SN74ALVC125,PDF(QUADRUPLE BUS
- SN74AHCT126-Q1,pdf(Quadruple B
- SN74AHCT125-Q1,pdf(Quadruple B
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