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采用像分區(qū)、自動(dòng)命名和拓樸匹配這樣的設(shè)計(jì)保存技術(shù)，有可能把解決問題所花費(fèi)的時(shí)間縮短幾個(gè)月。
作者：Eric Shiflet 和 Kate Kelley 賽靈思公司
在 FPGA 環(huán)境下，設(shè)計(jì)保存是一項(xiàng)復(fù)雜的實(shí)現(xiàn)挑戰(zhàn)，它需要保存的事項(xiàng)包括：一項(xiàng)設(shè)計(jì)的HDL 描述、一個(gè)模塊的綜合網(wǎng)表、約束文件內(nèi)的布局信息，以及在局部比特文件中的配置數(shù)據(jù)。賽靈思的IntegratedSoftware Environment (ISE) 9.1i 軟件以新的SmartCompile 技術(shù)為特色，其中包含兩種新的方法– SmartGuide 和Partitions-它可保存像布局或布線這樣的設(shè)計(jì)實(shí)現(xiàn)數(shù)據(jù)，并且可以減少解決問題所花費(fèi)的時(shí)間。
作者：Eric Shiflet 和 Kate Kelley 賽靈思公司
在 FPGA 環(huán)境下，設(shè)計(jì)保存是一項(xiàng)復(fù)雜的實(shí)現(xiàn)挑戰(zhàn)，它需要保存的事項(xiàng)包括：一項(xiàng)設(shè)計(jì)的HDL 描述、一個(gè)模塊的綜合網(wǎng)表、約束文件內(nèi)的布局信息，以及在局部比特文件中的配置數(shù)據(jù)。賽靈思的IntegratedSoftware Environment (ISE) 9.1i 軟件以新的SmartCompile 技術(shù)為特色，其中包含兩種新的方法– SmartGuide 和Partitions-它可保存像布局或布線這樣的設(shè)計(jì)實(shí)現(xiàn)數(shù)據(jù)，并且可以減少解決問題所花費(fèi)的時(shí)間。
賽靈思
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