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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>BDTI研究認(rèn)證以DSP為核心的FPGA設(shè)計(jì)的高級(jí)綜合流程

      BDTI研究認(rèn)證以DSP為核心的FPGA設(shè)計(jì)的高級(jí)綜合流程

      2011-02-25 | ??它 | 1.23 MB | 次下載 | 免費(fèi)

      資料介紹

      近年來，高級(jí)綜合工具已成為在設(shè)計(jì)方案中使用或希望使用FPGA的工程師的必殺技。這種工具以應(yīng)用的高級(jí)表示法（比如用C語言或MATLAB的M語言編寫的表示法）為輸入，并生成面向FPGA的硬件實(shí)現(xiàn)的寄存器傳輸級(jí)HDL描述。

      高級(jí)綜合工具(HLST)對(duì)兩種類型的潛在用戶非常有用，一是正在實(shí)現(xiàn)高強(qiáng)度數(shù)字信號(hào)處理(DSP)應(yīng)用的FPGA用戶，二是正在實(shí)現(xiàn)高強(qiáng)度數(shù)字信號(hào)處理(DSP)應(yīng)用的高性能DSP處理器用戶。這是因?yàn)樾盘?hào)處理工作負(fù)載非常繁重，通常需要較高的數(shù)據(jù)速率和高級(jí)并行處理能力，這種需求往往適合采用HLST的FPGA來實(shí)現(xiàn)。

      dsp FPGA
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