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如果設(shè)計 PCB 時不需要考慮時間這個因素，那么事情會簡單得多。設(shè)計 PCB 具有很強(qiáng)的多變性和復(fù)雜性，要做對每件事情，必須花上些時間才行。而現(xiàn)實卻是，時間對于任何 PCB 設(shè)計人員來說都是一個至關(guān)重要的因素。從滿足項目期限要求，到在腦海中構(gòu)思下個項目，再到在競爭對手之前搶占市場，時間永遠(yuǎn)是一個重要考慮因素。
我們無法簡單地快馬加鞭，迅速創(chuàng)建一個庫，輸入原理圖，然后處理 Layout，而把問題都留到最后。我們在 PCB 設(shè)計中總會有這樣那樣的漏洞；我們也可能會在庫方面出現(xiàn)技術(shù)錯誤，進(jìn)而導(dǎo)致在之后的設(shè)計流程中出現(xiàn)不匹配情況。我們可能會因違規(guī)而造成信號完整性問題和制造問題。不管怎樣，這些問題和許多其他問題都會使進(jìn)度落后于預(yù)定計劃。
那該如何解決問題呢？設(shè)置 PCB 設(shè)計約束！它們是成功的關(guān)鍵。如果在設(shè)計周期的早期設(shè)置好約束，則它們可以有效地防止錯誤的發(fā)生，所以完全值得我們花費時間對其進(jìn)行設(shè)置。
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