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在進行系統(tǒng)設(shè)計時節(jié)省時間和降低成本是很關(guān)鍵的。在原 型制作之前，系統(tǒng)設(shè)計人員可以用模型來進行設(shè)計仿真。 在高速系統(tǒng)設(shè)計中正是如此，進行信號完整性仿真來分析 不同條件下傳輸線中的電路行為，在設(shè)計初期就能預(yù)防并 檢測出典型的問題，例如過沖、欠沖、阻抗不匹配等。然 而，可用的數(shù)字IC模型非常少。當(dāng)半導(dǎo)體廠商被索要 SPICE模型時，他們并不愿意提供，因為這些模型會包含 有專有工藝和電路信息。 這個問題已經(jīng)通過采用IBIS模型來 (輸入/輸出緩沖器信息 規(guī)范)解決，IBIS也被稱為ANSI/EIA-656，這是一個建模的 新標準，在系統(tǒng)設(shè)計人員中越來越流行。
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