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標(biāo)簽 > 閂鎖效應(yīng)
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CMOS集成電路中閂鎖效應(yīng)的產(chǎn)生與防護(hù)
閂鎖效應(yīng)(Latch-up)是CMOS集成電路中一種危險(xiǎn)的寄生效應(yīng),可能導(dǎo)致芯片瞬間失效甚至永久燒毀。它的本質(zhì)是由芯片內(nèi)部的寄生PNP和NPN雙極型晶體...
2025-10-21 標(biāo)簽:集成電路CMOS閂鎖效應(yīng) 2.5k 0
TMUX9616/TMUX9616N 220V高壓16通道開(kāi)關(guān)技術(shù)解析
Texas Instruments TMUX9616 220V高壓16通道開(kāi)關(guān)是一款具有閂鎖效應(yīng)抑制的低電阻、低電容模擬開(kāi)關(guān)集成電路 (IC)。該模塊提...
2025-08-08 標(biāo)簽:集成電路低電容模擬開(kāi)關(guān) 1.3k 0
LU是 Latch Up的簡(jiǎn)寫(xiě),即閂鎖效應(yīng),也叫可控硅效應(yīng),表征芯片被觸發(fā)低阻抗通路后、電源VDD到GND之間能承受的最大電流。非車規(guī)芯片的規(guī)格書(shū)中通常...
一文搞懂閂鎖效應(yīng):電路里的“定時(shí)炸彈”與防護(hù)指南
CMOS工藝中的寄生晶閘管(SCR)結(jié)構(gòu),是由NMOS和PMOS的寄生NPN/PNP晶體管相互連接形成的。這些寄生晶體管平時(shí)處于關(guān)閉狀態(tài),但當(dāng)受到電壓尖...
2025-03-21 標(biāo)簽:CMOS電路閂鎖效應(yīng) 1.6k 0
?閂鎖效應(yīng)(Latch-up)是?CMOS工藝中一種寄生效應(yīng),通常發(fā)生在CMOS電路中,當(dāng)輸入電流過(guò)大時(shí),內(nèi)部電流急劇增加,可能導(dǎo)致電路失效甚至燒毀芯片...
芯片設(shè)計(jì)都不可避免的考慮要素—閂鎖效應(yīng)latch up
閂鎖效應(yīng),latch up,是個(gè)非常重要的問(wèn)題?,F(xiàn)在的芯片設(shè)計(jì)都不可避免的要考慮它。我今天就簡(jiǎn)單地梳理一下LUP的一些問(wèn)題。
2023-12-01 標(biāo)簽:CMOS芯片設(shè)計(jì)BJT 6k 0
閂鎖效應(yīng)(Latch-up)原理及其抑制方法解析
閂鎖效應(yīng):實(shí)際上是由于CMOS電路中基極和集電極相互連接的兩個(gè)BJT管子(下圖中,側(cè)面式NPN和垂直式PNP)的回路放大作用形成的
2023-12-01 標(biāo)簽:CMOS電路VDD閂鎖效應(yīng) 2.6萬(wàn) 0
HK32MCU應(yīng)用筆記(七)| 航順HK32MCU閂鎖效應(yīng)問(wèn)題研究及預(yù)防措施
HK32MCU應(yīng)用筆記(七)| 航順HK32MCU閂鎖效應(yīng)問(wèn)題研究及預(yù)防措施
2023-09-18 標(biāo)簽:晶體管閂鎖效應(yīng)航順芯片 2.6k 0
具有1.8V邏輯電平和閂鎖效應(yīng)抑制的TMUX720x44V、8:1單通道和4:12通道精密多路復(fù)用器數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 467 0
適用于單端和差分操作的現(xiàn)代化8:1多路復(fù)用器TMUX582F-SEP數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:復(fù)用器閂鎖效應(yīng) 461 0
具有閂鎖效應(yīng)抑制和1.8V邏輯電平的44V、低RON、2:1、4通道精密開(kāi)關(guān)TMUX7234數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 467 0
具有閂鎖效應(yīng)抑制和1.8V邏輯電平的44V、低RON、1:1 (SPST)、單通道精密開(kāi)關(guān)TMUX720x數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 429 0
具有閂鎖效應(yīng)抑制特性的互補(bǔ)金屬氧化物半導(dǎo)體(CMOS)開(kāi)關(guān)TMUX722x數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:金屬氧化物閂鎖效應(yīng) 554 0
具有1.8 V邏輯電平和閂鎖效應(yīng)抑制特性的44V 2:1 (SPDT)精密開(kāi)關(guān)TMUX7219數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 458 0
具有閂鎖效應(yīng)抑制和1.8V邏輯電平的低RON、1:1 (SPST) 4 通道精密開(kāi)關(guān)TMUX721x數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 438 0
具有1.8V邏輯電平和閂鎖效應(yīng)抑制的TMUX7219-Q1 44V 2:1 (SPDT)精密開(kāi)關(guān)數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 414 0
具有可調(diào)節(jié)故障閾值、1.8V邏輯電平和閂鎖效應(yīng)抑制的±60V故障保護(hù)、4 通道保護(hù)器TMUX7462F數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 550 0
具有閂鎖效應(yīng)抑制和1.8V邏輯電平的±60V故障保護(hù)、1:1 (SPST)、4 通道開(kāi)關(guān)TMUX741xF數(shù)據(jù)表立即下載
類別:電子資料 2024-03-20 標(biāo)簽:邏輯電平閂鎖效應(yīng) 411 0
一文搞懂閂鎖效應(yīng):電路里的“定時(shí)炸彈”與防護(hù)指南
什么是閂鎖(Latch-up)? CMOS 工藝中的寄生晶閘管(SCR)結(jié)構(gòu),是由 NMOS 和 PMOS 的寄生 NPN/PNP 晶體管相互連接形成的...
2025-03-21 標(biāo)簽:CMOS閂鎖效應(yīng) 3.3k 0
預(yù)防TVS閂鎖風(fēng)險(xiǎn)的方法與實(shí)際案例分析
仰賴先進(jìn)制程的進(jìn)步,電子產(chǎn)品得以在更小的面積及體積下實(shí)現(xiàn)更加復(fù)雜的功能與更低的功耗,在這樣的趨勢(shì)下卻也使得主芯片的靜電耐受度降低。由于靜電導(dǎo)致的失效與市...
2022-10-10 標(biāo)簽:ESDTVS閂鎖效應(yīng) 1.5k 0
什么是“閂鎖效應(yīng)”?這個(gè)詞兒對(duì)我們來(lái)講可能有點(diǎn)陌生。從構(gòu)造上來(lái)看,單片機(jī)由大量的PN結(jié)組成。有一個(gè)由四重結(jié)構(gòu)“PNPN”組成的部分,其中連接了兩個(gè)PN結(jié)...
2021-11-18 標(biāo)簽:CMOS單片機(jī)閂鎖效應(yīng) 5.5k 0
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