asic

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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

可行的平臺(tái)ASIC解決方案用于實(shí)現(xiàn)芯片上的定制系統(tǒng)

雖然需要定制邏輯解決方案的系統(tǒng)設(shè)計(jì)人員越來越多地面臨新的技術(shù)挑戰(zhàn)，但他們?cè)诙ㄖ菩酒a(chǎn)品方面擁有新的進(jìn)步和選擇。其中一個(gè)選擇是基于單元的ASIC和平臺(tái)AS...

2019-10-06 標(biāo)簽：asic 3.9k 0

為ASIC和SoC設(shè)計(jì)實(shí)現(xiàn)最佳化嵌入式存儲(chǔ)器

　在傳統(tǒng)的大規(guī)模ASIC和SoC設(shè)計(jì)中，晶片的實(shí)體空間大致可分為用于新的定制邏輯、用于可再使用邏輯（第三方IP或傳統(tǒng)的內(nèi)部IP）以及用于嵌入式存儲(chǔ)器三部份。

2013-07-10 標(biāo)簽：ASIC Soc 嵌入式存儲(chǔ)器 3.9k 0

為什么不把每一個(gè)類似的解決方案都構(gòu)建為ASIC呢?

PHY連接到包中的高帶寬內(nèi)存(HBM2)堆棧。值得注意的是，eSilicon在芯片和封裝級(jí)別的3D和2.5D系統(tǒng)構(gòu)建方面擁有豐富的經(jīng)驗(yàn)，包括在模具和封裝...

2018-09-03 標(biāo)簽：ASIC 人工智能 AI芯片 3.9k 0

基于FPGA的ASIC協(xié)同原型驗(yàn)證設(shè)計(jì)方案

鑒于芯片設(shè)計(jì)的復(fù)雜度提升，成功設(shè)計(jì)一個(gè)芯片所牽扯的步驟與過程也愈加復(fù)雜，所需花費(fèi)的資金也成倍增加，一個(gè)典型的芯片開發(fā)項(xiàng)目的周期和花銷如下所示 ? ? ...

2020-12-30 標(biāo)簽：fpga asic Xilinx 3.8k 0

ASIC在加密貨幣中應(yīng)用的障礙

許多人對(duì)ASIC的悲觀態(tài)度持續(xù)了很長(zhǎng)時(shí)間，并且也有足夠的理由。不過通用計(jì)算芯片像CPU、GPU甚至DRAM為了滿足通用計(jì)算需求都不能真正發(fā)揮其計(jì)算性能，...

2018-05-16 標(biāo)簽：芯片 ASIC 3.8k 0

幾種FPGA原理設(shè)計(jì)圖的性能與應(yīng)用分析

時(shí)至今日，F(xiàn)PGA市場(chǎng)的主要業(yè)者僅剩數(shù)家，包括Altera、Xilinx（賽靈思，過去稱為：智霖科技）、Actel、Atmel、Lattice、Quic...

2022-12-09 標(biāo)簽：fpga 單片機(jī)cpld 3.7k 0

FPGA在網(wǎng)絡(luò)安全產(chǎn)品設(shè)計(jì)中的作用 IPS上的奇葩還是到期的契約？

在網(wǎng)絡(luò)安全產(chǎn)品設(shè)計(jì)的時(shí)候，可以采用多種半導(dǎo)體解決方案，相對(duì)來講，目前主要采用的體系架構(gòu)包括了x86、NP、ASIC、FPGA四種。其中，CPU與NP的聯(lián)...

2018-04-18 標(biāo)簽：fpga asic xilinx 3.7k 0

如何實(shí)現(xiàn)優(yōu)于1％的輸出電壓精度的電源設(shè)計(jì)

隨著FPGA，DSP，ASIC和高性能處理器的工藝幾何尺寸不斷縮小，對(duì)電源電壓精度的要求越來越嚴(yán)格?，F(xiàn)在，內(nèi)核電壓通常會(huì)落在0.9V的范圍內(nèi)，內(nèi)核電流為...

2021-02-12 標(biāo)簽：處理器 fpga 集成電路 3.7k 0

“萬能芯片”FPGA在深度學(xué)習(xí)領(lǐng)域的用法

而眾所周知，在專用芯片與通用芯片中間，還有一個(gè)更為靈活，也更為神秘的領(lǐng)域：FPGA。無論是英特爾天價(jià)的收購(gòu)還是微軟與 IBM 雄心勃勃的計(jì)劃，都讓人對(duì)其...

2018-07-02 標(biāo)簽：fpga asic 深度學(xué)習(xí) 3.7k 0

高速低功耗的AES ASIC設(shè)計(jì)如何實(shí)現(xiàn)

AES是一個(gè)密鑰迭代分組密碼，對(duì)加密來說，輸入是一個(gè)明文分組和一個(gè)密鑰，輸出是一個(gè)密文分組。它將分組長(zhǎng)度固定為128比特，而且僅支持128、196或25...

2018-10-09 標(biāo)簽：asic 寄存器低功耗 3.7k 0

GB200關(guān)于PCB相關(guān)的問答

GB200架構(gòu)的推廣將對(duì)PCB廠商產(chǎn)生積極影響。隨著GB200架構(gòu)增強(qiáng)了GPU間的連接層，導(dǎo)致交換機(jī)ASIC數(shù)量增加，從而推動(dòng)了PCB價(jià)值量提升。

2024-04-28 標(biāo)簽：pcb asic gpu 3.7k 0

FPGA芯片中邏輯資源和門是如何對(duì)應(yīng)的

而且現(xiàn)在的LUT都是4輸入或者6輸入，可以做成邏輯門的組合，跟普通的邏輯門個(gè)數(shù)肯定不會(huì)是一對(duì)一關(guān)系。今天我們來看下這個(gè)關(guān)系如果對(duì)應(yīng)。

2022-11-11 標(biāo)簽：asic LUT FPGA芯片 3.6k 0

跨時(shí)鐘設(shè)計(jì)：異步FIFO設(shè)計(jì)

在ASIC設(shè)計(jì)或者FPGA設(shè)計(jì)中，我們常常使用異步fifo（first in first out）（下文簡(jiǎn)稱為afifo）進(jìn)行數(shù)據(jù)流的跨時(shí)鐘，可以說沒使...

2023-07-31 標(biāo)簽：fpga asic 接口 3.6k 0

異步FIFO設(shè)計(jì)原理及應(yīng)用需要分析

在大規(guī)模ASIC或FPGA設(shè)計(jì)中，多時(shí)鐘系統(tǒng)往往是不可避免的，這樣就產(chǎn)生了不同時(shí)鐘域數(shù)據(jù)傳輸?shù)膯栴}，其中一個(gè)比較好的解決方案就是使用異步FIFO來作不同...

2022-03-09 標(biāo)簽：fpga asic fifo 3.6k 0

FPGA和ASIC的工作原理、優(yōu)缺點(diǎn)及應(yīng)用領(lǐng)域

　　FPGA是一種現(xiàn)場(chǎng)可編程門陣列。它由大量的邏輯單元、輸入輸出模塊、存儲(chǔ)器和時(shí)鐘電路組成。FPGA的邏輯單元通常為可編程的邏輯單元，其內(nèi)部結(jié)構(gòu)由一組可...

2023-08-14 標(biāo)簽：fpga 集成電路模擬電路 3.6k 0

分散式與集中式汽車電子控制設(shè)計(jì)優(yōu)勢(shì)分析

借助應(yīng)用特定的 IC 簡(jiǎn)化車門電子系統(tǒng)設(shè)計(jì) 作者：Steven Keeping/Digi-Key 到 2030 年，電子系統(tǒng)將占一輛汽車成本的 50%，...

2020-10-14 標(biāo)簽：asic 線性穩(wěn)壓器電子系統(tǒng) 3.6k 0

CDC同步器設(shè)計(jì)方案：為什么使用異步路徑？

在第二周期的同步觸發(fā)器處正確捕獲了DIN處的數(shù)據(jù)（沒有亞穩(wěn)態(tài)）。源脈沖的長(zhǎng)度足以使目標(biāo)觸發(fā)器捕獲它。

2021-04-09 標(biāo)簽：asic 觸發(fā)器同步器 3.5k 0

鎖存器：組合電路與時(shí)序電路的橋梁

本系列整理數(shù)字系統(tǒng)設(shè)計(jì)的相關(guān)知識(shí)體系架構(gòu)，為了方便后續(xù)自己查閱與求職準(zhǔn)備。對(duì)于FPGA和ASIC設(shè)計(jì)中，避免使用Latch（鎖存器）一直是個(gè)繞不開的話題...

2023-08-08 標(biāo)簽：fpga asic 時(shí)序電路 3.5k 0

FPGA在醫(yī)療設(shè)備中有什么樣的作用

FPGA（現(xiàn)場(chǎng)可編輯門陣列）作為賽靈思（Xilinx）的一項(xiàng)重要發(fā)明，以其可編程和靈活性著稱。起初，F(xiàn)PGA只是用來仿真ASIC，再進(jìn)行掩碼處理和批量制...

2020-11-28 標(biāo)簽：FPGA ASIC 醫(yī)療設(shè)備 3.4k 0

EoPDH ASIC芯片的特點(diǎn)優(yōu)勢(shì)及應(yīng)用模式分析

由于以太網(wǎng)技術(shù)的成熟和低成本優(yōu)勢(shì)，以太網(wǎng)接入方式已經(jīng)成為很多用戶的首選。最早的客戶采用以太網(wǎng)到E1的轉(zhuǎn)換器，占用某幾個(gè)64kbit/s的時(shí)隙，而后逐步擴(kuò)...

2020-01-16 標(biāo)簽：芯片轉(zhuǎn)換器 asic 3.4k 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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