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      標簽　>　dut

      dut

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      dut技術

      UVM Transaction-Level Modeling (TLM)概述

      驗證生產力的關鍵之一是在一個合適的抽象級別上考慮驗證問題。也就是說，在驗證DUT時應該創(chuàng)建一個支持適當抽象級別的驗證環(huán)境。

      2023-05-22 標簽：RTLUVMTLM 1.6k 0

      如何設計和構建Testbench呢？

      Testbench是幾乎所有做動態(tài)仿真驗證的工程師都要面對的問題，可能是需要設計，或者開發(fā)，又或者是維護，總有很多事情要在這上面折騰。

      2023-05-08 標簽：UVMpython芯片驗證 1.6k 0

      如何在生成的代碼中使用UVM Register Layer？

      寄存器模型一般可以使用工具生成或者從頭開始編寫

      2023-06-05 標簽：寄存器UVM生成器 1.5k 0

      IC驗證中的打包思想簡析

      System Verilog（SV）語言的Class本身就帶有“打包”的基因。眾所周知，SV語言的很多特性是派生自C++語言的。

      2023-03-15 標簽：IC設計VerilogC++語言 1.5k 0

      如何驗證AMBA系統(tǒng)級環(huán)境

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      為了使 SOC 驗證工程師能夠創(chuàng)建高度可配置的 AMBA 結構，系統(tǒng)環(huán)境應提供占位符，用于將 DUT 與任何典型的 AMBA VIP 組件（如 AXI3...

      2023-05-29 標簽：socAMBADUT 1.5k 0

      簡化內存模型的調試

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      在這篇博客中，我將展示另一個功能，它使Verdi Protocol Analyzer成為調試內存協(xié)議問題和驗證正確系統(tǒng)行為的首選工具。此外，該工具還可用...

      2023-05-26 標簽：存儲器DDRDUT 1.5k 0

      測試平臺的建立方法

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      （1）DUT模型的建立 ?① 164245模型：在Modelsim工具下用Verilog HDL語言［5］，建立164245模型。164245是一個雙8...

      2023-10-30 標簽：測試IC模型 1.5k 0

      接口中的modport連接模塊都能看見什么

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      在構建測試平臺時，經(jīng)常會用到interface用來簡化模塊和測試平臺或者模塊之間的連接

      2023-06-25 標簽：DUT 1.5k 0

      射頻放大器測試系統(tǒng)中的電源噪聲

      射頻放大器測試系統(tǒng)中的電源噪聲

      噪聲是包括電源在內的測試系統(tǒng)中多余卻無法避免的問題。一部分的噪聲總是由電源（除了電池是低噪聲的電源）產生或者傳播的。

      2023-11-15 標簽：射頻放大器電源噪聲GND 1.5k 0

      模擬輸入測試的一個實際案例

      模擬輸入測試的一個實際案例

      前幾天剛好遇到一個模擬輸入測試的一個實際案例，我們一起來看看。

      2023-10-19 標簽：繼電器ECU測試分壓電路 1.4k 0

      軟件仿真、硬件仿真、原型驗證是如何工作的？

      軟件仿真、硬件仿真、原型驗證是如何工作的？

      在整個芯片開發(fā)中，芯片設計的驗證階段就像一場前線戰(zhàn)斗，可以說是整道防線上成敗的關鍵。在芯片進入生產之前，需要保證其設計完全符合需求規(guī)格，解決所有潛在的風...

      2023-06-14 標簽：寄存器VHDL語言RTL 1.4k 0

      認識一下只有driver的驗證平臺

      認識一下只有driver的驗證平臺

      對于一個驗證平臺而言，最重要的角色是激勵的產生，最開始，driver是集合了數(shù)據(jù)的產生、發(fā)送于一體這么一個重要的角色（后面到進入真正UVM會將功能分離）。

      2023-06-15 標簽：仿真器UVMCLK 1.4k 0

      Easier UVM Code Generator Part 1: 運行仿真

      在運行uvm代碼生成器后，我們現(xiàn)在可以開始運行仿真。同樣，我們將命令行放入腳本文件中

      2023-05-19 標簽：仿真器UVM生成器 1.4k 0

      UVM Transaction-Level驗證組件

      UVM Transaction-Level驗證組件

      如下圖所示，UVM中的TLM接口為組件之間Transaction的發(fā)送和接收提供了一套統(tǒng)一的通信方法。

      2023-05-29 標簽：發(fā)生器UVMTLM 1.4k 0

      創(chuàng)建約束隨機測試目標

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      為了實現(xiàn)驗證目標，測試用例開發(fā)者需要控制測試激勵的生成以覆蓋特定的場景。測試用例開發(fā)者可以用下面這些方法控制測試激勵的創(chuàng)建： 添加約束條件來控制單個數(shù)據(jù)...

      2023-06-17 標簽：數(shù)據(jù)仿真DUT 1.4k 0

      無源器件的大功率實時測量方案

      無源器件的大功率實時測量方案

      如果你是個跑步愛好者，你一定希望在運動過程中實時監(jiān)測自己的心率，而不是在運動結束后再用秒表來測量心率，因為后者不具備實時性，不能真實反映運動狀態(tài)下的心率...

      2023-07-15 標簽：大功率網(wǎng)絡分析儀無源器件 1.4k 0

      矢量網(wǎng)絡分析儀VNA的校準很重要嗎？

      編者注：在應用示波器、網(wǎng)分這類電子設備測試產品的時候，都建議熱機和校準。減少設備和環(huán)境引入的誤差。

      2023-02-13 標簽：濾波器示波器VNA 1.3k 0

      編寫動態(tài)的驗證環(huán)境

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      作為一名DV，開發(fā)驗證環(huán)境，編寫驗證環(huán)境也算是必備基礎技能了。雖然每天都會coding，但最終寫出來的代碼，是一次性代碼，還是方法？

      2023-07-17 標簽：處理器寄存器SoC芯片 1.3k 0

      SiC MOSFET柵-源電壓測量：探頭的連接方法

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      本文的關鍵要點?探頭的連接方法會給波形測量結果帶來很大影響。?如果延長線較長，在柵極引腳和源極引腳與測量夾具之間形成的環(huán)路會導致觀察到的波形與真正的波形...

      2023-02-09 標簽：MOSFET探頭SiC 1.3k 0

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      在上一篇文章中，我們了解了TC10規(guī)范的內容，并掌握了基于以太網(wǎng)鏈路的物理層休眠喚醒機制。為了確保不同廠商的設備在以太網(wǎng)休眠喚醒功能上的互操作性，OPE...

      2025-02-13 標簽：以太網(wǎng)物理層DUT 1.3k 0

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      • TMS320F28335
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