完善資料讓更多小伙伴認(rèn)識(shí)你,還能領(lǐng)取20積分哦,立即完善>
標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
文章:12961個(gè) 瀏覽:637163次 帖子:8006個(gè)
無論何時(shí),在復(fù)雜的 FPGA 設(shè)計(jì)過程中,都不可避免地需要在模塊之間發(fā)送數(shù)據(jù),實(shí)現(xiàn)這一點(diǎn)的常用的是 FIFO。
2022-09-20 標(biāo)簽:fpgaFPGA設(shè)計(jì)數(shù)據(jù) 3.8k 0
Vivado在FPGA設(shè)計(jì)中的優(yōu)勢(shì)
Xilinx的新一代設(shè)計(jì)套件Vivado相比上一代產(chǎn)品ISE,在運(yùn)行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。但是對(duì)初學(xué)者來說,新的約束語言X...
2022-09-19 標(biāo)簽:fpgaFPGA設(shè)計(jì)EDA工具 2.4k 0
筆者經(jīng)歷過一個(gè)項(xiàng)目,整個(gè)系統(tǒng)的功耗達(dá)到了100w,而單片F(xiàn)PGA的功耗估計(jì)得到為20w左右,有點(diǎn)過高了,功耗過高則會(huì)造成發(fā)熱量增大,溫度高最常見的問題就...
上圖是用與非門實(shí)現(xiàn)的D觸發(fā)器的邏輯結(jié)構(gòu)圖,CP是時(shí)鐘信號(hào)輸入端,S和R分別是置位和清零信號(hào),低有效; D是信號(hào)輸入端,Q信號(hào)輸出端;
2022-09-19 標(biāo)簽:fpga數(shù)據(jù)鎖存器 6.8k 0
TLM是transaction Level Modeling(事務(wù)級(jí)建模)的縮寫。簡(jiǎn)單來說,一個(gè)transaction就是把具有某一特定功能的一組信息封...
在設(shè)計(jì)仿真用例時(shí),有限制條件的激勵(lì)相比漫無目的的仿真更加有效的找出RTL的bug。因此,同一份測(cè)試方案,不同的sequence往往代表著不同的test_...
國(guó)產(chǎn)CPLD(AGM1280)試用記錄
AG1280和STM32、GD32等低成本MCU聯(lián)合使用時(shí),能將只有專用解決方案才能完成的功能帶給通用嵌入式系統(tǒng)。個(gè)人感覺,AG1280的最佳應(yīng)用場(chǎng)景是...
FPGA學(xué)習(xí)-如何實(shí)現(xiàn)PS和PL間的數(shù)據(jù)交互
交互數(shù)據(jù)將會(huì)經(jīng)過Zynq子系統(tǒng)的內(nèi)部總線(用空再考證一下是什么名稱)控制器“Central Interconnect”轉(zhuǎn)發(fā)給Memory Interfaces。
不同的用戶可能需要不同容量的RAM來構(gòu)建他們的特定應(yīng)用。所以FGPA底層的RAM基塊大小就是一個(gè)有意思的話題。如果太大,則不夠靈活,難以滿足小容量的應(yīng)用...
不同的用戶可能需要不同容量的RAM來構(gòu)建他們的特定應(yīng)用。所以FGPA底層的RAM基塊大小就是一個(gè)有意思的話題。
關(guān)于HDLBits的Verilog實(shí)現(xiàn)
從這一題開始我們將進(jìn)行過程塊的學(xué)習(xí),也就是時(shí)序和組合邏輯的一些知識(shí),下面簡(jiǎn)單介紹一下這方面知識(shí):
在實(shí)際工作中,許多公司對(duì)Verilog程序編寫規(guī)范都有要求。在公司內(nèi)部統(tǒng)一Verilog程序編寫規(guī)范不僅可以增強(qiáng)程序的可讀性、可移植性,而且也有助于邏輯...
SoC中的FPGA核,如Zynq MPSoC系列或Intel(原Altera)SoC,如Stratix SoC、Arria SoC等。
Xilinx的新一代設(shè)計(jì)套件Vivado相比上一代產(chǎn)品ISE,在運(yùn)行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。但是對(duì)初學(xué)者來說,新的約束語言X...
Verilog HDL(Hardware Description Language)是在用途最廣泛的C語言的基礎(chǔ)上發(fā)展起來的一種硬件描述語言,具有靈活性...
如何創(chuàng)建FPGA內(nèi)核/SoC所需的所有常用組件
LiteX 框架為創(chuàng)建 FPGA 內(nèi)核/SoC、探索各種數(shù)字設(shè)計(jì)架構(gòu)和創(chuàng)建完整的基于 FPGA 的系統(tǒng)提供了方便高效的基礎(chǔ)架構(gòu)。
2022-09-13 標(biāo)簽:fpga定時(shí)器數(shù)字設(shè)計(jì) 2.7k 0
探究DPU的緣起,DPU提升數(shù)據(jù)中心算力的三種方式
DPU的出現(xiàn)不僅僅是為解決CPU的算力瓶頸,而是要通過先天的網(wǎng)絡(luò)屬性,在數(shù)據(jù)中心整體TCO的維度提升算力。我們把DPU提升數(shù)據(jù)中心算力手段總結(jié)為算力卸載...
這部分,還是和上例中一樣,不同的是額外添加了一個(gè)font_row參數(shù),因?yàn)楸纠惺褂玫淖址际切枰獡Q行的,所以需要添加這個(gè)參數(shù)。
2022-09-09 標(biāo)簽:fpga數(shù)據(jù)OLED屏幕 1.4k 0
這是FPGA之旅設(shè)計(jì)的第十三例啦,本例是一個(gè)綜合性的例程,基于OLED屏幕顯示,和DHT11溫濕度采集,將DHT11采集到的溫濕度顯示到OLED屏幕上。
換一批
編輯推薦廠商產(chǎn)品技術(shù)軟件/工具OS/語言教程專題
| 電機(jī)控制 | DSP | 氮化鎵 | 功率放大器 | ChatGPT | 自動(dòng)駕駛 | TI | 瑞薩電子 |
| BLDC | PLC | 碳化硅 | 二極管 | OpenAI | 元宇宙 | 安森美 | ADI |
| 無刷電機(jī) | FOC | IGBT | 逆變器 | 文心一言 | 5G | 英飛凌 | 羅姆 |
| 直流電機(jī) | PID | MOSFET | 傳感器 | 人工智能 | 物聯(lián)網(wǎng) | NXP | 賽靈思 |
| 步進(jìn)電機(jī) | SPWM | 充電樁 | IPM | 機(jī)器視覺 | 無人機(jī) | 三菱電機(jī) | ST |
| 伺服電機(jī) | SVPWM | 光伏發(fā)電 | UPS | AR | 智能電網(wǎng) | 國(guó)民技術(shù) | Microchip |
| Arduino | BeagleBone | 樹莓派 | STM32 | MSP430 | EFM32 | ARM mbed | EDA |
| 示波器 | LPC | imx8 | PSoC | Altium Designer | Allegro | Mentor | Pads |
| OrCAD | Cadence | AutoCAD | 華秋DFM | Keil | MATLAB | MPLAB | Quartus |
| C++ | Java | Python | JavaScript | node.js | RISC-V | verilog | Tensorflow |
| Android | iOS | linux | RTOS | FreeRTOS | LiteOS | RT-THread | uCOS |
| DuerOS | Brillo | Windows11 | HarmonyOS |