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標(biāo)簽 > fpga

fpga

fpga

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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專(zhuān)用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。

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fpga技術(shù)

如何為5G基站組件提供最佳電源解決方案

自80年代初引入模擬蜂窩網(wǎng)絡(luò)以來(lái),蜂窩通信已有了長(zhǎng)足發(fā)展。如今,隨著市場(chǎng)由4G向5G網(wǎng)絡(luò)解決方案遷移,蜂窩通信行業(yè)正在為實(shí)現(xiàn)更快數(shù)據(jù)傳輸速度、更低延遲以...

2020-11-11 標(biāo)簽:fpga物聯(lián)網(wǎng)蜂窩網(wǎng)絡(luò) 4.1k 0

基于FPGA的全高清視頻采集顯示系統(tǒng)設(shè)計(jì)方案

基于FPGA的全高清視頻采集顯示系統(tǒng)設(shè)計(jì)方案

0 引言 隨著視頻顯示技術(shù)的發(fā)展,視頻信號(hào)從之前的標(biāo)清發(fā)展到高清,再發(fā)展到全高清,其分辨越來(lái)越高,數(shù)據(jù)量也成倍增加,這就推進(jìn)了顯示接口技術(shù)的高速發(fā)展,顯...

2020-11-11 標(biāo)簽:fpgaHDMISDRAM 6.2k 0

淺談FPGA配置狀態(tài)字寄存器Status Register的調(diào)試

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第一步要做的,永遠(yuǎn)都是拉出FPGA的狀態(tài)字寄存器Status Register看,它能直接告訴你或者極大地輔助判斷失敗的原因!

2020-12-01 標(biāo)簽:fpga寄存器Xilinx 1.1萬(wàn) 0

一文解析網(wǎng)絡(luò)壓縮算法的原理實(shí)現(xiàn)及結(jié)果

一文解析網(wǎng)絡(luò)壓縮算法的原理實(shí)現(xiàn)及結(jié)果

引言 網(wǎng)絡(luò)壓縮在AI加速中可以說(shuō)起到四兩撥千斤的作用,網(wǎng)絡(luò)參數(shù)的減小不僅僅降低了存儲(chǔ)和帶寬,而且使計(jì)算邏輯簡(jiǎn)單,降低了LUT資源。從本篇開(kāi)始,我們就一起...

2020-11-14 標(biāo)簽:fpga算法 3.7k 0

通過(guò)TI電源時(shí)序控制器在5G MIMO應(yīng)用的通信和控制

5G是目前通信設(shè)備領(lǐng)域的市場(chǎng)趨勢(shì), Massive MIMO指的是64T64R應(yīng)用中常用的多輸入和多輸出, 更多的發(fā)送器和接收器通道需要更多的數(shù)字處理器...

2020-12-01 標(biāo)簽:fpga服務(wù)器數(shù)字處理器 2.8k 0

應(yīng)用于CNN中卷積運(yùn)算的LUT乘法器設(shè)計(jì)

應(yīng)用于CNN中卷積運(yùn)算的LUT乘法器設(shè)計(jì)

卷積占據(jù)了CNN網(wǎng)絡(luò)中絕大部分運(yùn)算,進(jìn)行乘法運(yùn)算通常都是使用FPGA中的DSP,這樣算力就受到了器件中DSP資源的限制。比如在zynq7000器件中,D...

2020-11-30 標(biāo)簽:dspfpga寄存器 3.8k 0

針對(duì)LSTM實(shí)現(xiàn)硬件加速的稀疏化案例分析

本文介紹稀疏LSTM的硬件架構(gòu),一種是細(xì)粒度稀疏化,權(quán)重參數(shù)分布隨機(jī),另外一種是bank-balance稀疏化。 1. 文章結(jié)構(gòu) Long-short ...

2020-11-29 標(biāo)簽:FPGAfifo硬件加速 4.3k 0

Vivado中進(jìn)行ZYNQ硬件部分設(shè)計(jì)方案

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ZYNQ概述 ZYNQ內(nèi)部包含PS和PL兩部分,PS中包含以下4個(gè)主要功能模塊: Application processor unit (APU) Me...

2020-11-03 標(biāo)簽:fpga寄存器Zynq 6.3k 0

Xilinx Vivado I/O延遲約束介紹

1 I/O延遲約束介紹 要在設(shè)計(jì)中精確建模外部時(shí)序,必須為輸入和輸出端口提供時(shí)序信息。Xilinx Vivado集成設(shè)計(jì)環(huán)境(IDE)僅在FPGA邊界內(nèi)...

2020-11-29 標(biāo)簽:fpgaXilinx參考時(shí)鐘 6.4k 0

淺談FPGA內(nèi)部的時(shí)鐘網(wǎng)絡(luò)設(shè)計(jì)

時(shí)鐘網(wǎng)絡(luò)反映了時(shí)鐘從時(shí)鐘引腳進(jìn)入FPGA后在FPGA內(nèi)部的傳播路徑。 報(bào)告時(shí)鐘網(wǎng)絡(luò)命令可以從以下位置運(yùn)行: A,VivadoIDE中的Flow Navi...

2020-11-29 標(biāo)簽:fpga時(shí)鐘樹(shù) 3.9k 0

基于安卓手機(jī)的FPGA藍(lán)牙通信技術(shù)智能電子鎖控制系統(tǒng)

基于安卓手機(jī)的FPGA藍(lán)牙通信技術(shù)智能電子鎖控制系統(tǒng)

作者:柏 佳,魏 鑫,朱 廣,成都理工大學(xué)信息科學(xué)與技術(shù)學(xué)院,來(lái)源:2019年電子技術(shù)應(yīng)用第8期 摘要: 隨著人們安防意識(shí)的不斷增強(qiáng)和智能技術(shù)的持續(xù)發(fā)展...

2020-11-27 標(biāo)簽:fpga控制系統(tǒng)藍(lán)牙模塊 6.2k 0

CvP系統(tǒng)結(jié)構(gòu)解析 PCIE協(xié)議實(shí)現(xiàn)FPGA 配置案例

1. CvP 簡(jiǎn)介 CvP(Configuration via Protocol)是一種通過(guò)協(xié)議實(shí)現(xiàn) FPGA 配置的方案,Arria V,Cyclon...

2020-11-27 標(biāo)簽:fpgaPCIe 6.8k 0

基于賽靈思FPGA的廣告推薦算法Wide and deep硬件加速案例

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作者:雪湖科技 梅碧峰 在這篇文章里你可以了解到廣告推薦算法Wide and deep模型的相關(guān)知識(shí)和搭建方法,還能了解到模型優(yōu)化和評(píng)估的方式。我還為你...

2020-11-27 標(biāo)簽:fpga賽靈思機(jī)器學(xué)習(xí) 3.7k 0

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DDR對(duì)于做項(xiàng)目來(lái)說(shuō),是必不可少的。一般用于數(shù)據(jù)緩存和平滑帶寬。今天介紹下Xilinx DDR控制器MIG IP核的例化及仿真。 FPGA芯片:XC7K...

2020-11-26 標(biāo)簽:fpgaDDRXilinx 1.1萬(wàn) 0

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OFFSET語(yǔ)句:OFFSET說(shuō)明了外部時(shí)鐘和與其相關(guān)的輸入,輸出數(shù)據(jù)引腳之間的時(shí)序關(guān)系。

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xilinx FPGA中oddr,idelay的用法詳解

idelay2中按推薦配置,從DATAIN還是從IDATAIN輸入?yún)^(qū)別為是內(nèi)部延時(shí)還是從IO輸入,F(xiàn)IXED固定延時(shí),idelay value先輸入0,...

2020-11-25 標(biāo)簽:fpgaXilinxVivado 1.3萬(wàn) 0

基于相位累加器的任意分頻原理解析

在大部分的教科書(shū)中,都會(huì)提到如何分頻,包括奇數(shù)分頻,偶數(shù)分頻,小數(shù)分頻等。 1、DDS相位累加器 (1)DDS合成流程 首先講述DSS(直接頻率合成法)...

2020-11-29 標(biāo)簽:fpga低通濾波器分頻 6.3k 0

FPGA quartus ii里的靜態(tài)時(shí)序分析

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在fpga工程中加入時(shí)序約束的目的: 1、給quartusii 提出時(shí)序要求; 2、quartusii 在布局布線時(shí)會(huì)盡量?jī)?yōu)先去滿足給出的時(shí)序要求; 3...

2020-11-25 標(biāo)簽:fpga寄存器 7.8k 0

數(shù)字接口至轉(zhuǎn)換器的業(yè)界標(biāo)準(zhǔn)——JESD204

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隨著轉(zhuǎn)換器分辨率和速度的提高,對(duì)于效率更高的接口的需求也隨之增長(zhǎng)。JESD204接口可提供這種高效率,較之其前代互補(bǔ)金屬氧化物半導(dǎo)體(CMOS)和低壓差...

2020-11-24 標(biāo)簽:fpga轉(zhuǎn)換器adi 3.5k 0

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芯片型號(hào):XC7Z010-1CLG400C Vivado版本:2016.1 點(diǎn)亮流水燈,共使用了三種方式: (1)PS通過(guò)MIO點(diǎn)亮PS端LED (2)...

2020-11-24 標(biāo)簽:fpgaGPIOMIO 2.6萬(wàn) 0

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    IOT
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    IoT是Internet of Things的縮寫(xiě),字面翻譯是“物體組成的因特網(wǎng)”,準(zhǔn)確的翻譯應(yīng)該為“物聯(lián)網(wǎng)”。物聯(lián)網(wǎng)(Internet of Things)又稱(chēng)傳感網(wǎng),簡(jiǎn)要講就是互聯(lián)網(wǎng)從人向物的延伸。
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    海思
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    STM32F103C8T6
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    STM32F103C8T6是一款集成電路,芯體尺寸為32位,程序存儲(chǔ)器容量是64KB,需要電壓2V~3.6V,工作溫度為-40°C ~ 85°C。
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    數(shù)字隔離技術(shù)常用于工業(yè)網(wǎng)絡(luò)環(huán)境的現(xiàn)場(chǎng)總線、軍用電子系統(tǒng)和航空航天電子設(shè)備中,尤其是一些應(yīng)用環(huán)境比較惡劣的場(chǎng)合。數(shù)字隔離電路主要用于數(shù)字信號(hào)和開(kāi)關(guān)量信號(hào)的傳輸。另一個(gè)重要原因是保護(hù)器件(或人)免受高電壓的危害。本文詳細(xì)介紹了數(shù)字隔離器工作原理及特點(diǎn),選型及應(yīng)用,各類(lèi)數(shù)字隔離器件性能比較等內(nèi)容。
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  • 光模塊
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    光模塊(optical module)由光電子器件、功能電路和光接口等組成,光電子器件包括發(fā)射和接收兩部分。簡(jiǎn)單的說(shuō),光模塊的作用就是光電轉(zhuǎn)換,發(fā)送端把電信號(hào)轉(zhuǎn)換成光信號(hào),通過(guò)光纖傳送后,接收端再把光信號(hào)轉(zhuǎn)換成電信號(hào)。
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    Nexperia是大批量生產(chǎn)基本半導(dǎo)體的領(lǐng)先專(zhuān)家,這些半導(dǎo)體是世界上每個(gè)電子設(shè)計(jì)都需要的組件。該公司廣泛的產(chǎn)品組合包括二極管、雙極晶體管、ESD 保護(hù)器件、MOSFET、GaN FET 以及模擬和邏輯IC。
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    光立方是由四千多棵光藝高科技“發(fā)光樹(shù)”組成的,在2009年10月1日天安門(mén)廣場(chǎng)舉行的國(guó)慶聯(lián)歡晚會(huì)上面世。這是新中國(guó)成立六十周年國(guó)慶晚會(huì)最具創(chuàng)意的三大法寶之首。
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      SDK一般指軟件開(kāi)發(fā)工具包,軟件開(kāi)發(fā)工具包一般都是一些軟件工程師為特定的軟件包、軟件框架、硬件平臺(tái)、操作系統(tǒng)等建立應(yīng)用軟件時(shí)的開(kāi)發(fā)工具的集合。軟件開(kāi)發(fā)工具廣義上指輔助開(kāi)發(fā)某一類(lèi)軟件的相關(guān)文檔、范例和工具的集合。
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  • ESP8266
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    wifi模塊ESP8266的默認(rèn)波特率是115200,但是單片機(jī)不能達(dá)到那么快的傳輸速率,只能使用4800bps,那么設(shè)置的時(shí)候,必不可少的要先用轉(zhuǎn)串口調(diào)試下載器。
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