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fpga

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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門(mén)陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門(mén)電路數(shù)有限的缺點(diǎn)。

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fpga技術(shù)

Xilinx FPGA底層資源架構(gòu)與設(shè)計(jì)規(guī)范

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這一次給大家分享的內(nèi)容主要涉及Xilinx FPGA內(nèi)的CLBs,SelectIO和Clocking資源,適合對(duì)FPGA設(shè)計(jì)有時(shí)序要求,卻還沒(méi)有足夠了解...

2018-03-21 標(biāo)簽:fpgaxilinx 5.7k 0

基于FPGA的超級(jí)電容均壓及充放電設(shè)計(jì)方案

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由于超級(jí)電容器單體性能參數(shù)的離散性,當(dāng)多個(gè)單體串聯(lián)組成電容器組時(shí),在充放電過(guò)程中容易造成過(guò)充或過(guò)放現(xiàn)象,嚴(yán)重危害超級(jí)電容器的使用壽命。文中提出以FPGA...

2018-02-28 標(biāo)簽:FPGA超級(jí)電容串聯(lián)均壓 5.5k 0

針對(duì)Linux BSP開(kāi)發(fā)的Petalinux,如何實(shí)現(xiàn)硬件工程導(dǎo)入

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本實(shí)驗(yàn)工程將介紹如何利在賽靈思異構(gòu)多處理器產(chǎn)品系列 Zynq UtralScale+ MPSoC ZCU102 嵌入式評(píng)估板上實(shí)現(xiàn)多個(gè) UIO,同時(shí)借...

2018-02-27 標(biāo)簽:fpgaLinuxXilinx 1.9萬(wàn) 0

基于FPGA的改進(jìn)型FIR濾波器的實(shí)現(xiàn)

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FIR數(shù)字濾波器在數(shù)字信號(hào)處理的過(guò)程中有很好的線性相位和穩(wěn)定性,被廣泛應(yīng)用于音頻處理、語(yǔ)音處理、信息系統(tǒng)等各種系統(tǒng)中。隨著現(xiàn)代電子技術(shù)及EDA技術(shù)的發(fā)展...

2018-02-26 標(biāo)簽:FPGAFIR濾波器 3.6k 1

FPGA的FIFO實(shí)現(xiàn)過(guò)程

FIFO隊(duì)列有兩個(gè)位置指示指針。一個(gè)是寫(xiě)指針,指向隊(duì)列的第一個(gè)存儲(chǔ)單元。一個(gè)讀指針,指向隊(duì)列的最后一個(gè)存儲(chǔ)單元。當(dāng)有寫(xiě)命令的時(shí)候,數(shù)據(jù)寫(xiě)入寫(xiě)指針指向的存...

2018-06-29 標(biāo)簽:fpga仿真fifo 1.6萬(wàn) 0

Xilinx不同F(xiàn)PGA集成的GTx及性能

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GTx接收和發(fā)送方向均由PCS和PMA兩部分組成,PCS提供豐富的物理編碼層特性,如8b/10b編碼等;PMA部分為模擬電路,提供高性能的串行接口特性,...

2018-06-29 標(biāo)簽:fpgaxilinxgtx 1.1萬(wàn) 0

FPGA設(shè)計(jì)過(guò)程中定點(diǎn)小數(shù)計(jì)算要注意些什么

兩個(gè)FIX_32_30相乘得到的數(shù)據(jù)是 FIX_64_60,我們發(fā)現(xiàn)這個(gè)結(jié)果最大值為-1~+1,所以只需要保留兩位整數(shù)位即可(其中一位為符號(hào)位)即通過(guò)截...

2018-06-28 標(biāo)簽:fpga可編程邏輯 2.5k 0

FPGA設(shè)計(jì)的創(chuàng)新調(diào)試手段

EXOSTIV Probe從各方面都優(yōu)于傳統(tǒng)調(diào)試方案,它支持Xilinx所有系列,采用高速SerDes接口實(shí)現(xiàn)數(shù)據(jù)采集和通信,EXOSTIV Probe...

2018-06-28 標(biāo)簽:fpga硬件調(diào)試 2.2k 0

數(shù)字信號(hào)處理架構(gòu)下FPGA,ARM,DSP的對(duì)比

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信號(hào)處理系統(tǒng)一般不單單是模擬信號(hào)或者數(shù)字信號(hào),一般兩者都會(huì)有。信號(hào)的處理關(guān)注的是信號(hào)以及信號(hào)所包含的信息的表示、變換及運(yùn)算。

2018-03-21 標(biāo)簽:dspfpgaarm 5.4k 0

通過(guò)Xilinx FFT IP核的使用實(shí)現(xiàn)OFDM

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由于OFDM接收機(jī)中大多是數(shù)據(jù)串并轉(zhuǎn)換后的連續(xù)低速并行數(shù)據(jù)流輸入FFT,故這里采用流水線結(jié)構(gòu)。之后根據(jù)OFDM子載波數(shù)選擇變換長(zhǎng)度。該IP核僅支持50M...

2018-06-26 標(biāo)簽:fpgaofdmxilinx 2.5k 0

FPGA工程開(kāi)發(fā)中仿真的重要性

很多初學(xué)者入門(mén)FPGA的時(shí)候所學(xué)習(xí)的編程例子都是很簡(jiǎn)單的,比如流水燈、數(shù)碼管點(diǎn)亮之類的。這種入門(mén)級(jí)別的例子有個(gè)特點(diǎn),代碼量少,邏輯簡(jiǎn)單,分析容易。而且大...

2018-06-26 標(biāo)簽:fpga仿真 3.6k 0

Xilinx IP核配置,一步一步驗(yàn)證Xilinx Serdes GTX最高8.0Gbps

之前用serdes一直都是跑的比較低速的應(yīng)用,3.125Gbps,按照官方文檔一步一步來(lái)都沒(méi)出過(guò)什么問(wèn)題,這次想驗(yàn)證一下K7系列GTX最高線速8Gbps...

2018-03-26 標(biāo)簽:fpgaxilinxIP核 1.2萬(wàn) 0

Xilinx FPGA中SRL原理

基于SRL16的分布式RAM不再支持V5、S6和V6等器件,但是SRL16是所有XIlinx器件都支持的,并且在設(shè)計(jì)中應(yīng)用非常頻繁,因此可通過(guò)調(diào)用原語(yǔ)的...

2018-05-05 標(biāo)簽:fpgaxilinxsrl 7.9k 0

FPGA基礎(chǔ)知識(shí)之IIC協(xié)議讀寫(xiě)解析

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很多數(shù)字傳感器、數(shù)字控制的芯片(DDS、串行ADC、串行DAC)都是通過(guò)IIC總線來(lái)和控制器通信的。不過(guò)IIC協(xié)議仍然是一種慢速的通信方式,標(biāo)準(zhǔn)IIC速...

2018-05-05 標(biāo)簽:fpgaiic協(xié)議 9k 0

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UART通信的一幀一般由11到12位數(shù)據(jù)組成。1bit的起始位,檢測(cè)為低電平表示數(shù)據(jù)開(kāi)始傳輸;緊接著8bits的數(shù)據(jù);然后是1bit的奇偶校驗(yàn)位,可以是...

2018-05-05 標(biāo)簽:fpgauart 9.1k 0

FPGA基礎(chǔ)設(shè)計(jì)_PS2鍵盤(pán)控制及短按、長(zhǎng)按

PS2鍵盤(pán)也是一個(gè)經(jīng)典的實(shí)驗(yàn),可能很多人接觸如何對(duì)通信協(xié)議、時(shí)序編程就是從這個(gè)實(shí)驗(yàn)開(kāi)始學(xué)習(xí)的。USB鍵盤(pán)已經(jīng)很普及,現(xiàn)在市場(chǎng)上還是有一些USB轉(zhuǎn)PS2的...

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FPGA基礎(chǔ)設(shè)計(jì)之VGA顯示方法(文字、圖形、波形)

VGA是一種學(xué)習(xí)FPGA最常見(jiàn)的基礎(chǔ)實(shí)驗(yàn)。雖然現(xiàn)在的顯示屏大多已經(jīng)采用DVI和HDMI方案,但其實(shí)VGA在另一個(gè)地方還有應(yīng)用,那就是大屏的LCD。目前4...

2018-06-26 標(biāo)簽:fpgavga 1.8萬(wàn) 0

ARM、FPGA與可編程模擬電路設(shè)計(jì)的單芯片技術(shù)綜合應(yīng)用

相比分立IC,邏輯和線性模塊能夠提供不折不扣的高性能,同樣地,ARM Cortex-M3處理器也是一種全功能全規(guī)格的實(shí)現(xiàn)方案。它是一種已獲全面集成的功能...

2018-03-24 標(biāo)簽:fpga模擬電路arm 2.1k 0

FPGA與CPLD特性對(duì)比 哪類器件更適合你

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PLD和FPGA都是由邏輯陣列模塊構(gòu)成的,但是CPLD LAB基于乘積和宏單元,而FPGA LAB使用基于LUT的邏輯單元。CPLD LAB圍繞中心全局...

2018-04-17 標(biāo)簽:fpgacpld 3.7k 0

CPLD的優(yōu)勢(shì) FPGA的產(chǎn)生

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FPGA LAB和CPLD的LAB設(shè)計(jì)不同。CPLD LAB由宏單元構(gòu)成,包括自己的本地可編程陣列,而FPGA LAB由大量的邏輯模塊構(gòu)成,這些模塊被稱...

2018-04-17 標(biāo)簽:fpgacpld 2.5k 0

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