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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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LiteX 框架為創(chuàng)建 FPGA 內(nèi)核/SoC、探索各種數(shù)字設(shè)計(jì)架構(gòu)和創(chuàng)建完整的基于 FPGA 的系統(tǒng)提供了方便高效的基礎(chǔ)架構(gòu)。
驅(qū)動(dòng)無源蜂鳴器進(jìn)行七個(gè)基本音調(diào)“哆來咪發(fā)梭拉西”的循環(huán)鳴叫，每個(gè)音階持續(xù)鳴叫0.5s后鳴叫下一個(gè)音階。
2023-06-27 標(biāo)簽：fpgaPWM計(jì)數(shù)器 4k 0
呼吸燈的效果是LED燈在一段時(shí)間內(nèi)從完全熄滅的狀態(tài)逐漸變到最亮，再在同樣的時(shí)間段內(nèi)逐漸達(dá)到完全熄滅的狀態(tài)。這里我們需要實(shí)現(xiàn)1s內(nèi)實(shí)現(xiàn)從滅到亮，1s內(nèi)從亮到滅。
在過去的幾年里，我們不斷看到人工智能模型顛覆性的技術(shù)進(jìn)步，自然語言處理、計(jì)算機(jī)視覺等應(yīng)用不斷涌入市場。
2023-06-27 標(biāo)簽：fpga計(jì)算機(jī)萊迪思 755 0
電源排序可以防止損壞并延長電源以及設(shè)計(jì)中任何敏感IC和FPGA的使用壽命。除了控制啟動(dòng)時(shí)序以控制電流消耗外，電源軌還需要保持在FPGA的耐壓要求范圍內(nèi)。...
關(guān)于這兩段代碼，其實(shí)實(shí)現(xiàn)的功能都是相同的，邏輯功能都是一樣的（燈閃爍的時(shí)間不一樣），都是讓一個(gè)LED燈閃爍起來。
為實(shí)現(xiàn)這一技術(shù)突破，英特爾的三大關(guān)鍵創(chuàng)新和技術(shù)在其中功不可沒:英特爾@ 7制程工藝，第二代英特爾Hyperflex" FPGA架構(gòu)，高水平的系統(tǒng)集成。
FIFO （先入先出, First In First Out ）存儲(chǔ)器，在 FPGA 和數(shù)字 IC 設(shè)計(jì)中非常常用。 根據(jù)接入的時(shí)鐘信號(hào)，可以分為同步 ...
2023-06-27 標(biāo)簽：fpga存儲(chǔ)器IC設(shè)計(jì) 3.2k 0
大多數(shù)FPGA程序員認(rèn)為，高級(jí)工具總是發(fā)出更大的比特流，作為提高生產(chǎn)率的 "代價(jià)"。但是這總是真的嗎？
永磁同步電機(jī)（PMSM）因其結(jié)構(gòu)簡單、體積小、效率高等優(yōu)點(diǎn)，廣泛應(yīng)用與電機(jī)性能和控制精度較高的伺服系統(tǒng)中，穩(wěn)定地控制永磁同步電機(jī)也是研發(fā)過程中給不可或缺的一步。
2023-06-27 標(biāo)簽：fpga控制器永磁同步電機(jī) 1.9k 0
reg2reg路徑約束的對(duì)象是源寄存器（時(shí)序路徑的起點(diǎn)）和目的寄存器（時(shí)序路徑的終點(diǎn)）都在FPGA內(nèi)部的路徑。
《基于“礦板”低成本學(xué)習(xí)Zynq系列》之三-vitis安裝
Xilinx提供了一整套開發(fā)環(huán)境用于其FPGA和SOC的開發(fā)，主要包括硬件部分和軟件部分的開發(fā)工具，之前硬件部分是vivado軟件部分是sdk，現(xiàn)在統(tǒng)一...
MAX77812為四相、大電流、降壓轉(zhuǎn)換器，適用于高端游戲機(jī)、VR/AR耳機(jī)、數(shù)碼單反相機(jī)、無人機(jī)、網(wǎng)絡(luò)交換機(jī)和路由器、光學(xué)模塊以及使用多核處理器的FP...
2023-06-25 標(biāo)簽：處理器fpga轉(zhuǎn)換器 1.5k 0
使用MAX1產(chǎn)生高于525.77812V的輸出電壓
MAX77812為四相、大電流、降壓轉(zhuǎn)換器，適用于高端游戲機(jī)、VR/AR耳機(jī)、數(shù)碼單反相機(jī)、無人機(jī)、網(wǎng)絡(luò)交換機(jī)和路由器，以及使用多核處理器的FPGA系統(tǒng)...
2023-06-25 標(biāo)簽：FPGA轉(zhuǎn)換器寄存器 1k 0
使用Vitis AI在Zynq MP上實(shí)現(xiàn)手勢識(shí)別
FPGA得益于其高可編程性以及低延遲，低功耗的特點(diǎn)，在機(jī)器學(xué)習(xí)的推理領(lǐng)域已獲得了廣泛的關(guān)注。在過去，F(xiàn)PGA對(duì)于軟件開發(fā)人員來說有較高的開發(fā)門檻，把一部...
系統(tǒng)設(shè)計(jì)人員被要求生產(chǎn)更小、效率更高的電源解決方案，以滿足所有行業(yè)SoC和FPGA的高耗電需求。在先進(jìn)的電子系統(tǒng)中，因?yàn)殡娫幢仨毞旁赟oC或其外圍設(shè)備（...
只用簡單的自然語言之英語和 ChatGPT 聊聊天，便制作出了一款微處理芯片。更值得注意的是，在 ChatGPT 的助力下，這款芯片組件不僅是設(shè)計(jì)了出來...
構(gòu)建FPGA的第一階段稱為綜合。此過程將功能性RTL設(shè)計(jì)轉(zhuǎn)換為門級(jí)宏的陣列。這具有創(chuàng)建實(shí)現(xiàn)RTL設(shè)計(jì)的平面分層電路圖的效果。
??類似于電源域（電源規(guī)劃與時(shí)鐘規(guī)劃亦是對(duì)應(yīng)的），假如設(shè)計(jì)中所有的 D 觸發(fā)器都使用一個(gè)全局網(wǎng)絡(luò) GCLK ，比如 FPGA 的主時(shí)鐘輸入，那么我們說這...
簡易FM信號(hào)調(diào)制的FPGA實(shí)現(xiàn)過程講解
AM是幅度調(diào)制，因此只需要將基帶信號(hào)與載波信號(hào)相乘；FM是頻率調(diào)制，以頻率的變化來表示基帶信號(hào)。
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