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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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安全通信系統(tǒng)的FPGA實(shí)現(xiàn)的方法
本文針對(duì)網(wǎng)絡(luò)通信過(guò)程中存在信息泄露、信息篡改、非法用戶入侵等安全威脅而設(shè)計(jì)的一套基于FPGA平臺(tái)的的網(wǎng)絡(luò)通信安全傳輸系統(tǒng)
引入FPGA領(lǐng)域?qū)τ布_(kāi)發(fā)具有深遠(yuǎn)影響,并為‘軟’設(shè)計(jì)的新時(shí)代打開(kāi)了一扇大門,這為設(shè)計(jì)提供了前所未有的靈活性,同時(shí)具有減少板級(jí)尺寸和復(fù)雜性的無(wú)窮潛力。
基于FPGA平臺(tái)的工業(yè)電機(jī)最大效率實(shí)現(xiàn)
美國(guó)國(guó)家儀器公司(NI)的設(shè)計(jì)團(tuán)隊(duì)采用賽靈思FPGA作為其通用硬件架構(gòu)——可重構(gòu)I/O(RIO)的基礎(chǔ),以推出具有高計(jì)算性能的高靈活性嵌入式控制器。
2011-05-20 標(biāo)簽:FPGA工業(yè)電機(jī) 3.2k 0
基于賽靈思FPGA的硬件加速技術(shù)打造高速系統(tǒng)
設(shè)計(jì)人員時(shí)常需要通過(guò)增加計(jì)算能力或額外輸入(或兩者)延長(zhǎng)現(xiàn)有的嵌入式系統(tǒng)的壽命。而可編程系統(tǒng)平臺(tái)在這里大有用武之地。我們?cè)?jīng)希望用安全網(wǎng)絡(luò)連接功能升級(jí)一...
在嵌入式軟件行業(yè),由于嵌入式產(chǎn)品在最近幾年正在不斷滲透到各個(gè)行業(yè),小到手機(jī)、iPad,大到基站、航天衛(wèi)星等。而嵌入式軟件在其中扮演著越來(lái)越重要的角色
2011-05-17 標(biāo)簽:FPGA嵌入式系統(tǒng) 678 0
數(shù)字控制振蕩器(NCO)的FPGA實(shí)現(xiàn)
本文通過(guò)分析數(shù)控振蕩器的實(shí)現(xiàn)原理和性能,給出了通過(guò)FPGA來(lái)實(shí)現(xiàn)NCO的具體方法,同時(shí)通過(guò)QUARTUSⅡ中的仿真驗(yàn)證了本設(shè)計(jì)的正確性。
FreeDev數(shù)字圖象開(kāi)發(fā)套件是低成本FPGA器件上的高速數(shù)字化視頻圖象開(kāi)發(fā)平臺(tái),為應(yīng)用設(shè)計(jì)工程師提供了一個(gè)視頻數(shù)據(jù)采集、數(shù)字化處理、網(wǎng)絡(luò)傳輸視頻圖象開(kāi)...
超高速ADC-ADC08D1000是一款高性能的模/數(shù)轉(zhuǎn)換芯片。它具有雙通道結(jié)構(gòu),每個(gè)通道的最大采樣率可達(dá)到1.6 GHz
2011-05-05 標(biāo)簽:FPGAAD轉(zhuǎn)換ADC08D1000 9.3k 0
高速串行互連是標(biāo)志并行數(shù)據(jù)總線向串行總線轉(zhuǎn)變的技術(shù)里程碑,這種技術(shù)是減少設(shè)計(jì)師面臨的信號(hào)阻塞問(wèn)題的方法
我們不能僅僅把它們看成集成邏輯塊的有效方法,而是需要擴(kuò)大視野范圍,重新評(píng)估在器件(如FPGA)可重新配置的情況下我們對(duì)整個(gè)設(shè)計(jì)過(guò)程的看法。
2011-05-05 標(biāo)簽:FPGA嵌入式系統(tǒng) 1.1k 0
FPGA在嵌入式系統(tǒng)中的開(kāi)發(fā)方向
隨著微電子技術(shù)的進(jìn)步,SoC已經(jīng)在很多應(yīng)用中取代了傳統(tǒng)的以單片機(jī)為中心的架構(gòu),將很多外設(shè)和存儲(chǔ)器集成在一個(gè)芯片中,使系統(tǒng)的功耗和體積越來(lái)越小,而功能卻越來(lái)越強(qiáng)
2011-04-26 標(biāo)簽:FPGA嵌入式系統(tǒng) 1.2k 0
基于Xilinx FPGA的片上系統(tǒng)無(wú)線保密通信終端
本系統(tǒng)以AES加密算法為例,使用Xilinx SPARTAN 3E為開(kāi)發(fā)平臺(tái),以Xilinx的嵌入式軟核Microblaze為主控制器,調(diào)用FPGA的硬...
2011-04-23 標(biāo)簽:FPGAXilinx片上系統(tǒng) 2.3k 0
Altera發(fā)售業(yè)界最復(fù)雜半導(dǎo)體 Stratix V FPGA
Stratix V FPGA是目前業(yè)界發(fā)售的最復(fù)雜的半導(dǎo)體。它是利用TSMC的28-nm高性能(28HP)工藝來(lái)提高性能和帶寬的唯一FPGA。28HP工...
芯片內(nèi)部與外部測(cè)試的深層采樣儲(chǔ)存技術(shù)
本文章將介紹在芯片內(nèi)部糾錯(cuò)的一些限制,以及一套結(jié)合兩種測(cè)試模式的替代方案,可整合芯片內(nèi)部與外部測(cè)試模式的深層采樣儲(chǔ)存技術(shù)
通過(guò)與ARM的深度合作,Xilinx開(kāi)始超越傳統(tǒng)的FPGA技術(shù)范疇,逐步觸及更為核心的處理器領(lǐng)域。
基于FPGA的部分響應(yīng)CPM信號(hào)解調(diào)器的設(shè)計(jì)
基于CPM信號(hào)的恒包絡(luò)、帶寬緊湊和能量利用率高等優(yōu)點(diǎn),近幾年來(lái),它受到廣泛的研究與應(yīng)用。文中分析了二進(jìn)制,部分響應(yīng)L=2 的連續(xù)相位調(diào)制方式,提出了一種...
2011-04-09 標(biāo)簽:FPGAcpm信號(hào)信號(hào)解調(diào)器 4.2k 0
基于FPGA的8PSK軟解調(diào)實(shí)現(xiàn)
首先分析了8PSK 軟解調(diào)算法的復(fù)雜度以及MAX算法的基本原理,并在Altera 公司的Stratix II 系列FPGA芯片上實(shí)現(xiàn)了此軟解調(diào)硬件模塊
基于FPGA的EnDat編碼器數(shù)據(jù)采集后續(xù)電路設(shè)計(jì)
本文設(shè)計(jì)了一種基于FPGA的編碼器接口,用以進(jìn)行編碼器和伺服驅(qū)動(dòng)器DSP處理器之間的通訊,并且具有CRC校驗(yàn)等糾錯(cuò)功能。本文給出了硬件連接和FPGA程序設(shè)計(jì)流程
2011-04-06 標(biāo)簽:FPGA編碼器數(shù)據(jù)采集 6.7k 0
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