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ip核

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IP就是知識產(chǎn)權核或知識產(chǎn)權模塊的意思，在EDA技術開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。

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ip核技術

USB接口IP核關鍵模塊的設計

USB通信邏輯上分成了3層：信號層、協(xié)議層和數(shù)據(jù)層。信號層用來實現(xiàn)在USB設備和主機的物理連接之間傳輸位信息流的信息。邏輯層用來實現(xiàn)在USB設備和USB...

2019-03-22 標簽：usb接口 ip核串行總線 2.1k 0

USB接口IP核關鍵模塊的設計和驗證

2019-01-11 標簽：usb接口 usb總線總線傳輸 3k 0

調(diào)用Vivado IP核的方法

在開發(fā)PL時一般都會用到分頻或倍頻，對晶振產(chǎn)生的時鐘進行分頻或倍頻處理，產(chǎn)生系統(tǒng)時鐘和復位信號，下面就介紹一下在vivado2017.3中進行PL開發(fā)時...

2018-12-22 標簽：ip核 vivado 5.3k 0

FPGA的開發(fā)流程和物理含義和實現(xiàn)目標詳解

FPGA的開發(fā)流程是遵循著ASIC的開發(fā)流程發(fā)展的，發(fā)展到目前為止，F(xiàn)PGA的開發(fā)流程總體按照圖1進行，有些步驟可能由于其在當前項目中的條件的寬度的允許...

2018-11-18 標簽：fpga hdl ip核 1.8k 0

Vivado中的IP核封裝

第二項是器件添加，只有選擇了相應的器件，你的IP核才能在那個器件里被使用。單擊器件，右鍵——Add——Add Family Explicitiy，于是便...

2018-11-12 標簽：封裝 IP核 Vivado 1.1萬 0

基于SOPC的MVB收發(fā)控制器IP核實現(xiàn)MVB網(wǎng)卡的設計

本設計正是基于SOPC的思想，開發(fā)實現(xiàn)自主知識產(chǎn)權的MVB收發(fā)控制器IP核，借助于QuartersII開發(fā)工具，集成至Altera　FPGA器件內(nèi)部，構...

2020-04-18 標簽：控制器總線 ip核 4.9k 0

如何設計適用于嵌入式系統(tǒng)的加密IP核？

隨著計算機技術、微電子技術的不斷融合，嵌入式系統(tǒng)應用得到了迅猛發(fā)展。近年來嵌入式技術廣泛用于解決保密信息的傳輸、存儲和管理方面的問題。

2018-07-24 標簽：嵌入式 IP IP核 4.4k 0

基于FPGA的簡單圖像處理程序，可實現(xiàn)兩個功能

首先編寫相應的C/C++語言程序，加入到Vivado HLS工程中，再編寫相應的testbench代碼進行編譯測試。

2018-07-14 標簽：fpga 圖像處理 ip核 1.9萬 0

基于Zynq的HDMI傳輸和相關IP核介紹

為了簡化編碼解碼器和PL之間的集成復雜度，這里介紹兩個AVNET所開發(fā)的IP核，可通過Avnet GitHub下載（ github.com/Avnet/...

2018-07-11 標簽：hdmi ip核 zynq 1.3萬 0

千兆以太網(wǎng)的IP核接口和萬兆以太網(wǎng)IP核接口

對于IP核輸出數(shù)據(jù)的解析最好的工具就是其自帶的仿真文件，里面既將接收的數(shù)據(jù)進行了解析，又將發(fā)送給IP核的數(shù)據(jù)進行了封裝，這對于了解數(shù)據(jù)結構和協(xié)議是十分有...

2018-07-09 標簽：以太網(wǎng)可編程邏輯 ip核 4.3k 0

被zynq的GPIO唬住，告訴你zynq的3種GPIO

我們先看有哪三種GPIO：MIO、EMIO、AXI_GPIO。其中MIO和EMIO是直接掛在PS上的GPIO。而AXI_GPIO是通過AXI總線掛在PS...

2018-07-07 標簽：fpga ip核 gpio 5.9k 0

FPGA中對srl16資源IP核進行仿真

這個參數(shù)確定的是移位寄存器的移位時鐘個數(shù)。這個時鐘個數(shù)取決于后面的Depth參數(shù)。其中第一個參數(shù)Fixed Length 指的是移位周期數(shù)是固定的（后面...

2018-07-06 標簽：fpga 仿真 ip核 2k 0

Xilinx平方根IP核的整形平方根算法

Round Pos Inf：四舍五入，+0.5之后四舍五入，在負數(shù)時和第三種有區(qū)別。

2018-07-12 標簽：xilinx ip核 3k 0

vivado調(diào)用IP核詳細介紹

大家好，又到了每日學習的時間了，今天咱們來聊一聊vivado 調(diào)用IP核。首先咱們來了解一下vivado的IP核，IP核（IP Core）：Vivad...

2018-05-28 標簽：Verilog IP核 vivado 3.9萬 0

關于高性能主從模式動態(tài)可重構的SPI IP核的設計

隨著集成電路設計的快速發(fā)展，系統(tǒng)芯片(System-on-a-Chip，SoC)的集成度越來越高，從而對信號之間交流的要求也變高[1-2]。由于串行外設...

2018-06-14 標簽：soc spi接口 IP核 5.4k 0

Xilinx IP核配置,一步一步驗證Xilinx Serdes GTX最高8.0Gbps

之前用serdes一直都是跑的比較低速的應用，3.125Gbps，按照官方文檔一步一步來都沒出過什么問題，這次想驗證一下K7系列GTX最高線速8Gbps...

2018-03-26 標簽：fpga xilinx IP核 1.2萬 0

上海貝爾IP核心網(wǎng)三大升級策略

傳統(tǒng)IP核心網(wǎng)絡必須演進，以適應容量需求流量增長，100/400G技術以及設備淘汰，共同驅(qū)動著IP核心演進提供詳細的方法幫助運營商評估各種轉(zhuǎn)型方案 ...

2018-02-21 標簽：IP IP核 4.6k 0

基于LEON3開源軟核處理器的動態(tài)圖像邊緣檢測SoC設計

邊緣檢測是圖像處理和計算機視覺中的基本問題，邊緣檢測的目的是標識數(shù)字圖像中亮度變化明顯的點。邊緣檢測是圖像處理和計算機視覺中，尤其是特征提取中的一個研究...

2018-02-04 標簽：soc 邊緣檢測 ip核 1.4k 0

Xilinx FFT IP核功能?實現(xiàn)介紹與仿真

FFT算法是計算DFT的高效算法。算法最初由J.W.Cooley和J.W.Tukey于1965年提出，之后又有新的算法不斷涌現(xiàn)，總的來說發(fā)展方向有兩個：...

2017-11-22 標簽：Xilinx ip核 6.8k 0

Xilinx DDR2 IP 核控制器設計方案介紹與實現(xiàn)

提出一種便于用戶操作并能快速運用到產(chǎn)品的DDR2控制器IP核的FPGA實現(xiàn)，使用戶不需要了解DDR2的原理和操作方式的情況下，依然可以通過IP核控制DD...

2017-11-22 標簽：控制器 ip核 6k 0

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