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網(wǎng)絡之間互連的協(xié)議也就是為計算機網(wǎng)絡相互連接進行通信而設計的協(xié)議。在因特網(wǎng)中，它是能使連接到網(wǎng)上的所有計算機網(wǎng)絡實現(xiàn)相互通信的一套規(guī)則，規(guī)定了計算機在因特網(wǎng)上進行通信時應當遵守的規(guī)則。

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ip技術

公網(wǎng)通:公網(wǎng)IP基于TCP連接調試

在嵌入式開發(fā)過程中，有時需要產品進行聯(lián)網(wǎng)通信，常見的就是WiFi、Ethernet、BLE、ZigBee等，其中BLE和ZigBee還分別需要手機或者Z...

2019-06-04 標簽：嵌入式 IP WIFI 8.1k 0

基于ZYNQ FPGA與PC的IP設計與驗證方案（1）

AXI總線是一種多通道傳輸總線，將地址、讀數(shù)據(jù)、寫數(shù)據(jù)、握手信號在不同的通道中發(fā)送，不同的訪問之間順序可以打亂，用BUSID來表示各個訪問的歸屬。主設備...

2019-12-19 標簽：fpga ip 總線 2k 0

鋯石FPGA A4_Nano開發(fā)板視頻：軟核演練

IP軟核通常是用HDL文本形式提交給用戶，它經過RTL級設計優(yōu)化和功能驗證，但其中不含有任何具體的物理信息。

2019-09-25 標簽：fpga ip 軟核 2.2k 0

鋯石FPGA A4_Nano開發(fā)板視頻：內置IP核之Interval Timer的理論原理講解

Interval單位是豪秒, 設好該屬性值后,該控件的某個事件(timer_...)就會每隔 "屬性值" 就自動運行一次

2019-09-25 標簽：fpga ip 開發(fā)板 2.1k 0

鋯石FPGA A4_Nano開發(fā)板視頻：內置IP核SDRAM的理論實戰(zhàn)講解

SDRAM在計算機中被廣泛使用，從起初的SDRAM到之后一代的DDR（或稱DDR1），然后是DDR2和DDR3進入大眾市場，2015年開始DDR4進入消費市場。

2019-09-26 標簽：sdram ip 開發(fā)板 2.8k 0

鋯石FPGA A4_Nano開發(fā)板視頻：內置IP核之PIO的實戰(zhàn)應用講解

含有Avalon接口的并行輸入輸出（PIO）核在Avalon存儲映射（Avalon-MM）從屬口和多用途I/O口之間提供一個存儲器映射接口。I/O口連接...

2019-09-26 標簽：fpga 存儲器 ip 2.2k 0

鋯石FPGA A4_Nano開發(fā)板視頻：內置IP核之Interval Timer的應用實戰(zhàn)講解

利用IP核設計電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復雜功能和商業(yè)價值的IP核一般具有知識產權，盡管IP核的市場活動還不規(guī)范，但是仍有許多集成...

2019-09-26 標簽：fpga 集成電路 ip 2.3k 0

鋯石FPGA A4_Nano開發(fā)板視頻：內置IP核之EPCS的理論實戰(zhàn)講解

EPCS是串行存儲器，NiosII 不能直接從EPCS中執(zhí)行程序，它實際上是執(zhí)行EPCS控制器的片內ROM中的代碼（即Bootloader），把EPCS...

2019-09-26 標簽：控制器 epcs ip 6.5k 0

正點原子開拓者FPGA Qsys視頻：UART IP核

通用異步收發(fā)傳輸器（Universal Asynchronous Receiver/Transmitter)，通常稱作UART。它將要傳輸?shù)馁Y料在串行通...

2019-09-16 標簽：fpga ip uart 2.8k 0

正點原子開拓者FPGA Qsys視頻：自定義IP核之數(shù)碼管

數(shù)碼管，也稱作輝光管，是一種可以顯示數(shù)字和其他信息的電子設備。玻璃管中包括一個金屬絲網(wǎng)制成的陽極和多個陰極。大部分數(shù)碼管陰極的形狀為數(shù)字。

2019-09-16 標簽：fpga ip 數(shù)碼管 2.6k 0

基于ZYNQ FPGA與PC的IP設計與驗證方案（3）

Zynq-7000系列的可編程邏輯完全基于賽靈思最新7系列FPGA架構來設計，可確保28nm系列器件的IP核、工具和性能100%兼容。

2019-12-20 標簽：fpga ip 可編程邏輯 2.2k 0

FPGA之軟核演練篇：如何在Qsys系統(tǒng)中內置IP

軟核演練篇包含了哪些內容：該篇以什么是軟核、什么是Qsys、如何構建一個Qsys系統(tǒng)為切入點，在該基礎上進一步介紹了Nios II處理器的體系結構、Qs...

2019-12-09 標簽：處理器 fpga ip 3.1k 0

鋯石FPGA A4_Nano開發(fā)板視頻：數(shù)碼管IP核及其PIO的應用

數(shù)碼管的最常見形式有10個陰極，形狀為數(shù)字0到9，某些數(shù)碼管還有一個或兩個小數(shù)點。然而也有其他類型的數(shù)碼管顯示字母、標記和符號。

2019-10-08 標簽：ip 數(shù)碼管開發(fā)板 2.2k 0

鋯石FPGA A4_Nano開發(fā)板視頻：蜂鳴器IP核的定制

蜂鳴器是一種一體化結構的電子訊響器，采用直流電壓供電，廣泛應用于計算機、打印機、復印機、報警器、電子玩具、汽車電子設備、電話機、定時器等電子產品中作發(fā)聲器件。

2019-10-08 標簽：fpga ip 蜂鳴器 1.8k 0

基于ZYNQ FPGA與PC的IP設計與驗證方案

復旦大學微電子學院某國家重點實驗室內部教學視頻：基于ZYNQ FPGA與PC的IP設計與驗證方案。關鍵詞：IP設計，IP驗證，AXI總線協(xié)議，ARM...

2019-08-06 標簽：fpga 集成電路 ip 2.8k 0

基于ZYNQ平臺的IP設計與驗證

復旦大學某ASIC實驗室研究生新生FPGA基本知識入門培訓。主講AXI-GP和AXI-HP總線的快速實現(xiàn)方式。 AXI-GP的Slave模塊由我提...

2019-08-06 標簽：fpga ip 總線 2.6k 0

調用IP核實現(xiàn)動態(tài)顯示

中國大學MOOC 本課程以目前流行的Xilinx 7系列FPGA的開發(fā)為主線，全面講解FPGA的原理及電路設計、Verilog HDL語言及VIVAD...

2019-08-06 標簽：fpga 電路 IP 2.2k 1

自定義sobel濾波IP核，IP接口遵守AXI Stream協(xié)議

自定義sobel濾波IP核 IP接口遵守AXI Stream協(xié)議

2019-08-06 標簽：協(xié)議 ip 4.7k 0

Nios II處理器的體系結構及Avalon總線接口規(guī)范

2019-08-06 標簽：處理器 ip 總線 3.8k 0

PCI_MT64 IP核的原理和結構設計

隨著CompactPCI在中國大范圍的普及和使用，越來越多的企業(yè)開始研制基于CompactPCI接口的產品，市場上有一些專用PCI接口芯片。

2019-05-28 標簽：IP PCI 5.6k 1

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