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VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language，誕生于1982年。1987年底，VHDL被IEEE和美國國防部確認為標準硬件描述語言。

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vhdl技術

基于VHDL的組合邏輯電路的設計、仿真

完成2選1多路選擇器的文本編輯輸入（mux21a.vhd）和仿真測試等步驟。最后在實驗系統(tǒng)上進行硬件測試，驗證本項設計的功能。

2020-07-17 標簽：vhdl 硬件電路多路選擇器 5.3k 0

采用VHDL語言在CPLD內(nèi)部編程實現(xiàn)Flash讀取控制設計

本設計已實用于國家863計劃“可擴展到T比特的高性能IPv4/v6路由器基礎平臺及實驗系統(tǒng)”項目中。其主要功能是對主控部分的FPGA讀取Flash進行控制。

2020-07-15 標簽：cpld flash vhdl 1.8k 0

基于FPGA和VHDL語言編程實現(xiàn)液晶屏信號發(fā)生器的設計

液晶顯示已成為目前平板電視與計算機顯示終端的主流，液晶顯示器的研究設計、生產(chǎn)、檢驗等部門甚至消費者需要用一些定量或定性的方法和指標去檢驗液晶顯示器的質量和特性。

2020-07-10 標簽：fpga vhdl 信號發(fā)生器 1.8k 0

設計FPGA系統(tǒng)的三個基本原則是什么，了解一下

在這種方法中面積的復制可以換取速度的提高。支持的速度越高，就意味著可以實現(xiàn)更高的產(chǎn)品性能。一些注重產(chǎn)品性能的應用領域可以采用并行處理技術，實現(xiàn)面積換速度。

2020-07-10 標簽：fpga cpu vhdl 1.7k 0

基于復雜可編程邏輯器件和VHDL語言實現(xiàn)半整數(shù)分頻器的設計

在數(shù)字系統(tǒng)設計中，根據(jù)不同的設計需要，經(jīng)常會遇到偶數(shù)分頻、奇數(shù)分頻、半整數(shù)分頻等，有的還要求等占空比。在基于cpld（復雜可編程邏輯器件）的數(shù)字系統(tǒng)設計...

2020-06-26 標簽：cpld 分頻器 vhdl 1.5k 0

Verilog HDL和VHDL的區(qū)別

Verilog HDL是一種硬件描述語言，以文本形式來描述數(shù)字系統(tǒng)硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數(shù)字邏輯系統(tǒng)所完...

2020-06-17 標簽：Verilog vhdl 1.5萬 0

基于EDA技術和VHDL語言編程實現(xiàn)智能交通控制燈的設計

十字路口設計兩組交通燈分別控制東西和南北兩個方向的交通。如圖1所示，當東西方向的紅燈亮時，南北方向對應綠燈亮，過渡階段黃燈亮，即東西方向紅燈亮的時間等于...

2020-04-24 標簽：eda 計數(shù)器 vhdl 4.5k 0

基于級聯(lián)結構和VHDL語言的IIR數(shù)字濾波器在FPGA上實現(xiàn)設計

IIR數(shù)字濾波器在很多領域中有著廣闊的應用。與FIR數(shù)字濾波器相比，它可以用較低的階數(shù)獲得高選擇性，所用存儲單元少，經(jīng)濟而效率高，在相同門級規(guī)模和相同時...

2020-03-04 標簽：fpga 濾波器 vhdl 2.8k 0

基于FPGA實現(xiàn)多種小波變換

基于提升框架的小波變換方法，利用FPGA 可編程特性可實現(xiàn)多種小波變換。提升框架（LS ：Lifting Scheme）是由Sweldens 等人在近...

2019-08-18 標簽：fpga 濾波器 vhdl 2.5k 0

采用VHDL語言實現(xiàn)卷積碼編解碼器設計

數(shù)字信息在有噪信道中傳輸時，會受到噪聲干擾的影響，誤碼總是不可避免的。為了在已知信噪比的情況下達到一定的誤碼率指標，在合理設計基帶信號，選擇調(diào)制、解調(diào)方...

2019-06-30 標簽：解碼器 vhdl 2.5k 0

generate語句的基本概念與用法

生成語句（GENERATE）是一種可以建立重復結構或者是在多個模塊的表示形式之間進行選擇的語句。由于生成語句可以用來產(chǎn)生多個相同的結構，因此使用生成語句...

2019-11-21 標簽：vhdl 程序 7.1k 0

Verilog-HDL深入講解

2019-11-13 標簽：電路圖 vhdl verilog hdl 4k 0

深入淺出玩轉FPGA視頻：Quartus II調(diào)用ModeSim仿真實例

ModeSim是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術、Tcl/Tk技術、和單一內(nèi)核仿真技術，編譯仿真速...

2019-12-16 標簽：fpga 仿真器 vhdl 2.7k 0

利用VHDL語言的FPGA試驗箱設計洗衣機模擬程序

本設計利用vhdl硬件描述語言在FPGA試驗箱設計洗衣機模擬程序?！衾?個LED表示待機、正轉、反轉三種工作狀態(tài)?！糇孕性O定洗衣機循環(huán)次數(shù)(最大為16...

2019-08-29 標簽：fpga vhdl 洗衣機 3.3k 0

Verilog和VHDL之間如何互轉

當然階段四純屬個人的對未來的推測，但是，近年來，F(xiàn)PGA也高速發(fā)展，明顯有當年匯編語言開發(fā)到C高級語言開發(fā)的趨勢，我們是不是應該不局限于只學習FPG...

2018-11-12 標簽：Verilog C語言 VHDL 2.6萬 0

通過LPM_ROM模塊和VHDL語言為核心設計多功能信號發(fā)生器

以FPGA芯片為載體，通過QuartusII 的LPM_ROM 模塊和VHDL 語言為核心設計一個多功能信號發(fā)生器，根據(jù)輸入信號的選擇可以輸出遞增鋸...

2018-10-23 標簽：fpga ROM vhdl 1.5萬 0

FCSR的基本原理和特性及VHDL可編程邏輯器件的實現(xiàn)

偽隨機信號在雷達、遙控、遙測、通信加密和無線電測量系統(tǒng)領域有著廣泛的應用，其產(chǎn)生方法有多種途徑。進位反饋移位寄存器（feedbackwithcarrys...

2019-08-09 標簽：fpga cpld vhdl 3.8k 0

在PCI總線上采用CPLD技術實現(xiàn)多種板卡的設計

PLD（可編程邏輯器件）以其操作靈活、使用方便、開發(fā)迅速、投資風險低的特點，很快發(fā)展起來，并越來越受人們的矚目。PLD是可以由用戶在工作現(xiàn)場編程的邏輯器...

2019-08-16 標簽：cpld pci總線 vhdl 3k 0

采用VHDL語言和EDA工具實現(xiàn)超高頻射頻標簽數(shù)字電路

在研究讀寫器和射頻標簽通信過程的基礎上，結合EPC C1G2協(xié)議以及ISO／IEC18000．6協(xié)議，采用VHDL語言設計出一種應用于超高頻段的射頻標...

2019-08-28 標簽：射頻 eda vhdl 2.8k 0

使用VHDL語言和FPGA技術實現(xiàn)高效微控制器內(nèi)核的設計

與傳統(tǒng)投片實現(xiàn)ASIC相比，F(xiàn)PGA具有實現(xiàn)速度快、風險小、可編程、可隨時更改升級等一系列優(yōu)點，因而得到了越米越廣泛的應用。MCS-51應用時間長、范圍...

2019-09-05 標簽：微控制器 fpga vhdl 2.3k 0

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