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標簽 > vhdl
VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language,誕生于1982年。1987年底,VHDL被IEEE和美國國防部確認為標準硬件描述語言 。
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淺談VHDL/Verilog的可綜合性以及對初學者的一些建議
最近在寫代碼的時候總是在思考,我寫的這個能被綜合嗎?總是不放心,或是寫完了綜合的時候出問題,被搞的非常煩惱,雖然看了一些書,比如對組合邏輯用阻塞賦值,時...
高層次綜合(High Level Synthesis, HLS)是Xilinx公司推出的最新一代的FPGA設計工具,它能讓用戶通過編寫C/C++等高級語...
隨著科學研究與技術開發(fā)市場化,采用傳統電子設計手段在較短時間內完成復雜電子系統設計,已經越來越難完成了。EDA(EleCTRonICs Design A...
本文介紹了一種以FPGA 為基礎的數字密碼鎖。采用自頂向下的數字系統設計方法, 將數字密碼鎖系統分解為若干子系統, 并且進一步細劃為若干模塊, 然后用硬...
2015-08-04 標簽:FPGAVHDLQuartus II 1.0萬 0
當前業(yè)內領先的FPGA公司里工作的應用工程師每天都會面對很多設計問題,而且他們已經提出了一些將令你的設計工作變得更輕松的設計指導原則和解決方案。掌握FP...
基于Xilinx FPGA和VHDL的數字秒表設計與仿真實現
文中著重介紹了一種基于FPGA利用VHDL硬件描述語言的數字秒表設計方法,在設計過程中使用基于VHDL的EDA工具ModelSim對各個模塊仿真驗證,并...
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基于Altera CPLD的水輪發(fā)電機組轉速監(jiān)控系統的設計
電子發(fā)燒友網核心提示 :本文給出了采用CPLD的水輪發(fā)電機組轉速監(jiān)控系統的設計原理和VHDL的語言描述,該設計具有結構簡單、成本低和抗干擾性能強等特點。...
本系統是用CPLD實現的智能數字電壓表。隨著EDA技術的廣泛應用,CPLD已成為現代數字系統設計的主要手段,CPLD目前正朝著更高速、更高集成度、更強功...
隨著計算機與微電子技術的發(fā)展,電子設計自動化EDA領域已成為電子技術發(fā)展的主體,數字系統的設計正朝著速度快、容量大、體積小、重量輕的方向發(fā)展
2011-09-26 標簽:VHDL 8.3k 0
各種 IP Core和參考設計 以下各種 IP Core和參考設計是由相關設計者提供,可以免費下載學習或使用。 [使用注意事項] 大部分設計是針
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