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Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷(xiāo)售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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基于Xilinx Spartan-6 FPGA加速紋理映射的實(shí)現(xiàn)
采用Spartan-6 FPGA加速紋理映射:這種要求嚴(yán)苛的圖形流程曾經(jīng)是定制ASIC內(nèi)核的應(yīng)用,而如今卻成為低成本FPGA的天下。 作為一種以 FPG...
全新升級(jí)款Zybo Zynq-7000 APSoC開(kāi)發(fā)板應(yīng)用
支持reVISION堆棧,并附贈(zèng)SDSoc License。提供[嵌入式視覺(jué)]應(yīng).....
一文詳解Xilinx GTX/GTH及2D eye scan的基本原理
本文介紹Xilinx GT的一些概念,對(duì)GT沒(méi)有概念但是有時(shí)間的童鞋推薦先看一下此文(Xilinx 7系列FPGA 高速收發(fā)器GTX/GTH的一些基本概...
Xilinx 7系列FPGA中MMCM和PLL的區(qū)別
7系列FPGA包含最多24個(gè)CMT塊,CMT具體的分布和與其他時(shí)鐘資源的關(guān)系請(qǐng)參考本合集(FPGA應(yīng)用開(kāi)發(fā))的上一篇文章。本文主要介紹CMT內(nèi)部MMCM...
Xilinx Vivado HLS中Floating-Point(浮點(diǎn))設(shè)計(jì)介紹
盡管通常Fixed-Point(定點(diǎn))比Floating-Point(浮點(diǎn))算法的FPGA實(shí)現(xiàn)要更快,且面積更高效,但往往有時(shí)也需要Floating-P...
Zybo board 開(kāi)發(fā)經(jīng)驗(yàn)分享第一季: 詳解硬件構(gòu)架
Zybo Board 是一塊具有 FPGA 同時(shí)又包含了 ARM Cortex-A9 雙核心的開(kāi)發(fā)板。 在我們開(kāi)始這一切之前,我們需要稍微了解一下這片開(kāi)...
Xilinx FPGA Multiboot設(shè)計(jì)與實(shí)現(xiàn)(Spartan-6和Kintex-7示例)
FPGA的硬件可編程性給設(shè)計(jì)帶來(lái)了很高的靈活性,基于FPGA的產(chǎn)品也會(huì)有更新或升級(jí)的需求,而且大多數(shù)情況下由于現(xiàn)場(chǎng)環(huán)境、人力物力成本的限制,無(wú)法通過(guò)下載...
V4L2是Video for Linux2的簡(jiǎn)稱(chēng),為L(zhǎng)inux中關(guān)于視頻設(shè)備的內(nèi)核驅(qū)動(dòng)。在Linux中,視頻設(shè)備是設(shè)備文件,可以像訪問(wèn)普通文件一樣對(duì)其進(jìn)行讀寫(xiě)。
教你如何進(jìn)行Xilinx SerDes調(diào)試
FPGA SERDES的應(yīng)用需要考慮到板級(jí)硬件,SERDES參數(shù)和使用,應(yīng)用協(xié)議等方面。由于這種復(fù)雜性,SERDES的調(diào)試工作對(duì)很多工程師來(lái)說(shuō)是一個(gè)挑戰(zhàn)。
Xilinx IP核配置,一步一步驗(yàn)證Xilinx Serdes GTX最高8.0Gbps
之前用serdes一直都是跑的比較低速的應(yīng)用,3.125Gbps,按照官方文檔一步一步來(lái)都沒(méi)出過(guò)什么問(wèn)題,這次想驗(yàn)證一下K7系列GTX最高線速8Gbps...
基于Xilinx(賽靈思) CPLD的看門(mén)狗電路設(shè)計(jì)
1 引言 :隨著現(xiàn)代電子技術(shù)的發(fā)展,帶有各種微處理的現(xiàn)代電子設(shè)備已廣泛應(yīng)用于國(guó)民生產(chǎn)的各行各業(yè)中。但隨著設(shè)備功能越來(lái)越強(qiáng)大,程序結(jié)構(gòu)越來(lái)越復(fù)雜,指令代碼...
Xilinx ISE是如何調(diào)用ModelSim進(jìn)行仿真的
在我們用ModelSim仿真的時(shí)候經(jīng)常是修改一點(diǎn)一點(diǎn)修改代碼,這樣會(huì)造成一個(gè)無(wú)奈的操作循環(huán):修改代碼--->編譯代碼--->仿真設(shè)置--->進(jìn)入仿真頁(yè)面...
淺談FPGA配置狀態(tài)字寄存器Status Register的調(diào)試
第一步要做的,永遠(yuǎn)都是拉出FPGA的狀態(tài)字寄存器Status Register看,它能直接告訴你或者極大地輔助判斷失敗的原因!
RAM——單口、雙口、簡(jiǎn)單雙口、真雙口的區(qū)別
在 WE = 0 時(shí),兩個(gè)口均為讀出口,A 口的地址線 ADDR[3:0] 的地址為 0,在 SPO[7:0] 上讀出數(shù)據(jù) 17,B 口的地址線 DPR...
關(guān)于Xilinx公司出品的Spartan6系列FPGA的MultiBoot設(shè)計(jì)方案詳解
Xilinx公司出品的Spartan6系列FPGA所具有的MultiBoot特性,允許用戶在不掉電重啟的情況下,根據(jù)不同時(shí)刻的需求,有選擇地從存儲(chǔ)于F...
【干貨】編輯Xilinx FPGA內(nèi)LUT內(nèi)容的詳細(xì)方案
研究背景及基礎(chǔ)知識(shí) FPGA是實(shí)現(xiàn)高性能計(jì)算與網(wǎng)絡(luò)的重要工具,得益于其高度的并行性與用戶可編程的特性,F(xiàn)PGA得到了越來(lái)越廣泛的應(yīng)用。FPGA由CLB(...
Xilinx公司的開(kāi)發(fā)軟件Vivado上的在線調(diào)試工具——ILA
在FPGA開(kāi)發(fā)中,當(dāng)我們寫(xiě)完代碼,進(jìn)行仿真,確定設(shè)計(jì)沒(méi)有問(wèn)題后,下載到硬件上一般都能按照我們的設(shè)計(jì)意愿執(zhí)行相應(yīng)功能。但這也并非絕對(duì)的,有時(shí)候你會(huì)遇到一些...
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