用晶體管編程的機(jī)器人設(shè)計(jì)方案
之前，我在Verilog中實(shí)現(xiàn)了它，并在DE0-nano FPGA上對(duì)其進(jìn)行了仿真，以確保所有邏輯都是正確的：
這是我決定使用的and邏輯塊的設(shè)計(jì)（最初，我試圖用常規(guī)的AND和OR門實(shí)現(xiàn)下一個(gè)狀態(tài)邏輯，并意識(shí)到只有1KOhm的電阻這些門不能正常工作，所以我決定堅(jiān)持使用NAND并不是）：
以下是組裝后的一些板子：
這是成品！
責(zé)任編輯：xj
原文標(biāo)題：用晶體管編程的機(jī)器人，一樣好玩！
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