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      HMC987LP5E 1:9扇出緩沖器設計用于低噪聲時鐘分配

      jf_vuyXrDIR ? 來源：兆億微波 ? 2023-02-01 15:23 ? 次閱讀
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      HMC987LP5E 1:9扇出緩沖器設計用于低噪聲時鐘分配。該器件旨在生成上升/下降時間小于100 ps的相對方波輸出。HMC987LP5E具有低偏斜和抖動輸出以及快速上升/下降時間，從而可以控制混頻器、ADC/DAC或SERDES器件等下游電路的低噪聲開關功能。這些應用中，當時鐘網(wǎng)絡帶寬足夠?qū)挷⒃试S方波切換時，噪底尤為重要。HMC987LP5E的輸出以2 GHz驅(qū)動，其噪底為-166 dBc/Hz，相當于0.6 asec/rtHz抖動密度，或8 GHz帶寬內(nèi)的50 fs。

      輸入級可單端或差分驅(qū)動，可采用多種信號格式（CML、LVDS、LVPECL或CMOS），以及交流或直流耦合。輸入級同樣具有可調(diào)輸入阻抗。該器件集成帶有可調(diào)擺幅/功率電平的8路LVPECL輸出和1路CML輸出，步進為3 dB。

      d826f296-a19b-11ed-bfe3-dac502259ad0.jpg

      各輸出級可以通過硬件控制引腳或串行端口接口的控制使能或禁用，以便在不需要時節(jié)省電能。

      應用

      SONET、光纖通道、GigE時鐘分配

      ADC/DAC時鐘分配

      低偏斜和抖動時鐘或數(shù)據(jù)扇出

      無線/有線通信

      電平轉(zhuǎn)換

      高性能儀器儀表

      醫(yī)療成像

      單端至差分轉(zhuǎn)換

      審核編輯 ：李倩

      聲明：本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權轉(zhuǎn)載。文章觀點僅代表作者本人，不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用，如有內(nèi)容侵權或者其他違規(guī)問題，請聯(lián)系本站處理。 舉報投訴
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      • 低噪聲
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      原文標題：HMC987 3.3V低噪聲1:9扇出緩沖器，DC - 8 GHz

      文章出處：【微信號：兆億微波，微信公眾號：兆億微波】歡迎添加關注！文章轉(zhuǎn)載請注明出處。

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