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?LMX1404-EP 芯片技術(shù)文檔總結(jié)

科技綠洲 ? 2025-09-10 09:27 ? 次閱讀
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LMX1404-EP是一款緩沖器、分頻器和乘法器,具有高頻、超低抖動(dòng)和SYSREF輸出。該器件與超低噪聲參考時(shí)鐘源相結(jié)合,是時(shí)鐘數(shù)據(jù)轉(zhuǎn)換器的典范設(shè)計(jì),尤其是在采樣高于 3GHz 時(shí)。4 個(gè)高頻時(shí)鐘輸出和附加 LOGICLK 輸出中的每一個(gè)都與一個(gè) SYSREF 輸出時(shí)鐘信號(hào)配對(duì)。JESD接口的SYSREF信號(hào)可以在內(nèi)部生成,也可以作為輸入傳入并重新時(shí)鐘到器件時(shí)鐘。該器件可以通過禁用SYSREF輸出,將多通道、低偏斜、超低噪聲的本地振蕩器信號(hào)分配到多個(gè)混頻器。
*附件:lmx1404-ep.pdf

特性

  • 視頻 #V62/24627
  • 300MHz至15GHz頻率的時(shí)鐘緩沖器
  • 超低噪聲
    • 6GHz輸出時(shí)本底噪聲為–159dBc/Hz
    • 6GHz 輸出時(shí)為 36 fs 附加抖動(dòng)(100Hz 至 fCLK)
    • 5fs 附加抖動(dòng) (100Hz - 100MHz)
  • 4 個(gè)高頻時(shí)鐘,具有相應(yīng)的 SYSREF 輸出
    • 共享除法 1(緩沖區(qū))、2、3、4、5、6、7 和 8
    • 共享可編程乘法器 x2、x3 和 x4
  • 支持引腳模式選項(xiàng),無需SPI即可配置器件
  • LOGICLK 輸出與相應(yīng)的 SYSREF 輸出
    • 在單獨(dú)的分庫上
    • 1、2、4 預(yù)分頻器
    • 1(旁路)、2、...、1023 柱分隔器
  • 8 個(gè)可編程輸出功率級(jí)別
  • 同步 SYSREF 時(shí)鐘輸出
    • 508 次延遲步進(jìn)調(diào)整,每次小于 2.5ps,頻率在 12.8GHz 時(shí)
    • 發(fā)生器和中繼器模式
    • SYSREFREQ 引腳的窗口功能,用于優(yōu)化時(shí)序
  • SYNC 功能到所有分部和多個(gè)設(shè)備
  • 2.5V工作電壓
  • –55oC 至 125oC 工作溫度
  • 高可靠性
    • 受控基線
    • 一個(gè)裝配/測(cè)試站點(diǎn)
    • 一個(gè)制造現(xiàn)場
    • 延長產(chǎn)品生命周期
    • 產(chǎn)品可追溯性

參數(shù)
image.png

方框圖

image.png
?1. 產(chǎn)品概述?
LMX1404-EP 是德州儀器(TI)推出的高性能時(shí)鐘緩沖/乘法/分頻器,專為雷達(dá)、通信及數(shù)據(jù)轉(zhuǎn)換等高頻應(yīng)用設(shè)計(jì)。其核心特性包括:

  • ?超低噪聲?:噪聲基底低至-159dBc/Hz(6GHz輸出),附加抖動(dòng)僅36fs(100Hz至fCLK)。
  • ?寬頻支持?:輸入頻率300MHz至15GHz,支持JESD204B/C時(shí)鐘分配。
  • ?多功能輸出?:4路高頻時(shí)鐘(帶SYSREF輸出)和1路獨(dú)立邏輯時(shí)鐘(LOGICLK),支持緩沖、分頻(÷1-8)及倍頻(×2-4)模式。
  • ?高可靠性?:工作溫度-55°C至125°C,符合航天及工業(yè)級(jí)應(yīng)用標(biāo)準(zhǔn)。

?2. 關(guān)鍵特性?

  • ?時(shí)鐘管理?:
    • 分頻器支持1/2/3/4/5/6/7/8分頻,倍頻器支持×2/×3/×4。
    • 邏輯時(shí)鐘(LOGICLK)獨(dú)立分頻(÷1-1023),支持LVDS/CML輸出格式。
  • ?SYSREF同步?:
    • 支持生成器(連續(xù)/脈沖)和轉(zhuǎn)發(fā)器模式,延遲步進(jìn)精度<2.5ps(12.8GHz)。
    • 窗口化功能優(yōu)化SYSREFREQ引腳時(shí)序。
  • ?電氣參數(shù)?:
    • 2.5V供電,功耗1050mA(全輸出開啟)。
    • 輸出功率8級(jí)可調(diào),支持DC/AC耦合。

?3. 應(yīng)用場景?

  • ?雷達(dá)與通信?:高頻時(shí)鐘分配至混頻器或數(shù)據(jù)轉(zhuǎn)換器(如ADC/DAC)。
  • ?FPGA時(shí)鐘?:LOGICLK輸出適配FPGA低頻率需求。
  • ?多設(shè)備同步?:SYNC功能支持多芯片相位對(duì)齊。

?4. 封裝與設(shè)計(jì)支持?

  • ?封裝?:64引腳HTQFP(10mm×10mm),帶散熱焊盤。
  • ?開發(fā)工具?:TI提供TICS Pro配置軟件及PLLatinum相位噪聲仿真工具。

?5. 文檔結(jié)構(gòu)?
數(shù)據(jù)手冊(cè)包含詳細(xì)引腳定義、寄存器映射、典型應(yīng)用電路及布局指南(如電源去耦、SYSREFREQ輸入配置),并強(qiáng)調(diào)未列寄存器禁止編程以避免性能異常。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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