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電子發(fā)燒友網(wǎng)>處理器/DSP>基于DSP與FPGA的全姿態(tài)指引儀的設(shè)計

基于DSP與FPGA的全姿態(tài)指引儀的設(shè)計

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基于DSPFPGA的便攜式超聲探傷

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2017-10-19 14:21:567

DSPFPGA的HDLC協(xié)議通訊電路設(shè)計

DSPFPGA的HDLC協(xié)議通訊電路設(shè)計
2017-10-19 14:46:117

基于DSPFPGA配置方法研究與實現(xiàn)

基于DSPFPGA配置方法研究與實現(xiàn)
2017-10-19 16:15:1936

基于FPGADSP組合在無線基站中的應(yīng)用分析

在自動控制產(chǎn)品中,CPD+DSP+MCU的構(gòu)架是目前最為流行的成熟方案,而在通訊產(chǎn)品中,大量使用FPGA設(shè)計,合理使用FPGADSP的組合,FPGADSP之間的智能配分可使無線系統(tǒng)設(shè)計師獲得最佳
2017-10-25 11:41:071

異步FIFO在FPGADSP通信中的應(yīng)用解析

摘要 利用異步FIFO實現(xiàn)FPGADSP進行數(shù)據(jù)通信的方案。FPGA在寫時鐘的控制下將數(shù)據(jù)寫入FIFO,再與DSP進行握手后,DSP通過EMIFA接口將數(shù)據(jù)讀入。文中給出了異步FIFO的實現(xiàn)
2017-10-30 11:48:443

揭秘FPGADSP性能

今天,FPGA越來越多地應(yīng)用在多種DSP中。我們預(yù)計這一趨勢在未來幾年會更加明顯。美國調(diào)查機構(gòu)Berkeley設(shè)計技術(shù)公司做了上述預(yù)測。以Xilinx和Altera為主的兩大FPGA廠商多年前就涉足
2017-11-06 10:48:092

最新FPGADSP性能介紹

今天,FPGA越來越多地應(yīng)用在多種DSP中。我們預(yù)計這一趨勢在未來幾年會更加明顯。美國調(diào)查機構(gòu)Berkeley設(shè)計技術(shù)公司做了上述預(yù)測。以Xilinx和Altera為主的兩大FPGA廠商多年前就涉足
2017-11-06 13:58:578

基于FPGA的異構(gòu)可重配置DSP平臺

視頻、影像和電信市場的標(biāo)準(zhǔn)推動了異構(gòu)可重配置DSP硬件平臺的使用。在本文中這些平臺包括DSP處理器和FPGA,它們提供的現(xiàn)成硬件解決方案可以解決視頻、影像和電信設(shè)計中的重大難題,同時又不失差異化
2017-11-06 13:59:423

基于FPGADSP的噴油器霧化粒徑測量系統(tǒng)的設(shè)計

針對噴油器霧化粒徑測量系統(tǒng)實時數(shù)據(jù)處理的特點,將FPGA技術(shù)與DSP技術(shù)相結(jié)合,研究一種基于FPGADSP的電控噴油器粒徑檢測系統(tǒng);為滿足動態(tài)測量的要求,設(shè)計了應(yīng)用高性能的多路開關(guān)和超低輸入偏置電流運放的多通道微電流高速采集板;詳細(xì)介紹了檢測系統(tǒng)中基于FPGADSP的軟硬件設(shè)計和工作原理。
2017-12-06 17:03:042550

Altera徹底改變基于FPGA的浮點DSP

2014年4月23號,北京Altera公司 (Nasdaq: ALTR) 今天宣布在FPGA浮點DSP性能方面實現(xiàn)了變革。Altera是第一家在FPGA中集成硬核IEEE 754兼容浮點運算功能
2018-02-11 13:34:007750

FPGA會取代DSP嗎?FPGADSP區(qū)別介紹

本文首先分析了FPGA是否會取代DSP,其次介紹了FPAG結(jié)構(gòu)特點與優(yōu)勢及DSP的基本結(jié)構(gòu)和特征,最后闡述了FPGADSP兩者之間的區(qū)別。
2018-05-31 09:51:2537405

采用DSP+FPGA系統(tǒng)結(jié)構(gòu)實現(xiàn)姿態(tài)指引設(shè)計

隨著現(xiàn)代航空電子技術(shù)飛速發(fā)展以及飛機性能的提高,使得機載圖形顯示系統(tǒng)所顯示的參數(shù)越來越多,同時也對畫面顯示質(zhì)量從人機工效學(xué)的角度提出了很高的要求。要保證圖形顯示的連續(xù)性,顯示系統(tǒng)必須以每秒50幀以上的頻率實時刷新。
2019-01-15 08:41:001854

利用FPGADSP實現(xiàn)信號檢測系統(tǒng)設(shè)計

整個系統(tǒng)的組成如圖1所示。當(dāng)啟爆電路在DSPFPGA的控制下啟爆時,感應(yīng)線圈取出啟爆電流,首先是高速數(shù)據(jù)采集與存儲電路,以FPGA為核心,對數(shù)據(jù)進行高速采集與存儲。數(shù)據(jù)存儲完畢,FPGA發(fā)信號告知DSP采集完畢,開始對采集的數(shù)據(jù)進行相關(guān)的處理。
2018-10-07 12:03:033814

FPGADSP有哪些區(qū)別、特點及用途?

FPGA是一種可編程的硅芯片,DSP是數(shù)字信號處理,當(dāng)系統(tǒng)設(shè)計人員在項目的架構(gòu)設(shè)計階段就面臨到底采用FPGA還是DSP的重要問題。本文將首先分別介紹FPGADSP的特點,然后再從內(nèi)部資源、編程語言、功能多個角度解析兩者的不同。
2018-09-29 16:43:3531758

如何使用DSP與LabVIEW進行汽車行駛姿態(tài)參數(shù)采集系統(tǒng)設(shè)計

設(shè)計了一種基于TMS320F2812與LabVlEW的汽車行駛姿態(tài)參數(shù)采集系統(tǒng)。利用 ADISl6355AMLZ三軸陀螺靈敏度高、集成度高、測量精度高等特點,系統(tǒng)采用DSP對汽車行駛姿態(tài)進行實時
2018-11-13 08:00:005

FPGADSP的關(guān)系

大型的幾乎所有數(shù)字電路系統(tǒng),dsp主要完成復(fù)雜的數(shù)字信號處理,如fft,通常一個復(fù)雜系統(tǒng)可以由單片機、arm、fpga、dsp中的一種或幾種構(gòu)成,各有優(yōu)勢和不足。 dsp通常用于運算密集型,fpga用于控制密集型,許多人都用dsp高算法,用fpga作外圍控制
2020-10-25 09:50:063983

使用FPGA實現(xiàn)機載姿態(tài)指示圖形硬件填充的詳細(xì)資料說明

論述一種基于DSPFPGA的機載圖形顯示系統(tǒng),并提出一種新穎的基于FPGA的動態(tài)畫面的硬件填充方法在填充操作過程中,由DSP完成畫面中填充區(qū)域邊界的標(biāo)志運算,FPGA完成填充畫面像素的刷新操作,使整個畫面刷新的速度大為提高.
2021-01-22 15:08:4018

如何使用FPGADSP實現(xiàn)數(shù)字視頻消像旋系統(tǒng)的設(shè)計

為消除因探測器姿態(tài)變化造成的圖像旋轉(zhuǎn),保持觀測圖像的穩(wěn)定狀態(tài),采用可編程邏輯門陣列(FPGA)和數(shù)字信號處理器(DSp)構(gòu)建數(shù)字硬件平臺。給出了實時消像旋的完整硬件結(jié)構(gòu)與相應(yīng)算法。設(shè)計采用
2021-02-04 16:46:0010

MEMS陀螺姿態(tài)算法研究綜述

MEMS陀螺姿態(tài)算法研究綜述
2021-05-26 14:24:1439

基于FPGADSP的機載圖形顯示系統(tǒng)

基于FPGADSP的機載圖形顯示系統(tǒng)
2021-06-08 10:48:0836

基于ARM的彈丸姿態(tài)數(shù)據(jù)記錄及測試

基于ARM的彈丸姿態(tài)數(shù)據(jù)記錄及測試
2021-06-15 11:18:1118

基于FPGADSP的圖像采集監(jiān)測通信平臺

基于FPGADSP的圖像采集監(jiān)測通信平臺
2021-06-16 09:38:2923

FPGA_ASIC-DSPFPGA共用FLASH進行配置的方法

FPGA_ASIC-DSPFPGA共用FLASH進行配置的方法(哪些專業(yè)適合嵌入式開發(fā))-該文檔為FPGA_ASIC-DSPFPGA共用FLASH進行配置的方法講解文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………
2021-07-30 11:16:5522

FPGA,arm,stm32,dsp特點對比

FPGA,arm,stm32,dsp特點對比
2021-11-19 13:21:0224

DSPFPGA間SPI通信(DSP為主、FPGA為從)

DSP芯片(master):TMS320F28069FPGA芯片(slave):Spartan-xc6slx25-2ftg256SPI協(xié)議:SCK:5MHz數(shù)據(jù)長度:8ByteFalling
2021-12-05 17:21:1544

FPGA/DSP/ARM選型手冊

廣州星嵌DSP/ARM/FPGA 選型手冊2023
2023-05-05 10:24:2215

fpgadsp通訊怎樣同步時鐘頻率?dspfpga通信如何測試?

fpgadsp通訊怎樣同步時鐘頻率?dspfpga通信如何測試? 在FPGADSP通訊時,同步時鐘頻率非常重要,因為不同的設(shè)備有不同的時鐘頻率,如果兩者的時鐘頻率不同步,會導(dǎo)致通訊數(shù)據(jù)的錯誤或
2023-10-18 15:28:132793

基于DSPFPGA的通用控制器設(shè)計

電子發(fā)燒友網(wǎng)站提供《基于DSPFPGA的通用控制器設(shè)計.pdf》資料免費下載
2023-10-25 10:57:562

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