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的外部電阻值實(shí)現(xiàn),以實(shí)現(xiàn)2 V /μs轉(zhuǎn)換SN65HVD230M的電路進(jìn)入低電流待機(jī)模式,在此期間驅(qū)動(dòng)器關(guān)閉,如果對(duì)R S 施加高邏輯電平,接收器保持有效(第8針)。當(dāng)總線上出現(xiàn)顯性狀態(tài)(典型的總線差分電壓> 900 mV)時(shí),DSP控制器會(huì)反轉(zhuǎn)這種低電流待機(jī)模式。
高達(dá)1兆比特/秒(Mbps)