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數(shù)據(jù): (PCILynx-2) IEEE 1394 Link Layer Controller 數(shù)據(jù)表
TSB12LV21B(PCILynx-2)提供高性能IEEE 1394-1995接口,能夠在1394 PHY-link接口之間傳輸數(shù)據(jù), PCI總線(xiàn)接口和連接到本地總線(xiàn)接口的外部設(shè)備。 1394 PHY-link接口提供與1394物理層設(shè)備的連接;它由板載鏈路層控制器(LLC)支持。 LLC提供了在FIFO和PHY鏈路接口之間以100 Mbit /s,200 Mbit /s和400 Mbit /s的速率發(fā)送和接收1394分組數(shù)據(jù)的控制。鏈路層還提供從物理層設(shè)備接收狀態(tài)以及由應(yīng)用軟件訪問(wèn)物理層控制和狀態(tài)寄存器的能力。 PCILynx-2符合
內(nèi)部4 KB存儲(chǔ)器可配置為多個(gè)可變大小的FIFO,從而消除需要外部FIFO。單獨(dú)的FIFO可由用戶(hù)配置,以支持1394接收,異步發(fā)送和異步發(fā)送傳輸操作。
PCI接口支持高達(dá)33 MHz的32位突發(fā)傳輸,并且能夠作為主設(shè)備和目標(biāo)設(shè)備。配置寄存器可以從外部串行EEPROM加載,允許電路板和系統(tǒng)設(shè)計(jì)人員分配自己唯一的識(shí)別碼。自動(dòng)引導(dǎo)模式允許數(shù)據(jù)移動(dòng)系統(tǒng)(如擴(kuò)展塢)設(shè)計(jì)為在PCI總線(xiàn)上運(yùn)行,而無(wú)需主機(jī)CPU。
DMA控制器使用數(shù)據(jù)包控制列表(PCL)數(shù)據(jù)結(jié)構(gòu)控制數(shù)據(jù)傳輸并允許DMA在沒(méi)有主機(jī)CPU干預(yù)的情況下運(yùn)行。這些PCL可以駐留在PCI存儲(chǔ)器中或連接到本地總線(xiàn)端口的存儲(chǔ)器中。 PCL實(shí)現(xiàn)了一個(gè)指令集,允許鏈接,條件分支,1394數(shù)據(jù)傳輸控制,輔助支持命令和狀態(tài)報(bào)告。五個(gè)DMA通道可容納可編程數(shù)據(jù)類(lèi)型??梢詫CL鏈接在一起以形成可以開(kāi)發(fā)以支持每個(gè)DMA通道的通道控制程序。數(shù)據(jù)可以以big endian或little endian格式存儲(chǔ),從而無(wú)需主機(jī)CPU執(zhí)行字節(jié)交換。數(shù)據(jù)可以傳輸?shù)?字節(jié)對(duì)齊位置,以提供最高性能,或傳輸?shù)椒菍?duì)齊位置,以提供最佳內(nèi)存使用。
RAM,ROM,AUX,ZV和通用I /O(GPIO)端口共同構(gòu)成本地總線(xiàn)接口。這些映射到PCI地址的端口可以通過(guò)PCI總線(xiàn)或內(nèi)部DMA事務(wù)進(jìn)行訪問(wèn)。內(nèi)部事務(wù)不會(huì)出現(xiàn)在外部PCI總線(xiàn)上,從而節(jié)省了PCI帶寬。 DMA包控制列表或其他數(shù)據(jù)可以存儲(chǔ)在連接到本地總線(xiàn)接口的外部RAM或ROM中。這進(jìn)一步減少了PCI總線(xiàn)的使用并通常提高了性能。 ZV本地總線(xiàn)端口用于將數(shù)據(jù)從1394視頻設(shè)備傳輸?shù)竭B接到PCILynx-2 ZV端口的外部設(shè)備。該接口提供了一種直接從連接到本地總線(xiàn)接口的ZV兼容設(shè)備接收1394數(shù)碼相機(jī)數(shù)據(jù)包的方法。
內(nèi)置測(cè)試寄存器,專(zhuān)用測(cè)試輸出終端和4個(gè)GPIO終端允許觀察內(nèi)部狀態(tài)并提供方便的軟件調(diào)試功能??删幊讨袛嗫捎糜谕ㄖ?qū)動(dòng)程序軟件重要事件,例如1394總線(xiàn)復(fù)位和DMA到PCL傳輸完成。
3.3V內(nèi)部操作可降低功耗,同時(shí)保持與5-的兼容性V信令環(huán)境。 PCI接口兼容3 V和5 V PCI系統(tǒng)。
TSB12LV21B的特點(diǎn)是在-55°C至125°C的軍用溫度范圍內(nèi)工作。
< p>如需完整的數(shù)據(jù)表(文獻(xiàn)編號(hào)SLLS879)或更多信息,請(qǐng)聯(lián)系support@ti.com。