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Cadence UCIe IP在Samsung Foundry的5nm汽車工藝上實(shí)現(xiàn)流片成功
我們很高興能在此宣布,Cadence 基于 UCIe 標(biāo)準(zhǔn)封裝 IP 已在 Samsung Foundry 的 5nm 汽車工藝上實(shí)現(xiàn)首次流片成功。這一...
概倫電子集成電路工藝與設(shè)計(jì)驗(yàn)證評(píng)估平臺(tái)ME-Pro介紹
ME-Pro是概倫電子自主研發(fā)的用于聯(lián)動(dòng)集成電路工藝與設(shè)計(jì)的創(chuàng)新性驗(yàn)證評(píng)估平臺(tái),為集成電路設(shè)計(jì)、CAD、工藝開發(fā)、SPICE模型和PDK專業(yè)從業(yè)人員提供...
半導(dǎo)體是一種介于導(dǎo)體和絕緣體之間的導(dǎo)電性,半導(dǎo)體通過參雜可以使得能夠精確地控制電流的流動(dòng)。通過基于晶圓的光刻、刻蝕和沉積工藝,我們可以構(gòu)建出各種元件,如...
LPCVD方法在多晶硅制備中的優(yōu)勢與挑戰(zhàn)
本文圍繞單晶硅、多晶硅與非晶硅三種形態(tài)的結(jié)構(gòu)特征、沉積技術(shù)及其工藝參數(shù)展開介紹,重點(diǎn)解析LPCVD方法在多晶硅制備中的優(yōu)勢與挑戰(zhàn),并結(jié)合不同工藝條件對(duì)材...
本文深入解析了焊盤起皮的成因、機(jī)制及其與工藝參數(shù)之間的關(guān)系,結(jié)合微觀形貌圖和仿真分析,系統(tǒng)探討了劈刀狀態(tài)、超聲參數(shù)、滑移行為等關(guān)鍵因素的影響,并提出了優(yōu)...
粘片作為芯片與管殼間實(shí)現(xiàn)連接和固定的關(guān)鍵工序,達(dá)成了封裝對(duì)于芯片的固定功能,以及芯片背面電連接功能。在行業(yè)里,這一工序常被叫做粘片。由于其核心作用是固定...
詳解晶圓級(jí)可靠性評(píng)價(jià)技術(shù)
隨著半導(dǎo)體工藝復(fù)雜度提升,可靠性要求與測試成本及時(shí)間之間的矛盾日益凸顯。晶圓級(jí)可靠性(Wafer Level Reliability, WLR)技術(shù)通過...
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