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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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【ZYNQ Ultrascale+ MPSOC FPGA教程】第十四章HDMI輸出實(shí)驗(yàn)
由于開發(fā)板上只有DP可以顯示,但卻是PS端的,PL端沒有HDMI的接口,因此我們采用AN9134的HDMI擴(kuò)展模塊實(shí)現(xiàn)HDMI顯示。將24位RGB編碼輸...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十三章RS485實(shí)驗(yàn)
RS485與RS422類似,也是采用差分信號傳輸,但RS485是半雙工傳輸,也就是說,同一時(shí)刻只能有一個(gè)方向的數(shù)據(jù)傳輸。而且接口也比RS422少,只有差...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十二章RS422實(shí)驗(yàn)
本章利用AN3485模塊實(shí)現(xiàn)RS422接口數(shù)據(jù)傳輸。關(guān)于模塊,在前面的RS232實(shí)驗(yàn)中已經(jīng)介紹過,本實(shí)驗(yàn)不再贅述。RS422與RS232在與FPGA的連...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十一章RS232實(shí)驗(yàn)
AN3485模塊的RS232接口采用MAX3232芯片實(shí)現(xiàn)RS232和+3.3V TTL電平的轉(zhuǎn)換。TTL電平的串口接收和發(fā)送信號(RXD, TXD)連...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第十章PWM呼吸燈實(shí)驗(yàn)
用一個(gè)N比特的計(jì)數(shù)器,最大值可以表示為2的N次方,最小值0,計(jì)數(shù)器以“period”為步進(jìn)值累加,加到最大值后會溢出,進(jìn)入下一個(gè)累加周期。當(dāng)計(jì)數(shù)器值大于...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第九章Vivado下按鍵實(shí)驗(yàn)
按鍵是FPGA設(shè)計(jì)當(dāng)中最常用也是最簡單的外設(shè),本章通過按鍵檢測實(shí)驗(yàn),檢測開發(fā)板的按鍵功能是否正常,并了解硬件描述語言和FPGA的具體關(guān)系,學(xué)習(xí)Vivad...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第八章FPGA片內(nèi)FIFO讀寫測試實(shí)驗(yàn)
FIFO: First in, First out代表先進(jìn)的數(shù)據(jù)先出,后進(jìn)的數(shù)據(jù)后出。Xilinx在VIVADO里為我們已經(jīng)提供了FIFO的IP核, 我...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第七章FPGA片內(nèi)ROM測試實(shí)驗(yàn)
既然是ROM,那么我們就必須提前給它準(zhǔn)備好數(shù)據(jù),然后在FPGA實(shí)際運(yùn)行時(shí),我們直接讀取這些ROM中預(yù)存儲好的數(shù)據(jù)就行。Xilinx FPGA的片內(nèi)ROM...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第六章FPGA片內(nèi)RAM讀寫測試實(shí)驗(yàn)
RAM是FPGA中常用的基礎(chǔ)模塊,可廣泛用于緩存數(shù)據(jù)的情況,同樣它也是ROM,F(xiàn)IFO的基礎(chǔ)。本實(shí)驗(yàn)將為大家介紹如何使用FPGA內(nèi)部的RAM以及程序?qū)υ?..
【ZYNQ Ultrascale+ MPSOC FPGA教程】第五章Vivado下PLL實(shí)驗(yàn)
PLL(phase-locked loop),即鎖相環(huán)。是FPGA中的重要資源。由于一個(gè)復(fù)雜的FPGA系統(tǒng)往往需要多個(gè)不同頻率,相位的時(shí)鐘信號。所以,一...
Vitis HLS工具在Standalone模式下調(diào)用Xilinx Vision Library L1 API例程
在論壇上遇到在高層次綜合工具中調(diào)用視覺庫遇到的大多數(shù)問題都和 opencv 庫以及Xilinx Vision 庫的安裝路徑有關(guān),如今 Vitis HLS...
人工智能(AI)歷史悠久,自1955年便被公認(rèn)為一門學(xué)科。人工智能是計(jì)算機(jī)模仿人類智能、從經(jīng)驗(yàn)中學(xué)習(xí)、適應(yīng)新信息并執(zhí)行類似人類活動的能力。
2021-01-21 標(biāo)簽:fpga驅(qū)動器神經(jīng)網(wǎng)絡(luò) 1.6k 0
【ZYNQ Ultrascale+ MPSOC FPGA教程】第四章PL的LED實(shí)驗(yàn)
對于ZYNQ來說PL(FPGA)開發(fā)是至關(guān)重要的,這也是ZYNQ比其他ARM的有優(yōu)勢的地方,可以定制化很多ARM端的外設(shè),在定制ARM端的外設(shè)之前先讓我...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第三章Verilog基礎(chǔ)模塊介紹
Wire 類型變量,也叫網(wǎng)絡(luò)類型變量,用于結(jié)構(gòu)實(shí)體之間的物理連接,如門與門之間,不能儲存值,用連續(xù)賦值語句assign賦值,定義為wire [n-1:0...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第二章硬件原理圖介紹
XCZU2CG-1SFVC784E芯片的PS系統(tǒng)PS系統(tǒng)集成了2個(gè)ARMCortex?-A53處理器,速度高達(dá)1.2Ghz,支持2級Cache;另外還包...
【ZYNQ Ultrascale+ MPSOC FPGA教程】第一章MPSoC芯片介紹
原創(chuàng)聲明: 本原創(chuàng)教程由芯驛電子科技(上海)有限公司(ALINX)創(chuàng)作,版權(quán)歸本公司所有,如需轉(zhuǎn)載,需授權(quán)并注明出處。 適用于板卡型號: AXU2CGA...
基于AD7705與FPGA的光信號采集系統(tǒng)設(shè)計(jì)
光纖光柵傳感器是利用光纖光柵受外界物理作用時(shí)其反射中心波長會發(fā)生偏移的機(jī)理制成的,光纖光柵傳感器具有體積小、重量輕和抗電磁干擾等特點(diǎn),被廣泛應(yīng)用于變壓器...
基于Virtex-E系列XCV300E與高速靜態(tài)存儲設(shè)備的接口實(shí)現(xiàn)
為了能更好﹑更有效的設(shè)計(jì)FPGA與IS63LV1024的接口實(shí)現(xiàn),必須先了解IS63LV1024的性能特點(diǎn)。充分利用這些特點(diǎn)會使設(shè)計(jì)的實(shí)現(xiàn)變得事半功倍。...
pwm是脈沖帶寬調(diào)制技術(shù),采用pwm技術(shù),可以對脈沖帶寬加以調(diào)節(jié)。在往期文章中,小編對pwm占空比有所介紹。為增進(jìn)大家對pwm技術(shù)的了解程度,本文將闡述...
2021-02-15 標(biāo)簽:FPGAPWM計(jì)數(shù)器 2.0萬 0
基于EP1C3T144C6芯片和VHDL語言實(shí)現(xiàn)語音電子密碼鎖的設(shè)計(jì)
隨著電子技術(shù)的發(fā)展,具有防盜報(bào)警、語音提示等功能的電子密碼鎖代替密碼量少、安全性差的機(jī)械式密碼鎖已是必然趨勢。目前大部分密碼鎖采用單片機(jī)進(jìn)行設(shè)計(jì),電路較...
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