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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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基于FPGA的通用CNN加速器整體框架如下,通過Caffe/Tensorflow/Mxnet等框架訓(xùn)練出來的CNN模型,通過編譯器的一系列優(yōu)化生成模型對...
2017-10-27 標(biāo)簽:fpga深度學(xué)習(xí)cnn 1.1萬 0
仿真軟件ModelSim及其應(yīng)用,ModelSim的仿真流程
ModelSim不僅可以用于數(shù)字電路系統(tǒng)設(shè)計(jì)的功能仿真,還可以應(yīng)用于數(shù)字電路系統(tǒng)設(shè)計(jì)的時(shí)序仿真。 ModelSim的使用中,最基本的步驟包括創(chuàng)建工程、編...
2018-12-29 標(biāo)簽:FPGA仿真器PCB設(shè)計(jì) 1.1萬 0
ZYNQ7000與傳統(tǒng)FPGA有著巨大的差異,它將自己定位為一款A(yù)ll Programmable Soc(軟硬件可編程片上系統(tǒng)),視其為以FPGA作為外...
PEX6-COP是一個(gè)靈活的FPGA協(xié)處理器卡。它是帶有FMC 輸入輸出模塊并且集成了Virtex6 FPGA計(jì)算的核心的行業(yè)標(biāo)準(zhǔn)的半長PCIe臺式機(jī)或...
基于LUT的FPGA具有很高的集成度,其器件密度從數(shù)萬門到數(shù)千萬門不等,可以完成極其復(fù)雜的時(shí)序與邏輯組合的邏輯電路功能,因此其適用于高速、高密度的高端數(shù)...
【紫光同創(chuàng)國產(chǎn)FPGA教程】【第十七章】AD實(shí)驗(yàn)之AD9238波形顯示
本實(shí)驗(yàn)練習(xí)使用ADC,實(shí)驗(yàn)中使用的ADC模塊型號為AN9238,最大采樣率65Mhz,精度為12位。實(shí)驗(yàn)中把AN9238的2路輸入以波形方式在HDMI上...
2021-02-24 標(biāo)簽:fpgaadc數(shù)字示波器 1.1萬 0
數(shù)字設(shè)計(jì)中,“時(shí)鐘”表示在寄存器間可靠地傳輸數(shù)據(jù)所需的參考時(shí)間。Vivado的時(shí)序引擎通過時(shí)鐘特征來計(jì)算時(shí)序路徑需求,通過計(jì)算裕量(Slack)的方法報(bào)...
FPGA學(xué)習(xí)系列:26. 矩陣鍵盤的設(shè)計(jì)
設(shè)計(jì)背景: 矩陣鍵盤在工程設(shè)計(jì)越來越多的被用到,已然成為了我們做開發(fā)接觸到的不可缺少的小型項(xiàng)目,利于我們理解設(shè)計(jì)方向的原理為以后的強(qiáng)化學(xué)習(xí)打好了堅(jiān)實(shí)的基...
基于FPGA的步進(jìn)電機(jī)控制實(shí)現(xiàn)
正常情況下,步進(jìn)電機(jī)轉(zhuǎn)過的總角度和輸入的脈沖數(shù)成正比;連續(xù)輸入一定頻率的脈沖時(shí),電動機(jī)的轉(zhuǎn)速與輸入脈沖的頻率保持嚴(yán)格的對應(yīng)關(guān)系,不受電壓波動和負(fù)載變化的...
2020-09-10 標(biāo)簽:fpga步進(jìn)電機(jī)微機(jī)控制 1.1萬 0
為什么以及如何使用 Efinix FPGA 進(jìn)行 AI/ML 成像 — 第 1 部分:入門
編者按:FPGA 架構(gòu)的新方法帶來了更細(xì)粒度的控制和更大的靈活性,以滿足機(jī)器學(xué)習(xí) (ML) 和人工智能 (AI) 的需求。這個(gè)由兩部分組成的系列的第 1...
解決FPGA一個(gè)解復(fù)用和時(shí)鐘域轉(zhuǎn)換問題
SERDES恢復(fù)出的數(shù)據(jù)進(jìn)入FPGA有一個(gè)解復(fù)用和時(shí)鐘域轉(zhuǎn)換的問題,Stratix GX包含了專用電路可以完成8/10bit數(shù)據(jù)到8/10/20bit數(shù)...
傳授壓箱絕技:從SoC設(shè)計(jì)人員那都了解不到的功耗管理問題
電子發(fā)燒友網(wǎng)核心提示: 當(dāng)今的系統(tǒng)設(shè)計(jì)人員受益于芯片系統(tǒng)(SoC)設(shè)計(jì)人員在芯片級功耗管理上的巨大投入。但是對于實(shí)際能耗非常小的系統(tǒng),系統(tǒng)設(shè)計(jì)團(tuán)隊(duì)必須要...
在做項(xiàng)目的過程中,經(jīng)常遇到乘法計(jì)算,乘法器的設(shè)計(jì)就尤為重要。乘法器決定了最終電路功能能否實(shí)現(xiàn),資源使用量多少以及時(shí)序性能優(yōu)劣等。
關(guān)于FPGA芯片結(jié)構(gòu),工作原理以及開發(fā)流程知識詳解
FPGA是英文FieldProgrammableGateArray的縮寫,即現(xiàn)場可編程門陣列,它是在PAL、GAL、EPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)...
2018-08-03 標(biāo)簽:FPGA 1.0萬 0
利用FPGA技術(shù)實(shí)現(xiàn)各類分頻器的設(shè)計(jì)
分頻器是FPGA設(shè)計(jì)中使用頻率非常高的基本單元之一。盡管目前在大部分設(shè)計(jì)中還廣泛使用集成鎖相環(huán)(如altera的PLL,Xilinx的DLL)來進(jìn)行時(shí)鐘...
關(guān)于反熔絲FPGA的結(jié)構(gòu)和原理以及其在密碼芯片設(shè)計(jì)中的運(yùn)用淺析
隨著計(jì)算機(jī)和通信的發(fā)展,信息傳輸過程中信息安全的重要性越來越受到人們的重視。在信息傳輸過程中,人們普遍采用將待傳輸?shù)男畔⒓用苓M(jìn)行傳輸,然后在收端進(jìn)行解密...
本文在分析Rife,MRife和傅里葉系數(shù)插值迭代3種算法的基礎(chǔ)上,將串行迭代變?yōu)椴⑿械?,由此得出了一種快速頻率估計(jì)算法,并分析了新算法與前3種算法的...
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