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標(biāo)簽 > fpga
FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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D觸發(fā)器為什么能對數(shù)據(jù)延遲一個時鐘周期
D觸發(fā)器在FPGA里用得很多,但我經(jīng)常無法理解D觸發(fā)器為什么能對數(shù)據(jù)延遲一個時鐘周期(打一拍)。下面從信號處理的角度來談一下我的理解。如發(fā)現(xiàn)理解有誤,煩...
ZYNQ7000 SOC 芯片可以從 FLASH 啟動,也可以從 SD 卡里啟動, 本節(jié)介紹程序 FLASH 啟動的方法。Zynq7000 SOC 芯片...
通過Matlab軟件實現(xiàn)對DSP/FPGA線性調(diào)頻信號仿真
Matlab是美國MathWorks公司自20世紀80年代中期推出的數(shù)學(xué)軟件,優(yōu)秀的數(shù)值計算與卓越的數(shù)據(jù)可視化能力使其很快在同類軟件中脫穎而出。Matl...
2018-08-30 標(biāo)簽:dspfpga調(diào)頻信號 8.5k 0
聯(lián)調(diào)仿真分析,操作簡單。你幾乎不需要手動敲Tcl指令就可以進行仿真,自動化程度更高。
隨著數(shù)字電子技術(shù)的發(fā)展,數(shù)字電路已由早期的分立元件逐漸發(fā)展成集成電路,對電路設(shè)計的要求越來越高。尤其是可編程邏輯器件的出現(xiàn),使得以硬件為載體、以計算機軟...
為什么在FPGA設(shè)計中使用MicroBlaze V處理器
在各類行業(yè)與應(yīng)用中,經(jīng)常能看到許多 FPGA 設(shè)計。一個非常常見的現(xiàn)象是:設(shè)計者常常用復(fù)雜的有限狀態(tài)機(FSM)來實現(xiàn) I2C、SPI、GPIO 時序控...
采用FPGA和單片機結(jié)合的等精度原理的測量頻率實現(xiàn)
傳統(tǒng)測量頻率的方法主要有直接測量法、分頻測量法、測周法等,這些方法往往只適用于測量一段頻率,當(dāng)被測信號的頻率發(fā)生變化時,測量的精度就會下降。
前邊寫了很多關(guān)于板上外圍器件的評測文章,這篇是FPGA純邏輯設(shè)計,是FPGA的另一部分——算法實現(xiàn),上篇文章做了HDC1000傳感器的使用,當(dāng)時說FPG...
了解CPU vs FPGA處理技術(shù)的好處和得失來進行圖像處理
因此在考慮誰更適合進行圖像處理時,CPU還是FPGA?答案是“視情況而定”。您需要了解應(yīng)用的目標(biāo),才能使用最適合該設(shè)計的處理元件。但是,不管是什么應(yīng)用,...
很多計算機專業(yè)的學(xué)生都只是在理論層次學(xué)習(xí)計算機體系結(jié)構(gòu)方面的知識,比如數(shù)據(jù)路徑、控制結(jié)構(gòu)和存儲系統(tǒng)等,但是如何將這些組合起來則完全靠學(xué)生的想象力。MIP...
2018-05-21 標(biāo)簽:fpgamipsimagination 8.4k 0
利用 FPGA DIY 開發(fā)板實現(xiàn)撥碼開關(guān)控制數(shù)碼管顯示
利用撥碼開關(guān)控制8個數(shù)碼管的顯示,撥動SW1,顯示1; 關(guān)閉SW1,打開SW2,顯示2...依此類推,撥動SW8,顯示8。
基于ADS1298與FPGA的高性能腦電信號采集系統(tǒng)
本文利用ADS1298芯片的高精度,以FPGA為主控制芯片,通過將工頻陷波、帶通濾波等模擬部分轉(zhuǎn)移到數(shù)字側(cè),在保證性能的前提下簡化腦電信號放大與調(diào)理的模...
2014-01-25 標(biāo)簽:FPGA信號采集系統(tǒng) 8.4k 0
產(chǎn)生高輸出電流時輸出低電壓的降壓DC/DC轉(zhuǎn)換器模塊介紹
在基于云的數(shù)據(jù)中心和RAID陣列中使用的許多機架安裝系統(tǒng)中,低DC總線電壓(例如3.3 V或5.0 V)是首選的主配電軌。為了在這些系統(tǒng)的主板上為FPG...
2019-03-21 標(biāo)簽:fpga轉(zhuǎn)換器德州儀器 8.4k 0
一般情況下,F(xiàn)PGA器件內(nèi)部的邏輯會在每個時鐘周期的上升沿執(zhí)行一次數(shù)據(jù)的輸入和輸出處理,而在兩個時鐘上升沿的空閑時間里,則可以用于執(zhí)行各種各樣復(fù)雜的處理...
Stratix IV內(nèi)嵌DPA電路的基本結(jié)構(gòu)分析
不論從哪個角度看,今天的現(xiàn)場可編程門陣列(FPGA),都顯得鶴立雞群,真是非常棒的器件。如果在這個智能時代,在這個領(lǐng)域,想擁有一技之長的你還沒有關(guān)注FP...
2018-02-16 標(biāo)簽:fpga 8.4k 0
基于FPGA技術(shù)實現(xiàn)H.264/AVC中CAVLC編碼器設(shè)計并優(yōu)化性能
CAVLC是一種依據(jù)4×4塊變換系數(shù)的zig-zag掃描順序進行的編碼算法。塊系數(shù)的非零系數(shù)幅值較小,主要集中在低頻段,經(jīng)過zig-zag掃描后,連續(xù)零...
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