介紹了一款可配置的USB IP核設(shè)計(jì)，重點(diǎn)描述USB IP核的結(jié)構(gòu)劃分，詳細(xì)闡述了各模塊的設(shè)計(jì)思想。為了提高USB lP的可重用性，本USB IP核設(shè)計(jì)了總線適配器，經(jīng)
2010-07-17 10:39:51
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采用基于IP復(fù)用技術(shù)進(jìn)行設(shè)計(jì)是減小這一差距惟一有效的途徑，IP復(fù)用技術(shù)包括兩個(gè)方面的內(nèi)容:IP核生成和IP核復(fù)用。文中采用IP核復(fù)用方法和SOC技術(shù)基于AVR 8位微處理器AT90S1200IP Core設(shè)計(jì)專
2012-01-12 14:22:472515 
本文介紹了LCD的通用驅(qū)動(dòng)電路IP核設(shè)計(jì)，采用自頂向下的設(shè)計(jì)方法將其劃分為幾個(gè)主要模塊，分別介紹各個(gè)模塊的功能，用VHDL語(yǔ)言對(duì)其進(jìn)行描述，用FPGA實(shí)現(xiàn)并通過(guò)了仿真驗(yàn)證。該IP核具有良好的移植性，可驅(qū)動(dòng)不同規(guī)模的LCD電路。
2014-05-13 10:09:353236 IP核生成文件：XilinxAlteraIP 核生成文件：（Xilinx/Altera同） IP 核生成器生成ip 后有兩個(gè)文件對(duì)我們比較有用，假設(shè)生成了一個(gè) asyn_fifo 的核，則
2012-08-12 12:21:36
本帖最后由 eehome 于 2013-1-5 09:59 編輯
IP核簡(jiǎn)介IP核是指：將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,如FIR濾波器、SDRAM控制器、PCI接口等等設(shè)計(jì)成可修改
2011-07-06 14:15:52
IP核簡(jiǎn)介IP核是指：將一些在數(shù)字電路中常用但比較復(fù)雜的功能塊,如FIR濾波器、SDRAM控制器、PCI接口等等設(shè)計(jì)成可修改參數(shù)的模塊,讓其它用戶可以直接調(diào)用這些模塊,以避免重復(fù)勞動(dòng)。隨著CPLD
2011-07-15 14:46:14
我想問(wèn)一下，在quartus上直接調(diào)用IP核和在qsys中用IP核有什么區(qū)別？自個(gè)有點(diǎn)迷糊了
2017-08-07 10:09:03
我調(diào)用了一個(gè)ip核 在下載到芯片中 有一個(gè)time-limited的問(wèn)題 在完成ip核破解之后 還是無(wú)法解決 但是我在Google上的找到一個(gè)解決方法就是把ip核生成的v文件加到主項(xiàng)目文件中就是上面
2016-05-17 10:28:47
公司現(xiàn)需12bit sar adc的IP核，國(guó)內(nèi)有哪些公司提供相關(guān)方面的服務(wù)了？
2015-11-06 08:37:44
控制機(jī)制對(duì)當(dāng)前變長(zhǎng)分組骨干網(wǎng)的流量控制還是具有重要的參考價(jià)值，所以有必要對(duì)ATM的流量控制及其實(shí)現(xiàn)方式進(jìn)行深入的研究。 IP核是一段具有特定電路功能的硬件描述語(yǔ)言代碼，該程序與集成電路工藝無(wú)關(guān)，因而
2011-09-27 11:54:25
用Quartus II 調(diào)用IP核時(shí)，在哪可以查看IP核的例程
2014-07-27 20:28:04
Altera_IP核,僅供參考
2016-08-24 16:57:15
我用的是xinlinx spartan6 FPGA,我想知道它的IP核RAM是與FPGA獨(dú)立的，只是集成在了一起呢，還是占用了FPGA的資源來(lái)形成一個(gè)RAM？如果我以ROM的形式調(diào)用該IP核，在
2013-01-10 17:19:11
FPGA的IP軟核使用技巧主要包括以下幾個(gè)方面：
理解IP軟核的概念和特性 ：
IP軟核是指用硬件描述語(yǔ)言（如VHDL或Verilog）描述的功能塊，但并不涉及具體的電路實(shí)現(xiàn)細(xì)節(jié)。它通常只經(jīng)過(guò)功能
2024-05-27 16:13:24
如何根據(jù)成本、功耗和性能來(lái)選擇微處理器？FPGA結(jié)構(gòu)中硬核和軟核的特點(diǎn)是什么？處理器IP有什么重要性？
2021-04-08 06:16:37
本帖最后由 gk320830 于 2015-3-8 09:29 編輯
LCD的通用驅(qū)動(dòng)電路IP核設(shè)計(jì) 摘 要：本文介紹了一種新型的LCD驅(qū)動(dòng)電路IP核的總體設(shè)計(jì)，采用自頂向下的設(shè)計(jì)方法將其
2012-08-12 12:28:42
大家好，有沒(méi)有誰(shuí)比較熟悉ALTERA公司的VIP系列ip核，我們用該系列IP核中的某些模塊（主要是scaler和interlacer）來(lái)實(shí)現(xiàn)高清圖像轉(zhuǎn)標(biāo)清圖像（具體就是1080p50轉(zhuǎn)576i30
2015-04-13 14:12:18
在vivado生成ip核后缺少一大片文件，之前是可以用的，中途卸載過(guò)Modelsim，用vivado打開(kāi)過(guò)ISE工程，因?yàn)楣こ讨泻芏?b class="flag-6" style="color: red">IP核不能用所以在重新生成過(guò)程中發(fā)現(xiàn)了這個(gè)問(wèn)題，還請(qǐng)大神告知是怎么回事？
2023-04-24 23:42:21
求用sopc builder定制IP核的步驟，是9.0的軟件，假設(shè)硬件代碼已有
2013-09-14 18:35:40
請(qǐng)問(wèn)哪位高手有ise軟件中的各個(gè)ip核的功能介紹
2013-10-08 16:41:25
有哪位大神用過(guò)pci ip核，為什么輸入lm_req32請(qǐng)求，pci側(cè)沒(méi)有reqn請(qǐng)求輸出呢？
2016-06-27 17:56:59
本帖最后由 ys_1*****8201 于 2016-5-19 14:16 編輯
Quartus IP核破解在完成quartus軟件安裝之后，一般都要進(jìn)行一個(gè)軟件破解。對(duì)于一般的需求來(lái)說(shuō)
2016-05-19 14:13:09
，可以打開(kāi)參數(shù)設(shè)置對(duì)話框。點(diǎn)擊左上方的Documentation可以查看IP核的手冊(cè)。這里將輸入的A、B均設(shè)置為4為無(wú)符號(hào)型，其他為默認(rèn)值，點(diǎn)擊OK確認(rèn)。三、繪制電路1. 右擊Diagram窗口空白處
2018-05-15 12:05:13
有沒(méi)有大神可以提供xilinx FPGA的FFT IP核的調(diào)用的verilog 的參考程序，最近在學(xué)習(xí)FFT的IP核的使用，但是仿真結(jié)果有問(wèn)題，所以想找些參考設(shè)計(jì)，謝謝
2016-12-25 17:05:38
隨著電路規(guī)模不斷擴(kuò)大，以及競(jìng)爭(zhēng)帶來(lái)的上市時(shí)間的壓力，越來(lái)越多的電路設(shè)計(jì)者開(kāi)始利用設(shè)計(jì)良好的、經(jīng)反復(fù)驗(yàn)證的電路功能模塊來(lái)加快設(shè)計(jì)進(jìn)程。這些電路功能模塊被稱為IP(Intellectual Property)核。
2019-11-04 07:40:53
剛剛接觸IP核做FFT，現(xiàn)在用的是FFTV9.0，已經(jīng)建立了一個(gè)IP核，但是如何仿真呢？是用quartus自帶軟件，還是要用MATLAB？抑或其他？我用的自帶軟件，但是什么也沒(méi)有出來(lái)。正確的辦法應(yīng)該怎樣呢，謝謝指點(diǎn)。
2011-04-21 10:22:31
對(duì)于深入學(xué)習(xí)使用FPGA的小伙伴們，特別是一些復(fù)雜的、大規(guī)模的設(shè)計(jì)應(yīng)用，適宜的IP核對(duì)開(kāi)發(fā)能起到事半功倍的作用。IP核的概念與我們sdk里庫(kù)的概念相似。IP即電路功能模塊，用戶可以直接調(diào)用這些模塊
2024-04-29 21:01:16
quartus ii9.0創(chuàng)建的ip核，生成的一些文件，（.qip、 add_sub_bb.v、add_sub.v）這些文件都有用嗎，想在其他工程里調(diào)用這些IP核，這幾個(gè)文件全部要添加嗎？
2013-07-02 17:20:01
核的分類和特點(diǎn)是什么？基于IP核的FPGA設(shè)計(jì)方法是什么？
2021-05-08 07:07:01
引言隨著半導(dǎo)體技術(shù)的發(fā)展,深亞微米工藝加工技術(shù)允許開(kāi)發(fā)上百萬(wàn)門(mén)級(jí)的單芯片，已能夠?qū)⑾到y(tǒng)級(jí)設(shè)計(jì)集成到單個(gè)芯片中即實(shí)現(xiàn)片上系統(tǒng)SoC。IP核的復(fù)用是SoC設(shè)計(jì)的關(guān)鍵，但困難在于缺乏IP核與系統(tǒng)的接口標(biāo)準(zhǔn)
2019-06-11 05:00:07
Viterbi譯碼的基本過(guò)程,接著根據(jù)Viterbi譯碼器IP核的特點(diǎn),分別詳細(xì)介紹了并行結(jié)構(gòu)、混合結(jié)構(gòu)和基于混合結(jié)構(gòu)的增信刪余3種Viterbi譯碼器IP核的主要性能和使用方法,并通過(guò)應(yīng)用實(shí)例給出了譯碼器IP
2010-04-26 16:08:39
我畢業(yè)設(shè)計(jì)要做一個(gè)基于FPGA的IP核的DDS信號(hào)發(fā)生器，但是我不會(huì)用DDS的IP核，有沒(méi)有好人能發(fā)我一份資料如何用IP核的呀。我的瀏覽器下載不了網(wǎng)站上的資料，所以只能發(fā)帖求幫忙了。
2015-03-10 11:46:40
on Chip)是以嵌入式系統(tǒng)為核心，以IP復(fù)用技術(shù)為基礎(chǔ)，集軟、硬件于一體的設(shè)計(jì)方法。使用IP復(fù)用技術(shù)，將UART集成到FPGA器件上，可增加系統(tǒng)的可靠性，縮小PCB板面積；其次由于IP核的特點(diǎn)
2019-08-20 07:53:46
什么是三相全控橋整流電路？怎樣去設(shè)計(jì)IP軟核？怎樣對(duì)IP軟核進(jìn)行仿真及驗(yàn)證？
2021-04-23 07:12:38
本人FPGA小白一枚，最近使用到FPGA的IP核遇到一個(gè)問(wèn)題。比如說(shuō)：某個(gè)IP，用于計(jì)算sin函數(shù)，使用了流水線機(jī)制，所有從輸入到輸出需要20個(gè)時(shí)鐘周期的延時(shí)。另外，還有一個(gè)IP，從輸入到輸出需要1
2021-06-19 11:06:07
請(qǐng)問(wèn)Altera RAM IP核怎么使用？
2022-01-18 06:59:33
這是我們一個(gè)小比賽的題面：設(shè)計(jì)一個(gè)簡(jiǎn)易的電子計(jì)算器電路，包括輸入數(shù)據(jù)處理電路，算數(shù)運(yùn)算電路（包含加法、減法、乘法、除法等算數(shù)運(yùn)算），運(yùn)算結(jié)果處理電路，所有運(yùn)算電路的設(shè)計(jì)均不可使用IP核及查找表進(jìn)行
2018-04-06 20:46:11
以SCI接口電路為例，介紹基于FPGA器件的接口電路IP核如何去設(shè)計(jì)？
2021-04-28 06:10:23
章禮宏 范全潤(rùn)1 引言隨著電路規(guī)模不斷擴(kuò)大，以及競(jìng)爭(zhēng)帶來(lái)的上市時(shí)間的壓力，越來(lái)越多的電路設(shè)計(jì)者開(kāi)始利用設(shè)計(jì)良好的、經(jīng)反復(fù)驗(yàn)證的電路功能模塊來(lái)加快設(shè)計(jì)進(jìn)程。這些電路功能模塊被稱為IP
2019-07-29 08:33:45
提出一種可進(jìn)化IP 核的設(shè)計(jì)和實(shí)現(xiàn)方法。這種IP 核采用進(jìn)化硬件的設(shè)計(jì)思想， 將遺傳算法運(yùn)用于硬件電路的設(shè)計(jì)中，使電路能根據(jù)當(dāng)前的環(huán)境自動(dòng)進(jìn)行內(nèi)部電路的進(jìn)化，從而生成最
2009-05-16 14:33:28
14 IP核生成器生成ip后有兩個(gè)文件對(duì)我們比較有用，假設(shè)生成了一個(gè)asyn_fifo的核，則asyn_fifo.veo給出了例化該核方式（或者在Edit－>Language Template->COREGEN中找到verilog/VHDL的例化方式）
2009-07-21 16:42:120 IC設(shè)計(jì)技術(shù)中的IP核互連:隨著IC 設(shè)計(jì)復(fù)雜度的不斷提高，在SoC 中集成的IP 核越來(lái)越多，基于片上總線的SOC 設(shè)計(jì)技術(shù)解決了大規(guī)模集成電路的設(shè)計(jì)難點(diǎn)，但是片上總線的應(yīng)用帶來(lái)了
2009-10-14 12:50:238 隨著集成電路設(shè)計(jì)復(fù)雜度的提高和產(chǎn)品上市時(shí)間壓力的增大，基于IP 核復(fù)用的SoC 設(shè)計(jì)已成為一種重要的設(shè)計(jì)方法。在SoC 中集成的IP 核越來(lái)越多時(shí)，IP 核的互連策略和方法就成
2009-11-28 14:40:468 USB設(shè)備接口IP核的設(shè)計(jì):討論了用Verilog硬件描述語(yǔ)言來(lái)實(shí)現(xiàn)USB設(shè)備接口IP核的方法，并進(jìn)行了FPGA的驗(yàn)證。簡(jiǎn)要介紹USB系統(tǒng)的體系結(jié)構(gòu)，重點(diǎn)描述USB設(shè)備接口IP核的結(jié)構(gòu)劃分和各模塊的
2010-01-08 18:15:3822 以 FPGA 技術(shù)為基礎(chǔ)，以Verilog HDL 為載體，設(shè)計(jì)了遵守Wishbone 片上總線規(guī)范的IP 核接口，實(shí)現(xiàn)了片上系統(tǒng)的IP 核互聯(lián)。
2010-01-13 15:09:1413 基于Avalon總線的可配置LCD 控制器IP核的設(shè)計(jì)
本文討論了基于Avalon 總線流傳輸?shù)呐渲肔CD 顯示控制器IP 核的設(shè)計(jì)，根據(jù)自頂向下的設(shè)計(jì)思想，將IP 核進(jìn)行層次功能
2010-02-09 09:34:4427 本文詳述了一種基于AMBA總線接口的IIC總線控制器IP核設(shè)計(jì)，給出了該IP核的系統(tǒng)結(jié)構(gòu)以及各個(gè)子模塊的詳細(xì)設(shè)計(jì)方法，并對(duì)該IP核進(jìn)行了功能仿真、FPGA原型驗(yàn)證，可測(cè)性設(shè)計(jì)以
2010-07-17 16:20:2221 基于BIST的編譯碼器IP核測(cè)
隨著半導(dǎo)體工藝的發(fā)展，片上系統(tǒng)SOC已成為當(dāng)今一種主流技術(shù)?；?b class="flag-6" style="color: red">IP復(fù)用的SOC設(shè)計(jì)是通過(guò)用戶自定義邏輯(UDL)和連線將IP核整合
2008-12-27 09:25:391195 
I2C器件接口IP核的CPLD設(shè)計(jì)
根據(jù)單片機(jī)I2C串行擴(kuò)展的特點(diǎn)，在EDA軟件MaxplusII的環(huán)境下，利用AHDL語(yǔ)言，建立IP核。此設(shè)計(jì)利用狀態(tài)機(jī)實(shí)現(xiàn)，在給出設(shè)計(jì)的同時(shí)詳細(xì)說(shuō)明IP核的建立
2009-03-28 16:21:351351 
摘 要： 根據(jù)單片機(jī)I2C串行擴(kuò)展的特點(diǎn)，在EDA軟件MaxplusII的環(huán)境下，利用AHDL語(yǔ)言，建立IP核。此設(shè)計(jì)利用狀態(tài)機(jī)實(shí)現(xiàn)，在給出設(shè)計(jì)的同時(shí)詳細(xì)說(shuō)明IP核的建立過(guò)程，并下載到
2009-06-20 13:36:121065 
基于PCI IP核的碼流接收卡的設(shè)計(jì)
本文介紹了一種基于Altera公司的PCI接口IP核的DVB碼流接收系統(tǒng)的硬件設(shè)計(jì)方案及設(shè)計(jì)要點(diǎn)的分析。該設(shè)計(jì)采用Altera公司的新一代FPGA
2009-09-26 18:02:08912 
介紹了FreeARM7 IP核的基本概況及其接口特點(diǎn)，以LPC2101為原型對(duì)該IP核進(jìn)行了擴(kuò)展。結(jié)合USB 1.1設(shè)備控制器IP核和自定制硬件邏輯，構(gòu)建了一種微控制器功能驗(yàn)證回路。
2011-04-06 11:41:132369 
本文介紹的基于Wishbone總線的UART IP核的設(shè)計(jì)方法，通過(guò)驗(yàn)證表明了各項(xiàng)功能達(dá)到預(yù)期要求，為IP核接口的標(biāo)準(zhǔn)化設(shè)計(jì)提供了依據(jù)。此外，該IP核代碼全部采用模塊化的Verilog-HDL語(yǔ)言編寫(xiě)，
2011-06-10 11:47:374199 
文章采用TOP-DOWN 的方法設(shè)計(jì)了 AMBA 總線IP 核!它包括AHB 和APB兩個(gè)子IP 核 所有AMBA結(jié)構(gòu)模塊均實(shí)現(xiàn)了RTL級(jí)建模
2011-07-25 18:10:5293 介紹了SoPC（System on a Programmable Chip）系統(tǒng)的概念和特點(diǎn)，給出了基于PLB總線的異步串行通信（UART）IP核的硬件設(shè)計(jì)和實(shí)現(xiàn)。通過(guò)將設(shè)計(jì)好的UART IP核集成到SoPC系統(tǒng)中加以驗(yàn)證，證明了所
2012-03-05 17:53:4963 我國(guó)集成電路設(shè)計(jì)業(yè)的高速發(fā)展帶動(dòng)IP核市場(chǎng)穩(wěn)步擴(kuò)大，國(guó)內(nèi)企業(yè)對(duì)IP核的數(shù)量、質(zhì)量和服務(wù)的需求都在不斷增加。
2012-12-23 12:28:421459 定制簡(jiǎn)單LED的IP核的設(shè)計(jì)源代碼
2012-12-23 16:43:5375 FPGA中IP核的生成，簡(jiǎn)單介紹Quartus II生成IP核的基本操作，簡(jiǎn)單實(shí)用挺不錯(cuò)的資料
2015-11-30 17:36:1512 Xilinx FPGA工程例子源碼：PCI Express IP核應(yīng)用參考設(shè)計(jì)
2016-06-07 14:13:4314 Xilinx FPGA工程例子源碼：USB IP核
2016-06-07 14:41:5713 基于8051內(nèi)核IP核的應(yīng)用，感興趣的小伙伴們可以瞧一瞧。
2016-11-11 18:18:321 一種小規(guī)模LCD驅(qū)動(dòng)電路IP核的設(shè)計(jì)
2017-01-14 12:35:3911 IP核（IP Core） Vivado中有很多IP核可以直接使用，例如數(shù)學(xué)運(yùn)算（乘法器、除法器、浮點(diǎn)運(yùn)算器等）、信號(hào)處理（FFT、DFT、DDS等）。IP核類似編程中的函數(shù)庫(kù)（例如C語(yǔ)言
2017-02-08 13:08:113085 
電子設(shè)計(jì)工程 基于FPGA的Flexray IP核通信的研究與實(shí)現(xiàn)
2017-08-30 16:08:3213 本文介紹了LCD的通用驅(qū)動(dòng)電路IP核設(shè)計(jì)，采用自頂向下的設(shè)計(jì)方法將其劃分為幾個(gè)主要模塊，分別介紹各個(gè)模塊的功能，用VHDL語(yǔ)言對(duì)其進(jìn)行描述，用FPGA實(shí)現(xiàn)并通過(guò)了仿真驗(yàn)證。該IP核具有良好的移植性
2017-10-26 17:21:5915 IP核（IP Core） Vivado中有很多IP核可以直接使用，例如數(shù)學(xué)運(yùn)算（乘法器、除法器、浮點(diǎn)運(yùn)算器等）、信號(hào)處理（FFT、DFT、DDS等）。IP核類似編程中的函數(shù)庫(kù)（例如C語(yǔ)言
2017-11-15 11:19:1410744 本文檔內(nèi)容介紹了建立用戶自己的IP核的操作步驟，供參考
2018-04-03 11:26:514 大家好，又到了每日學(xué)習(xí)的時(shí)間了，今天咱們來(lái)聊一聊vivado 調(diào)用IP核。 首先咱們來(lái)了解一下vivado的IP核，IP核（IP Core）：Vivado中有很多IP核可以直接使用，例如
2018-05-28 11:42:1438569 AD的IP核哪里有？
2018-10-06 15:37:29469 利用IP核設(shè)計(jì)電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán)，盡管IP核的市場(chǎng)活動(dòng)還不規(guī)范，但是仍有許多集成電路設(shè)計(jì)公司從事IP核的設(shè)計(jì)、開(kāi)發(fā)和營(yíng)銷工作。
2019-12-19 07:06:002168 
利用IP核設(shè)計(jì)電子系統(tǒng)，引用方便，修改基本元件的功能容易。具有復(fù)雜功能和商業(yè)價(jià)值的IP核一般具有知識(shí)產(chǎn)權(quán)，盡管IP核的市場(chǎng)活動(dòng)還不規(guī)范，但是仍有許多集成電路設(shè)計(jì)公司從事IP核的設(shè)計(jì)、開(kāi)發(fā)和營(yíng)銷工作。
2019-10-08 07:07:001949 由于CPLD數(shù)字設(shè)計(jì)結(jié)構(gòu)化的趨勢(shì)，將出現(xiàn)針對(duì)CPLD不同層次的IP（Intellectual Property）核。各個(gè)IP核可重復(fù)利用，可大大提高設(shè)計(jì)能力和效率。國(guó)外各大公司都推出了專門(mén)的IP核，我國(guó)也迫切需要發(fā)展自己的IP核。本文針對(duì)I2C的主方式串行擴(kuò)展通信的特點(diǎn)，詳細(xì)給出設(shè)計(jì)過(guò)程和結(jié)果。
2020-04-07 09:54:104073 
? Xilinx公司的FPGA中有著很多的有用且對(duì)整個(gè)工程很有益處的IP核，比如數(shù)學(xué)類的IP核，數(shù)字信號(hào)處理使用的IP核，以及存儲(chǔ)類的IP核，本篇文章主要介紹BRAM ?IP核
2020-12-29 15:59:3913270 提出一種可進(jìn)化IP核的設(shè)計(jì)和實(shí)現(xiàn)方法。這種IP核采用進(jìn)化硬件的設(shè)計(jì)思想，將遺傳算法運(yùn)用于硬件電路的設(shè)計(jì)中，使電路能根據(jù)當(dāng)前的環(huán)境自動(dòng)進(jìn)行內(nèi)部電路的時(shí)化，從而生成最有效的電路，并能在普通的FPGA器件
2021-06-22 14:37:403382 
在仿真Vivado IP核時(shí)分兩種情況，分為未使用SECURE IP核和使用了SECURE IP核。
2023-06-06 14:45:432875 
Vivado IP核提供了強(qiáng)大的FIFO生成器，可以通過(guò)圖形化配置快速生成FIFO IP核。
2023-08-07 15:36:287270 
在給Vivado中的一些IP核進(jìn)行配置的時(shí)候，發(fā)現(xiàn)有Shared Logic這一項(xiàng)，這里以Tri Mode Ethernet MAC IP核為例，如圖1所示。
2023-09-06 17:05:123014 
整體而言，作為集成電路產(chǎn)業(yè)上游的IP核領(lǐng)域，市場(chǎng)呈現(xiàn)出前所未有的壟斷與集中態(tài)勢(shì)。2013 年，全球半導(dǎo)體 IP 市場(chǎng)規(guī)模達(dá)到 24.5億美元，較2012年增長(zhǎng)了 11.5%。ARM 以 43.2%的市場(chǎng)占有率遙遙領(lǐng)先，穩(wěn)居龍頭地位。
2023-10-18 17:02:441904 電子發(fā)燒友網(wǎng)站提供《HDLC協(xié)議IP核的設(shè)計(jì)與實(shí)現(xiàn).pdf》資料免費(fèi)下載
2023-11-08 15:45:335 電子發(fā)燒友網(wǎng)站提供《LCD的通用驅(qū)動(dòng)電路IP核設(shè)計(jì).doc》資料免費(fèi)下載
2023-11-15 11:15:372 Xilinx公司的FPGA中有著很多的有用且對(duì)整個(gè)工程很有益處的IP核，比如數(shù)學(xué)類的IP核，數(shù)字信號(hào)處理使用的IP核，以及存儲(chǔ)類的IP核，本篇文章主要介紹BRAM IP核的使用。 BRAM是FPGA
2023-12-05 15:05:023291 在使用FPGA的時(shí)候，有些IP核是需要申請(qǐng)后才能使用的，本文介紹如何申請(qǐng)xilinx IP核的license。
2024-10-25 16:48:322275 
在創(chuàng)新加速的浪潮中，為更好地響應(yīng)客戶群需求， 芯驛電子 ALINX 推出全新 IP 核產(chǎn)品線 ，致力于為高性能數(shù)據(jù)傳輸和復(fù)雜計(jì)算需求提供 高帶寬、低延遲 的解決方案。發(fā)布的第一批 IP 核包括
2024-10-30 17:39:431459 
本文介紹了Vidado中FFT IP核的使用，具體內(nèi)容為：調(diào)用IP核>>配置界面介紹>>IP核端口介紹>>MATLAB生成測(cè)試數(shù)據(jù)>>測(cè)試verilogHDL>>TestBench仿真>>結(jié)果驗(yàn)證>>FFT運(yùn)算。
2024-11-06 09:51:435640 
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