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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

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基于FPGA的DDS芯片實現(xiàn)雷達線性調(diào)頻信號系統(tǒng)的設計

線性調(diào)頻信號可以獲得較大的壓縮比，有著良好的距離分辨率和徑向速度分辨率，所以線性調(diào)頻信號作為雷達系統(tǒng)中一種常用的脈沖壓縮信號，已經(jīng)廣泛應用于高分辨率雷達...

2019-05-03 標簽：fpga 芯片 dds 7.8k 0

基于FPGA+ARM多路千兆以太網(wǎng)通信接口設計

隨著人工智能、大數(shù)據(jù)和物聯(lián)網(wǎng)等新興技術(shù)的發(fā)展，原始數(shù)據(jù)井噴式地涌現(xiàn)出來，這也對接口提出了更高的要求[1?2]，高速、可靠的傳輸接口往往是整個項目的技術(shù)關鍵。

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如何通過軟件?無線?電?推進?無線?原型?驗證?

Xilinx Zynq UltraScale+ FPGA的可編程邏輯組件擁有的FPGA資源比其他USRP產(chǎn)品多一倍，可提供高吞吐量的數(shù)字信號處理(DSP...

2021-08-10 標簽：fpga 無線電嵌入式處理器 7.8k 0

鎖存器與觸發(fā)器的概念及其區(qū)別

請簡述鎖存器與觸發(fā)器的概念，并分析二者的區(qū)別。

2023-08-15 標簽：fpga 鎖存器數(shù)字電路 7.8k 0

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2018-06-20 標簽：fpga altera 數(shù)碼管 7.8k 0

基于Block Design方法的Vivado FIR濾波器設計與仿真

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2021-01-02 標簽：dsp fpga 濾波器 7.8k 0

通過 FPGA-DIY 開發(fā)板實現(xiàn) LED 跑馬燈

gymdove 的FPGA-DIY LED 跑馬燈視頻。

2018-06-20 標簽：fpga altera diy 7.8k 0

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對大多數(shù)數(shù)據(jù)中心和網(wǎng)絡服務供應商來說，如果想要保持競爭力，就必須不斷地提高網(wǎng)絡速率來滿足人們?nèi)找嬖鲩L的網(wǎng)絡需求。據(jù)權(quán)威機構(gòu)統(tǒng)計，到2018年，全球?qū)?..

2017-09-21 標簽：fpga Xilinx 7.7k 0

基于FPGA的IIR數(shù)字帶通濾波器的設計方案及實現(xiàn)

本方案利用FPGA實現(xiàn)了巴特沃茲IIR數(shù)字帶通濾波器，并給出較為詳細的方案設計過程。實驗結(jié)果證明了所設計的濾波器完全滿足預定設計要求，從而也證實了本方案...

2014-02-13 標簽：FPGA 數(shù)字濾波器 A/D轉(zhuǎn)換器 7.7k 0

在FPGA和DSP兩種處理器之間實現(xiàn)SRIO協(xié)議的方法

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2023-02-27 標簽：處理器 dsp fpga 7.7k 0

基于CSMA／CA的MAC協(xié)議設計實現(xiàn)

嵌入式技術(shù)的發(fā)展對MAC協(xié)議的實現(xiàn)也提供了很好的技術(shù)支撐。本文搭建了一種基于 ARM 和 FPGA 相結(jié)合的嵌入式開發(fā)平臺，并在此基礎上設計與實現(xiàn)了基于...

2018-03-28 標簽：fpga arm mac協(xié)議 7.7k 0

基于ARM和FPGA的嵌入式數(shù)控系統(tǒng)設計

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2013-05-31 標簽：FPGA ARM 嵌入式 7.7k 1

相比GPU和GPP，F(xiàn)PGA是深度學習的未來？

相比GPU和GPP，F(xiàn)PGA在滿足深度學習的硬件需求上提供了具有吸引力的替代方案。憑借流水線并行計算的能力和高效的能耗，F(xiàn)PGA將在一般的深度學習應用中...

2016-07-28 標簽：FPGA GPU 機器學習 7.7k 0

DDR3帶寬的計算方法

我們在買DDR內(nèi)存條的時候，經(jīng)常會看到這樣的標簽DDR3-1066、DDR3-2400等，這些名稱都有什么含義嗎？請看下表。

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基于Cyclone IV GX系列的FPGA的PCIe接口設計詳解

PCI Express（PCIe）是一種高性能互連協(xié)議，可應用于網(wǎng)絡適配、圖形加速、服務器、大數(shù)據(jù)傳輸、嵌入式系統(tǒng)等領域。PCIe協(xié)議在軟件層上可兼容于...

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集成邏輯分析儀(ILA)的使用方法

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普通IO可以通過BUFG再連到PLL的時鐘輸入上,但要修改PLL的設置 input clk的選項中要選擇"No Buffer";

2017-02-09 標簽：FPGA 賽靈思 Xilinx 7.7k 0

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2021-01-21 標簽：fpga 原理圖 JTAG 7.7k 0

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【紫光同創(chuàng)國產(chǎn)FPGA教程】【第五章】串口收發(fā)實驗

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2021-02-04 標簽：fpga 串口 UART 7.7k 0

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