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      FPGA之家

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      賽靈思7系列的FPGA上電配置流程

      一、FPGA配置引腳說明 1、CFGBVS 如果VCCO0連接至2.5V或3.3V，CFGBVS連接....
      的頭像 FPGA之家 發(fā)表于 01-18 13:43 ?14175次閱讀
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      如何借助Cyclone 10 GX ATX PLL refclk切換實(shí)施功能模擬

      你知道如何借助Cyclone 10 GX ATX PLL refclk切換實(shí)施功能模擬嗎？嵌入式流轉(zhuǎn)....
      的頭像 FPGA之家 發(fā)表于 01-18 13:38 ?3203次閱讀

      怎樣下載Xilinx官網(wǎng)的文件

      小編，小編，求救，賽靈思官網(wǎng)的文件下載不下來啊 啥情況啊？ ? ? 好慢。而且總是失敗。。。。 好吧....
      的頭像 FPGA之家 發(fā)表于 01-18 11:57 ?10907次閱讀

      相位偏移調(diào)制：一種利用相位差異的信號來傳送資料的調(diào)制方式

      相位偏移調(diào)制，又稱移相鍵控（PSK，Phase Shift Keying）是一種利用相位差異的信號來....
      的頭像 FPGA之家 發(fā)表于 01-18 11:51 ?6541次閱讀

      FPGA開發(fā)工具套餐搭配推薦以及軟件鏈接

      一、Xilinx(全球FPGA市場份額最大的公司，其發(fā)展動態(tài)往往也代表著整個(gè)FPGA行業(yè)的動態(tài)) (....
      的頭像 FPGA之家 發(fā)表于 01-18 11:48 ?3754次閱讀

      通信數(shù)字信號處理的一些基本知識

      1、符號能量問題 請問各位大蝦，像4QAM，16QAM，32QAM，64QAM調(diào)制每符號平均能量怎么....
      的頭像 FPGA之家 發(fā)表于 01-18 11:35 ?7637次閱讀

      常見的ADC類型及原理，以及可能容易掉進(jìn)去的坑

      本文來梳理ADC兩個(gè)方面的內(nèi)容，常見的ADC類型及原理，以及可能容易掉進(jìn)去的坑。 談?wù)勎覟槭裁凑磉@....
      的頭像 FPGA之家 發(fā)表于 01-18 11:31 ?13130次閱讀
      常見的ADC類型及原理，以及可能容易掉進(jìn)去的坑

      FPGA中的時(shí)鐘相關(guān)概念

      一、時(shí)鐘相關(guān)概念 理想的時(shí)鐘模型是一個(gè)占空比為50%且周期固定的方波。Tclk為一個(gè)時(shí)鐘周期，T1為....
      的頭像 FPGA之家 發(fā)表于 01-15 09:37 ?5799次閱讀
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      FPGA布局及資源優(yōu)化

      1.項(xiàng)目需求 FPGA ：V7-690T兩片 Resource:兩片F(xiàn)PGA通過X12 gth互聯(lián)；....
      的頭像 FPGA之家 發(fā)表于 01-07 10:15 ?5919次閱讀
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      NandFlash基礎(chǔ)知識和幾類NAND壞塊管理方法

      概述 Flash名稱的由來，F(xiàn)lash的擦除操作是以block塊為單位的，與此相對應(yīng)的是其他很多存儲....
      的頭像 FPGA之家 發(fā)表于 01-07 10:12 ?9008次閱讀
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      經(jīng)典卡爾曼濾波算法步驟

      卡爾曼濾波實(shí)質(zhì)上就是基于觀測值以及估計(jì)值二者的數(shù)據(jù)對真實(shí)值進(jìn)行估計(jì)的過程。預(yù)測步驟如圖1所示： 圖1....
      的頭像 FPGA之家 發(fā)表于 01-07 10:08 ?11302次閱讀

      英特爾積極支持構(gòu)建以小芯片為核心的行業(yè)生態(tài)系統(tǒng)

      作為一名電子人，咱們都知道隨著摩爾定律的提出，為半導(dǎo)體產(chǎn)業(yè)指明了之后幾十年的發(fā)展之路。然而許多人不知....
      的頭像 FPGA之家 發(fā)表于 01-07 10:04 ?2053次閱讀

      Linux內(nèi)核中I2C子系統(tǒng)的整體視圖

      本文通過閱讀內(nèi)核代碼，來梳理一下I2C子系統(tǒng)的整體視圖。在開發(fā)I2C設(shè)備驅(qū)動程序時(shí)，往往缺乏對于系統(tǒng)....
      的頭像 FPGA之家 發(fā)表于 12-31 10:40 ?3006次閱讀
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      通信中調(diào)制概念的理解及種類

      調(diào)制的概念 調(diào)制（modulation）就是對信號源的信息進(jìn)行處理加到載波上，使其變?yōu)檫m合于信道傳輸....
      的頭像 FPGA之家 發(fā)表于 12-31 10:37 ?9798次閱讀
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      學(xué)會讀源碼特別重要

      剛參加工作那會，沒想過去讀源碼，更沒想過去改框架的源碼；總想著別人的框架應(yīng)該是完美的、萬能的，應(yīng)該不....
      的頭像 FPGA之家 發(fā)表于 12-31 10:29 ?2266次閱讀
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      賽靈思兩款劃時(shí)代“利器” 讓開發(fā)FPGA應(yīng)用可以信手拈來

      在大數(shù)據(jù)和人工智能盛行的今天，金融科技（Fintech）領(lǐng)域數(shù)據(jù)日益密集和敏感，在高頻交易、風(fēng)險(xiǎn)分析....
      的頭像 FPGA之家 發(fā)表于 12-28 09:50 ?2759次閱讀

      嵌入式系統(tǒng)裸機(jī)編程的內(nèi)存管理簡介

      ? 在嵌入式裸機(jī)編程中，作為一名初級的CODER。經(jīng)常要與CPU、內(nèi)存等打交道。CPU作為系統(tǒng)的動力....
      的頭像 FPGA之家 發(fā)表于 12-28 09:44 ?3954次閱讀
      嵌入式系統(tǒng)裸機(jī)編程的內(nèi)存管理簡介

      怎么利用官網(wǎng)和Vivado的Documention進(jìn)行相關(guān)的操作

      有的時(shí)候需要查找一些官網(wǎng)的例程進(jìn)行學(xué)習(xí)和參考，但是總感覺無從下手，今天就教大家怎么利用官網(wǎng)和Viva....
      的頭像 FPGA之家 發(fā)表于 12-28 09:39 ?3348次閱讀
      怎么利用官網(wǎng)和Vivado的Documention進(jìn)行相關(guān)的操作

      如何在Vitis中封裝加速平臺？

      這是《創(chuàng)建 Vitis 加速平臺》系列的第 3 篇博文。在前文中，我們講解了如何創(chuàng)建硬件和軟件工程。....
      的頭像 FPGA之家 發(fā)表于 12-26 10:20 ?3552次閱讀
      如何在Vitis中封裝加速平臺？

      我們看看JTAG的最初用途，邊界測試

      JTAG可以控制（or hijack）所有IC的引腳。在圖片上，也許JTAG將使所有CPU引腳輸出，....
      的頭像 FPGA之家 發(fā)表于 11-29 11:21 ?3141次閱讀
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      數(shù)字電路電平標(biāo)準(zhǔn)全解析

      在工業(yè)領(lǐng)域應(yīng)用最多的應(yīng)該是485 232的電平標(biāo)準(zhǔn)，兩者各有優(yōu)缺點(diǎn)，成本低，使用也比較簡單，但是依然....
      的頭像 FPGA之家 發(fā)表于 11-29 11:17 ?6131次閱讀

      使用UART協(xié)議與計(jì)算機(jī)進(jìn)行通信

      通用異步收發(fā)傳輸器（Universal Asynchronous Receiver/Transmit....
      的頭像 FPGA之家 發(fā)表于 11-29 11:12 ?3322次閱讀

      在芯片設(shè)計(jì)階段如何防護(hù)“單粒子翻轉(zhuǎn)”

      單粒子翻轉(zhuǎn)（Single-Event Upsets，SEU）指的是元器件受輻照影響引起電位狀態(tài)的跳變....
      的頭像 FPGA之家 發(fā)表于 11-29 11:07 ?8620次閱讀

      帶大家一起體驗(yàn)一下Vivado的ECO流程

      這里帶大家一起體驗(yàn)一下Vivado 的ECO流程，以vivado自帶的Example Design為....
      的頭像 FPGA之家 發(fā)表于 11-29 11:04 ?5381次閱讀
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      線程和進(jìn)程的關(guān)系與區(qū)別

      線程是CPU調(diào)度的最小單位(程序執(zhí)行流的最小單元)，它被包含在進(jìn)程之中，是進(jìn)程中的實(shí)際運(yùn)作單元。一條....
      的頭像 FPGA之家 發(fā)表于 11-29 11:01 ?14411次閱讀

      FPGA設(shè)計(jì)的8大重要知識點(diǎn)

      要求一個(gè)同時(shí)具備設(shè)計(jì)面積最小、運(yùn)行頻率最高是不現(xiàn)實(shí)的。更科學(xué)的設(shè)計(jì)目標(biāo)應(yīng)該是在滿足設(shè)計(jì)時(shí)序要求（包括....
      的頭像 FPGA之家 發(fā)表于 11-29 10:58 ?2173次閱讀

      關(guān)于CPU的12個(gè)必須知道的知識點(diǎn)

      作為一名程序員，與計(jì)算機(jī)打交道的日子不計(jì)其數(shù)，不管你玩硬件還是做軟件，你的世界自然都少不了計(jì)算機(jī)最核....
      的頭像 FPGA之家 發(fā)表于 11-05 18:10 ?5219次閱讀

      ZYNQ中DMA與AXI4總線

      ZYNQ中DMA與AXI4總線 為什么在ZYNQ中DMA和AXI聯(lián)系這么密切？通過上面的介紹我們知道....
      的頭像 FPGA之家 發(fā)表于 11-02 11:27 ?5172次閱讀
      ZYNQ中DMA與AXI4總線

      一個(gè)STM32串口DMA發(fā)送 接收（1.5Mbps波特率）機(jī)制

      偶然看到一篇很干文章，整理分享給大家： 1 前言 直接存儲器訪問（Direct Memory Acc....
      的頭像 FPGA之家 發(fā)表于 11-02 11:24 ?4438次閱讀
      一個(gè)STM32串口DMA發(fā)送 接收（1.5Mbps波特率）機(jī)制

      CPU為什么不做成圓形的？

      CPU的本體芯片被牢固安裝在封裝的中心。稱不上巧合的是CPU芯片的形狀同樣為矩形，所以我們就先來講一....
      的頭像 FPGA之家 發(fā)表于 11-01 11:24 ?2318次閱讀